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简介：本资源是一个面向电子工程、信号处理及嵌入式系统方向学习者与工程师的二阶Σ-Δ模数转换器（ADC）Simulink建模仿真包，聚焦高分辨率低速ADC设计核心原理——过采样、噪声整形与动态性能优化。压缩包共7个文件，含6个Simulink模型文件（.mdl），覆盖连续/离散域下的一阶与二阶Σ-Δ结构（含带噪声整形的CT/DT变体），以及1个MATLAB脚本（.m）用于参数配置或性能分析，总大小仅36KB，轻量易导入、便于教学演示与算法验证。已有476人下载学习，适用于高校课程实验、毕业设计仿真验证及ADC架构预研。用户可直接运行模型观察量化噪声分布、信噪比变化与输出频谱特性，深入理解积分器级联、反馈环路稳定性及数字抽取滤波等关键环节，为实际硬件实现提供可调参、可扩展的理论验证平台。 前阵子整理手头一个ADC建模项目，文件夹里躺着一个ADC2.rar的压缩包，里面是第二版修过的MATLAB脚本加Simulink模型。这个项目核心做的就是Sigma-Delta ADC的行为级建模仿真，工具链是MATLAB加Simulink。搞数据转换器的朋友应该都有同感：架构选型、性能评估、参数调试，光靠公式推导很难一步到位，Simulink里把模型搭起来跑一圈，很多问题当场就有数了。

这篇文章不打算讲那种教科书式的原理复述，而是把整个建模过程摊开：从噪声整形怎么影响SNR，到Simulink里每一步怎么搭，再到怎么从比特流里把ENOB算准，最后附上我踩过的坑和排查思路。适合三种人看：正在做Sigma-Delta ADC课题的学生，需要快速验证算法架构的工程师，以及想用Simulink做信号链仿真又没摸清门道的朋友。

1. 为什么这个ADC模型值得好好搭

1.1 行为级模型到底在模拟什么

说起ADC建模，很多人的第一反应是拿Cadence或者Spectre去做晶体管级仿真，把开关电容、运放、比较器一个个搭出来。这种级别的仿真精度确实高，但代价是仿真速度慢得吓人。一个二阶Sigma-Delta调制器，跑上万个采样点，可能要好几天。而行为级模型不一样，它不关心每个管子工作在哪个区，只看积分器、量化器、反馈DAC在输入输出层面怎么传递信号。

说白了，行为级模型是站在"系统工程师"的视角看问题：给定一个输入正弦波，经过积分器、量化器、反馈环路之后，输出比特流里信号和噪声的分布是什么样。这个视角下，Sigma-Delta调制器可以被抽象成几个关键模块的组合——离散积分器、1-bit量化器、单位延迟反馈，以及一组可调的环路系数。Simulink里面把这几块搭起来，仿真是瞬时完成的。

我这次项目的第一版是完全用MATLAB脚本写的，差分方程一层层算下来，结果虽然正确，但问题是很难做交互式调试。比如我想看看第一个积分器输出波形在哪个时间段饱和了，脚本模式下得自己画图找。而Simulink模型可以直接把Scope挂上去，随时盯任何一个节点的信号。到了第二版（就是ADC2.rar里的内容），我彻底转到了Simulink建模，效率和可维护性都提升了一大截。

1.2 Simulink建模相比代码建模的直接优势

用Simulink做Sigma-Delta建模，有几个实际收益是用了之后才体会到的。

第一是模块化带来的清晰度。积分器、增益、求和、量化器、延迟，每个功能都是独立模块，环路的信号流一眼就能看懂。代码模式下，一长串差分方程排在那里，过一个月自己回来都要重新捋一遍。Simulink模型则可以在模型图上直接标注系数，参数修改实时反映在结构里。

第二是参数扫描方便。Simulink里可以用Simulink Design Optimization或者单纯写个for循环配合set_param批量改参数，跑十组系数对比稳定性和SNR非常方便。这个在第3节实操里我会详细讲。

第三是后续扩展容易。行为级模型验证通过后，可以把量化器换成多bit版本，把理想积分器换成带噪声的模型，甚至可以加上开关电容的KT/C噪声、时钟抖动等非理想因素。这些在Simulink里都是加模块的事，脚本模式下就得重新改代码逻辑。

第四是数据后处理省事。Simulink可以用To Workspace模块直接把比特流导到MATLAB工作区，接着用MATLAB做PSD分析、SNR计算，链路是通的。

1.3 这次项目的整体思路与文件组织

简单交代一下ADC2.rar里整体的组织逻辑。压缩包里主要包含：一个sd_sim_1st.slx一阶调制器模型、一个sd_sim_2nd.slx二阶调制器模型、一个sd_analysis.m性能分析脚本，还有几个用于批量仿真的辅助函数。

整个项目的推进思路非常直白：先把规格定下来（信号带宽、过采样率、目标SNR），用理论公式估算阶数和OSR，然后在Simulink里搭模型跑仿真，用MATLAB脚本从比特流算出实际SNR和ENOB，对比理论值，最后根据结果微调系数。完整的闭环链路就是"理论推导→行为级建模→仿真验证→参数迭代"，整个过程一两天内就能跑通。

2. 建模前必须算清楚的这几个参数

2.1 过采样率、信噪比和有效位数之间的账

Sigma-Delta ADC最大的特点就是"以时间换精度"。它不需要像SAR ADC那样做高精度电容阵列匹配，而是用远高于奈奎斯特频率的采样率，把量化噪声推高频段，再用数字滤波器把带外噪声滤掉。这个"推噪声"的过程叫噪声整形，是通过环路里的积分器实现的。

建模之前，这张账必须算清楚。对于1-bit量化器的L阶Sigma-Delta调制器，理想SNR（单位dB）可以用下面这个公式估算：

SNR ≈ 6.02N + 1.76 + (20L + 10)log10(OSR) - 10log10(π^(2L)/(2L+1))

这里N是量化器位数，1-bit量化器取N=1；L是调制器阶数；OSR是过采样率，等于采样频率fs除以奈奎斯特频率（也就是信号带宽的两倍，或信号带宽为fb时OSR = fs/(2fb)）。

这个公式是建模前的第一道计算题。举个例子：二阶调制器（L=2）、1-bit量化器（N=1）、OSR=64时，理想SNR算出来大约是85dB左右，对应ENOB约13.8bit。如果OSR提到256，SNR能到115dB量级，对应ENOB接近19bit。当然这是理想值，实际会因为系数设置、稳定性余量、非理想噪声打个折扣。但至少建模之前心里有个数：我这个OSR和阶数，理论上限在哪里。

每个倍频程OSR（也就是OSR翻倍）能换来的SNR提升也很值得记：一阶调制器约9dB，二阶约15dB，三阶约21dB。这几组数字在评估方案时特别有用——如果目标SNR差一点，优先考虑升OSR还是升阶数，这笔账一算就知道。

2.2 调制器阶数与稳定性约束

阶数越高，噪声整形越陡，理论上SNR越高。但问题来了：高阶Sigma-Delta调制器有稳定性约束。一阶、二阶调制器只要输入幅度不超过满幅，基本稳定；三阶以上就需要仔细设计系数，整个环路才不至于在某些输入幅度下陷入极限环或者振荡。

具体到建模仿真，最直接的体现就是NTF（噪声传递函数）的峰值增益。工程上通常要求NTF的最大增益小于一定值（比如1.5到2），否则调制器在大输入信号下容易不稳定。实际操作中，很多设计者会用DelSig Toolbox这类工具来辅助设计NTF，然后把设计好的环路系数拿到Simulink里搭建验证。

我在这个项目里选的是二阶结构，原因很简单：一阶的噪声整形效果太弱，OSR要拉很高才能达到目标，仿真点数暴增；三阶以上在行为级验证阶段容易因为系数设置不当出现不稳定，排查起来麻烦。二阶是噪声整形效果和稳定性之间最稳妥的平衡点，适合把完整流程跑通。

2.3 结构选型：CIFB和CIFF怎么挑

同样的二阶调制器，在Simulink里可以按不同拓扑搭建。最常见的是CIFB（级联积分器反馈结构）和CIFF（级联积分器前馈结构）两种。

CIFB结构把反馈信号分别送到每一级积分器的输入端，优点是积分器输出摆幅相对可控，对运放摆幅要求低，但缺点是系数容易有分立的电阻电容比，实际实现时对元件精度要求高。CIFF结构则是把各级积分器输出前馈到量化器前的求和点，输入信号本身也有一条前馈路径，积分器只需要处理量化误差信号，所以积分器输出摆幅很小，对内部运放的线性度要求更低，在很多高精度Sigma-Delta ADC里更受青睐。

从Simulink建模角度，两者差别其实不大，就是几个求和点和增益模块的连接方式不同。但选型会影响后续往模型里加非理想因素时的复杂度，所以我建议在动手之前先想清楚自己要哪种拓扑。我这次用的是CIFF，一方面是想把积分器输出摆幅压小一点，方便后面加非理想噪声时信号不这么快饱和，另一方面也是想验证一下CIFF结构在Simulink里的搭建流程。如果你追求参数更接近实际芯片，CIFB会更适合。

2.4 参数规划表示例

建模前我把关键参数整理成一张表，照着这张表去搭建模型，不容易漏项：

这里有个关键点要重点说明：信号幅度一定不能取满幅。特别是二阶以上的调制器，满幅输入很容易触发不稳定，仿真跑出来比特流里会出现明显的周期振荡，SNR暴跌。通常取满幅的一半到三分之二比较稳妥。我一般用0.5V（满幅假设为±1V），既保证不触发稳定问题，又不会让信号功率太小导致SNR分析时信号被噪声淹没。

3. Simulink搭建Sigma-Delta调制器实录

3.1 在Simulink里跑通一阶Sigma-Delta调制器闭环

先讲最基础的一阶结构，这是我每次搭高阶模型之前的"冒烟测试"步骤。一阶调制器模型很小，但整个闭环的关键模块都在里面。

打开Simulink，新建一个空白模型，按下面这几步操作：

1. 拖一个Sum模块，作为输入信号与反馈信号的求差节点。双击配置符号为|+-，第一个输入为正，第二个输入为负。
2. 拖一个Discrete-Time Integrator，采样时间填1/fs（如果fs=1MHz，就填1e-6），积分方法选Forward Euler。这一步对应z域里的z^(-1)/(1-z^(-1))传递函数。
3. 拖一个Sign模块，作为1-bit量化器，输出为±1。
4. 拖一个单位延迟（Unit Delay）模块，采样时间同样填1/fs，放在量化器输出到反馈Sum之间。这个模块很关键，它同时承担了DAC反馈的延迟建模作用，也帮你避免了代数环问题。
5. 信号源用Sine Wave，幅度设0.5，频率按相干采样设置算好。
6. 最后用To Workspace模块把量化器输出导出去，变量名设为bits_out。

跑仿真之前，把求解器设成离散（discrete），因为整个模型都是离散模块，强行用连续求解器只会增加无谓的计算开销。仿真时间设为N_fft / fs。跑完以后，把bits_out拉到MATLAB工作区，这个一阶闭环就算通了。

验证手段非常直接：算一下bits_out里符号翻转的比例，在输入正弦波正半周期内，量化器输出应该以+1为主，负半周期以-1为主，而且翻转模式呈现明显的疏密变化（密度调制）。如果看到这个现象，说明闭环和噪声整形已经工作起来了。

3.2 二阶调制器：关键模块的参数设置细节

一阶闭环通了以后，升到二阶就顺理成章。二阶CIFF结构的Simulink实现，核心是在一阶基础上再加一级积积分器，并把两路前馈系数连接到量化器前的求和点。

我搭模型时的具体配置如下：

• 第一级积分器：模块参数与一阶相同，采样时间1/fs，Forward Euler。
• 第二级积分器：参数同上，输入连第一级积分器输出。
• 前馈求和：量化器前的Sum模块需要多个输入端口。第一路是输入信号乘以系数b1（前馈系数，用于把信号直接送到量化器之前，保证STF平坦），第二路是第一级积分器输出乘以a1，第三路是第二级积分器输出乘以a2。
• 反馈路径：量化器输出经过Unit Delay后，反馈到第一级积分器的输入求和点（负端），同时也可以选择反馈到第二级的输入端，取决于你设计的NTF形式。

关于系数的取值，有几个经验值可以参考。对于二阶CIFF结构，一组比较常用的系数是：a1=0.5、a2=0.25、b1=0.5，或者按"目标NTF零点"设计出来的归一化系数。在Simulink里这些系数就是Gain模块的Gain参数，改成什么值就代表什么环路拓扑特性。

这里有个非常容易踩的坑：第一级积分器输入端的Sum模块，输入信号和反馈信号同时进入时，反馈符号一定不能搞反。如果反馈接成同相，环路变成正反馈，模型跑出来输出直接方波化，SNR分析毫无意义。每次改模型前我都会花十秒钟检查一下反馈环路的符号方向。

3.3 激励源、仿真时间与数据导出怎么配置

仿真参数是整个项目的重要环节，配置不对，后面的SNR分析全是白做。

激励源方面，我用的是Simulink自带的Sine Wave模块，但频率不是随意取的。为了后续FFT分析不泄漏，需要满足相干采样的条件：fin = M * fs / N_fft，其中M是整数，最好是与N_fft互质的质数，N_fft是FFT点数。

我常用的组合是：N_fft=16384，fs=1MHz，取M=4093，那么fin = 4093 * 1e6 / 16384 ≈ 249817.8 Hz。看起来是个"奇怪"的频率，但正是这种频率才能保证采样的N_fft个点恰好覆盖整数个信号周期，FFT不会出现频谱泄漏。

仿真时间设为N_fft / fs，也就是16.384ms。跑完之后To Workspace导出的数据点正好是16384个，直接对应FFT点数。另外我习惯在Simulink配置里设置一个仿真停止条件或者额外的延时输入，让调制器先预热一段时间再正式记录数据——实际操作中可以看到刚开始的几个采样点处于瞬态建立过程，如果直接计入FFT分析，低频段会产生明显的人为噪声。

数据导出方面，To Workspace模块的变量名我固定用bits_out，数据格式选数组（Array），采样时间设为1/fs。这样导出的就是一个长度为N_fft的列向量，后面的MATLAB脚本可以直接用。

3.4 搭建中的几个关键细节：代数环、离散步长和输出值范围

搭建过程中有几个细节决定成败，单独拎出来说。

代数环（Algebraic Loop）是Simulink里Sigma-Delta建模最常见的报错。出现的原因是反馈路径中没有任何延迟模块，导致某个信号在同一个采样时刻内需要同时作为输入和输出。解决办法很简单：在反馈路径上插一个Unit Delay，或者在Sum模块设置里加入初始条件来处理反馈。Sigma-Delta本身的离散特性正好支持这种延迟建模，所以这不是理论问题，纯粹是建模技巧。

离散步长的设置需要全局统一。所有离散模块的采样时间必须一致，否则Simulink的多速率离散仿真会引入莫名其妙的周期误差。我习惯在模型根层用一个常量（比如Ts变量）定义采样时间，所有模块的采样时间引用这个变量，这样改采样率只需要改一处。

量化器输出值范围也值得留个心。Sign模块输出的是±1，如果后续要模拟实际DAC反馈的满幅电压（比如±Vref），需要在反馈路径上加一个增益模块把±1映射到±Vref。我为了便于对比理论公式，直接把Vref归一化为1，整个模型所有信号都工作在归一化幅度下，分析起来清爽很多。

4. 从比特流看性能：SNR和ENOB的评估流程

4.1 相干采样和数据预处理

仿真跑完，手上有16384个比特流数据点。直接对这些点做FFT然后算SNR是常见的错误做法。原因很简单：Simulink初始瞬态产生的非稳态数据混在里面，会把低频段频谱抬高。

正确的预处理流程是：取数据的中段稳定区域。比如总共导出了16384点，前三十分之一（约547点）舍弃，只取后面的15500点左右用于分析。这样虽然FFT点数不再是2的幂，但处理起来没有影响，甚至更真实。

如果你的仿真没按相干采样配置，那FFT之前必须加窗，比如Hanning窗或者Blackman-Harris窗。但加窗会改变噪声带宽的计算逻辑，SNR算出来需要修正。所以我强烈建议从一开始就按相干采样条件设置信号频率，省去一堆后处理麻烦。

4.2 用PSD计算SNR的完整流程

算SNR的核心思路是：对时域比特流做FFT得到幅度谱，然后把信号频段的功率算出来，再把除信号以外的噪声功率积分，两者相除。

我习惯在MATLAB里写一个calc_snr.m函数，流程如下：

1. 去掉初始瞬态数据，得到data向量。
2. 对data做FFT，取前一半（单边谱），计算功率谱密度。
3. 找到信号bin（就是fin对应的那一个FFT bin），把信号功率记为Ps。
4. 信号bin左右各留几个bin的保护区（一般±3~5个bin），把保护区内的功率排除。
5. 剩下的所有bin的功率累加，记为Pn（包含量化噪声和整形噪声）。
6. SNR = 10 * log10(Ps / Pn)，ENOB = (SNR - 1.76) / 6.02。

有个细节：计算噪声功率时要不要加窗？如果严格满足相干采样，可以直接用矩形窗（等效于不加窗），SNR算出来最准确。如果数据长度不是信号周期的整数倍，就必须加窗，并把噪声带宽归一化（ENBW因子）修正。这也是为什么我总是强调相干采样的重要性——它让后面的SNR计算简洁可靠。

4.3 仿真结果与理论值的对照

以我上面配置的二阶CIFF模型、OSR=64为例，仿真跑完算出来的SNR大概在75~80dB之间，理想公式给的是85dB左右，差距约5~10dB。这个差距是正常的，主要来源三个：一是CIFF系数并非按照理想NTF最优设计，环路系数带来的噪声整形效果略逊于理论极限；二是信号幅度取0.5V而非满幅，信号功率本身小了一截；三是有限仿真点数导致的频谱估计误差。

如果SNR偏差超过15dB，那多半不是"正常差距"，而是模型有bug。排查顺序是：先看输出波形是否正常密度调制，再看PSD曲线里信号附近有没有不该有的杂散，最后检查是不是仿真瞬态数据没去掉。

我提供一个经验判据：一阶调制器OSR=64时，理论约57dB，实测做到50~54dB是正常的。二阶调制器OSR=64，实测75~80dB正常。低于这些范围就要怀疑模型搭建或者SNR算法有问题。

4.4 非理想因素怎么往模型里加

行为级建模的价值在于快速迭代，验证完理想模型之后，往里面加非理想因素是水到渠成的事。这里简单列几个我常加的非理想模块：

• 积分器泄漏：给每个理想积分器并联一个小的泄漏因子（比如0.999），模拟有限运放增益导致的积分器泄漏。加完以后观察SNR下降多少，可以评估运放增益需求。
• 开关电容噪声（KT/C）：在每个积分器的输入端加一个白噪声源，噪声功率按kBT/C估算。这个参数直接影响低功耗设计的C值选择。
• 时钟抖动（jitter）：让DAC反馈的采样时刻带随机抖动，在Unit Delay前加一个随机延迟扰动模块。效果是带内噪声基底抬高，对高频输入尤其明显。
• 比较器失调：在Sign模块输入前加一个固定偏置，模拟比较器电压失调。一阶调制器对失调不敏感，高阶随输入信号有相关性，效果不同。

具体加非理想模块时，控制变量是关键。一次只加一种非理想因素，跑一次SNR，记录下降量。这样能清楚知道哪种非理想因素是当前性能瓶颈，后续设计优化时才有方向。

5. 建模中踩过的坑和排查思路

5.1 积分器饱和导致结果完全失真

最典型的现象是：模型搭完跑起来，比特流看起来像是方波，密度调制完全消失，SNR算出来是负的。排查之后发现是积分器输出饱和了。

Sigma-Delta调制器内部的积分器本质上是对误差信号的累积。当输入信号幅度过大或者系数设置偏大时，积分器输出会不断积分到运算放大器的电源轨。在行为级模型里，Discrete-Time Integrator的积分上限默认是无穷大，不会"饱和"，但输出值会变得非常大，导致量化器输入长期处于正向饱和区间，环路失去反馈调节能力。

解决办法有三条：一是把输入信号幅度降下来，比如从0.9V降到0.5V；二是调整环路系数，降低积分器路径的增益；三是给Discrete-Time Integrator设置饱和度输出限幅（在模块参数里选Limit output，上下限设为±Vref）。我建议排查顺序是：先看各积分器输出波形，确认是不是积分器输出异常，再决定用哪条方案。一般来说降输入幅度最快，但治本方案是调整系数。

5.2 仿真跑得太慢

Simulink仿真Sigma-Delta模型，理论上速度很快，有时候慢得离谱，大概率是求解器配置出了问题。

第一个坑：模型里混入了连续模块。比如把信号源用成了连续时间的Sine Wave，Simulink就会自动切换到变步长连续求解器，每一步都要做误差控制，速度骤降。解决办法是把Sine Wave的采样时间设为Ts，强制离散采样。

第二个坑：数据记录模块用了高采样间隔。To Workspace如果设置为按连续时间采样，会把每个求解器步长都记录下来，数据量爆炸。要显式设置采样时间为Ts，只记录需要的离散点。

第三个坑：仿真停了，但工作区数据巨大。16384个点不算多，但如果To Workspace没设置好，导出的可能是每个求解器子步的数据，处理起来内存开销大。设置对了之后，仿真应该在几秒内跑完。

5.3 频谱出现杂散和音调

比特流里如果出现明显的"音调"（tonal），PSD在特定频率出现尖峰，不是信号本身，而是调制器性能劣化的信号。

一阶调制器最容易出现音调问题，因为1-bit量化器与输入信号耦合时会产生与输入相关的模式噪声。这在高精度应用里很致命。解决方法是加dither（抖动），常见做法是在量化器输入前加一个幅度很小的随机信号（约0.1~0.5个LSB），打破量化模式与输入信号的相关性。

二阶以上的音调问题相对少，但高阶调制器在特定输入幅度下可能进入极限环，PSD出现离散尖峰。排查时先把输入幅度扫一遍（比如从0.1V到0.9V），如果某些幅度下出现尖峰而其他幅度正常，基本可以确定是极限环问题。这时要调系数，或者加dither，或者直接提高调制器阶数和更优化的NTF设计。

5.4 系数缩放经验

最后分享一个调试系数的实操经验。我在改系数的时候，一般遵循"等比例渐变"原则：每次只动一个系数，变化幅度控制在10%~20%，跑一次仿真看SNR，记录结果，再决定下一步。一次改多个系数的问题是，如果SNR变差了，你不知道是哪个系数造成的。

另外，给系数设边界很重要。a1、a2这类前馈系数通常都在0~1范围内，如果出现大于2的值，基本可以断定设计有误，不要盲目增加积分器增益去追SNR。增益太高不仅仅影响稳定性，还会放大积分器内部的非理想噪声，事倍功半。

我在调试过程中养成一个习惯：为每组系数做个MATLAB保存点，文件命名包含SNR和系数值，比如run_a1_0.5_a2_0.25_snr78.mat。这样批量调参后回头看，数据都在，不用重新跑仿真。

6. 从模型走向工程落地

6.1 后端的抽取滤波器设计

Sigma-Delta ADC的输出是高速1-bit比特流，只是个中间产物，要得到真正的数字输出，还必须经过抽取滤波器——先低通滤掉带外整形噪声，再做降采样。

搭建好调制器模型后，设计抽取滤波器是顺理成章的下一步。最常见的选择是CIC（级联积分梳状）滤波器，因为在1-bit输入下不需要乘法器，硬件实现便宜。对于二阶调制器，CIC阶数需要L+1=3阶才能匹配噪声整形的衰减特性。

在Simulink里，可以直接用DSP System Toolbox里的CIC Decimation模块做仿真验证。先把调制器比特流灌进去，然后看输出端的SNR，确认抽取后的信噪比与带内理论值一致。如果差得多，多半是CIC阶数不够或者滤波器通带滚降严重，需要加补偿滤波器。

6.2 与MCU采集链路的衔接

看到这里你可能要问：这个Simulink模型跟实际MCU里跑ADC采集有什么关系？其实关系非常大。

如今很多MCU（包括STM32系列）内置的是SAR型ADC，通过多通道扫描、循环采样+DMA的方式做连续数据采集。SAR ADC本身不做噪声整形，所以处理这类数据主要靠软件滤波，比如C语言里的算术平均、滑动平均、中位值滤波、一阶低通滤波等。这些滤波算法的参数怎么定，很大程度上依赖于对信号和噪声频段的判断——这正好是Simulink建模能提供的价值：你可以先把系统级信号链在Simulink里跑通，明确噪声分布和所需滤波阶数，然后把已经验证过的滤波参数直接翻译成C代码部署到MCU上。

我遇到不少项目，MCU侧ADC采出来的数据毛刺很大，工程师换个滤波参数试试，运气成分居多。如果事先在Simulink里把信号链建模、把噪声底摸清楚，落地时会从容很多。模型里验证过的一阶低通截止频率、CIC抽取值、滑动窗口长度，都是可以直接迁移到嵌入式代码里的参数。

6.3 跨场景：不同ADC架构建模的通用方法

最后说一点心得体会。Sigma-Delta只是ADC家族里的一支，但用Simulink做行为级建模的方法论是通用的。

不管什么架构的ADC（SAR、Flash、Pipeline、Sigma-Delta），建模思路都是同一个流程：先拆解架构的核心信号链，把"理想行为"用模块搭出来，跑仿真确认行为正确；再逐个加入非理想因素（噪声、失调、时钟抖动、非线性），观察系统指标的变化；最后做参数扫描，找到满足规格的最优设计点。

这套方法论的优势在项目迭代中体现得很明显：改架构、改参数、评估性能都是快速仿真搞定，不用每次都推倒重来。我现在的习惯是，任何ADC相关的项目，无论最终要不要流片，都先用Simulink做一版行为级模型，先把架构和参数空间摸清，再进入下一阶段设计。

最后再分享一个实际感受：行为级建模这件事，看着简单，但真正把每个模块、每个系数、每个后处理算法吃透，需要反复调试和记录。我建议你拿到任何一个ADC模型，先别急着改参数，把默认配置跑通，把仿真结果和理论公式对照一遍，再开始调参。我这次做ADC2.rar里的第二版模型，就是在第一版基础上重新梳理了系数、加了完整的SNR分析脚本，整体调试效率高了很多。这步基础工作省不得。

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