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做电源这行十几年，智能手机充电器大概是更新节奏最快的一类产品——功率从5W一路推到65W、120W，体积反而越做越小，协议从最简单的D+/D-短接一路演到USB PD 3.1的PPS精细调压。很多刚入行的朋友拿到一个"智能手机充电器系统方案设计"的任务，第一反应是找一个现成的参考设计，把原理图抄下来、变压器照着绕、PCB照搬布局，通电发现能出电压就以为大功告成，结果一上老化台就炸管、一送检就传导超标、一插手机就握不上手。这篇内容我想把充电器方案从骨架到细节完整拆一遍，讲清楚能量路径怎么划、变压器参数怎么算、协议怎么谈、安规和EMI怎么守、热怎么散，以及调试阶段那些反直觉的现象到底怎么解释。适合已经能看懂反激原理图、准备独立做一版方案的人，也适合做了几版但总在细节上翻车的同行对照着排查。

1. 手机充电器方案的骨架：市电到直流输出的能量路径怎么拆

1.1 五个功能块与它们之间真正的耦合关系

一款典型的手机充电器，无论标称18W还是65W，功能块划分几乎是固定的：输入整流滤波、功率变换（反激为主）、输出整流滤波、反馈与协议控制、保护与待机管理。教科书上把它们画成五个方框，看起来井井有条，但实际设计中最耗时间的恰恰是方框之间的耦合——输入滤波的X电容容量决定了差模EMI的起点，而这个起点又反过来影响变压器初级电感的下限；同步整流管的选型取决于匝比，匝比又受一次侧MOS耐压约束。也就是说，你不能先把某一块做到最优再拼起来，必须一开始就把这五块当成一个联立方程来解。

我一般的做法是先钉死三个边界条件：输入电压范围（90–264Vac通用还是窄范围）、输出规格（单口最大功率、电压电流档位）、外壳可用的体积。这三个条件一旦确定，拓扑选择空间就非常窄了。比如20W以内、体积要求苛刻，基本就是QR反激加同步整流；65W以上单口且要求高功率密度，很多方案会走有源钳位反激或者LLC，但成本和调试复杂度立刻上一个台阶，多口充电器为了共享变压器，又会回到反激配合二次侧多路DC-DC的架构。

真正容易被忽略的是"耦合"里的时间维度。空载时充电器绝大部分时间在打嗝或跳周期，此时输入电容上的电压是缓慢波动的，协议芯片的供电如果直接取自辅助绕组，就容易在打嗝间隙掉电复位，手机插上后协议握手的头几百毫秒内反复重启。这个问题在原理图阶段完全看不出来，只有做完整机插拔测试才会暴露。所以我在画框图阶段就会专门标一条"辅助供电与协议芯片供电"的路径，明确它是取辅助绕组、取输出端，还是单独用线性稳压从高压直接降下来。

1.2 功率等级如何切分拓扑与技术路线

18W到30W这一段，行业里几乎是QR反激的天下，原因是器件少、成本低、待机容易做低。30W到65W，QR反激仍然能用，但变压器体积和一次侧电流应力开始变得不友好，同步整流从"可选"变成"必选"，同时需要更好的钳位电路来压制漏感尖峰。65W以上，尤其在体积被严格限制的场景里，提升开关频率是必然选择，频率上去以后开关损耗和磁芯损耗同时增加，就得靠有源钳位、氮化镓器件或者两者结合来消化。

这里有一个很实际的取舍：开关频率从65kHz提到130kHz，变压器磁芯可以小一圈，但一次侧MOS的开关损耗大概翻倍，如果还用传统的硅MOS加RCD钳位，效率可能从90%掉到87%，多出来的损耗全部变成热量堆在密闭外壳里，反而更麻烦。所以在做方案选型时，我习惯先做一张粗略的损耗预算表，把一次侧导通损耗、开关损耗、变压器铜铁损、二次侧整流损耗、控制电路损耗各估一个数，加起来如果超过总输入功率的12%，就说明这条路线在当前体积下走不通，得换器件或者换拓扑。

下面的表是我在做中小功率方案时常用的一个对照，数字是经验区间，具体项目还要按实际器件参数修正。

1.3 一次侧与二次侧的隔离边界该怎么划

隔离边界不是简单画一条线，它决定了后面所有的安规距离、Y电容位置和PCB分区。我的习惯是把边界定在变压器骨架的中间挡墙和光耦（如果用了光耦）的爬电槽上，所有跨越这条线的东西只有三样：变压器、Y电容、反馈器件。任何一根额外的走线跨过去，都会成为安规和EMI的双重隐患。

实践中常见的问题是协议芯片的供电走线。有些方案为了省一个辅助绕组，让二次侧的协议芯片通过一颗高压启动器件从一次侧取电，这种设计在功能上没问题，但走线必须严格沿着隔离边界布置并做开槽处理，否则爬电距离直接被吃掉两三个毫米。我在评审别人的板子时，第一眼先看隔离带有没有被走线或铺铜"偷渡"，这一条不过关，后面做得再漂亮也是白费。

还有一点是关于Y电容的。它跨接在一次地和二次地之间，为共模噪声提供回流路径，容值直接受漏电流指标约束。按50Hz、220V计算，2.2nF对应的漏电流大约0.15mA，4.7nF对应0.32mA，而大多数终端产品对漏电流的要求在0.25mA以内，所以2.2nF是一个比较安全的默认值。想再压共模噪声，就得从变压器层间屏蔽和PCB布局上找办法，不能一味加大Y电容。

2. 反激变压器不是"绕够圈数就行"：磁芯、匝比与漏感的取舍

2.1 为什么QR反激在中小功率段依然是最优解

准谐振反激的核心优势在于利用MOS漏源电压谐振到谷底时开通，把开通损耗压到接近零。对手机充电器这种输入电压宽、负载变化剧烈、又要求待机极低的应用，这个特性非常划算：轻载时频率自然升高、周期跳变，效率曲线在10%负载附近还能维持在较高水平，这对能效认证里的四点平均效率（25%、50%、75%、100%）和待机功耗两项都是加分项。

但QR也有它的代价。谷底检测的消隐时间是绕不过去的坎，消隐窗口设得太短容易误触发、设得太长则谷底跟不准，直接影响效率；而谷底跟随在轻载下会导致频率飚得很高，开关损耗和驱动损耗随之上升，所以要靠频率钳位和跳周期来兜底。我在调这类方案时，通常先把满载和半载的谷底波形抓出来，确认在最低输入电压下能稳定跟在第二或第三谷底，再回头调轻载的频率上限，顺序反了会反复来回改。

另外要提醒的是，QR反激在输出侧短路或者电池深度亏电时，工作点会跑到非常低的输出电压，此时反射电压几乎消失，一次侧电流上升率变慢，如果变压器电感取值偏大，进入保护的时间就会被拖长，MOS承受的电流应力时间也变长。所以变压器设计阶段必须把"输出短路"当成一个正常工作点来校核，而不是当成异常。

2.2 匝比与占空比的联动计算，一笔一笔算清楚

很多方案翻车就翻在这里：匝比拍脑袋定一个，电感随手取值，最后靠加大吸收电路硬压尖峰，效率自然上不去。我把常用的计算链条写一遍，以65W、20V/3.25A、90–264Vac输入为例。

第一步定反射电压。反射电压VOR决定了一次侧MOS的电压应力，也决定了占空比的范围。取VOR=100V是一个折中值：太低则占空比大、电流有效值高、铜损大；太高则MOS电压应力紧张。MOS耐压估算公式为：

Vds_max = Vin_max_dc + VOR + Vspike

其中Vin_max_dc在264Vac输入时约为375V，Vspike是漏感引起的尖峰，钳位做得好大约80–100V。这样算下来是375+100+90≈565V，用650V器件余量只剩85V，比较紧；如果钳位做得差、尖峰到150V，那就必须换750V器件。这就是为什么很多65W方案宁愿把VOR降到80V左右，把余量让给尖峰。

第二步算匝比。匝比n=VOR/(Vout+Vf)，Vf取同步整流管导通压降约0.5V，所以n=100/20.5≈4.88，取整为5。此时实际VOR=5×20.5=102.5V。

第三步算占空比。最低输入电压90Vac对应直流母线约127V，D_max=VOR/(VOR+Vin_min)=102.5/(102.5+127)≈0.447。最高输入时D_min=102.5/(102.5+375)≈0.215。占空比在0.21到0.45之间摆动，这个范围对QR反激来说是健康的。

第四步算峰值电流和初级电感。设效率0.9，输入功率Pin=65/0.9≈72W。在最恶劣点（最低输入、满载）按临界模式估算：

Ipk = 2×Pin/(Vin_min×D_max) = 2×72/(127×0.447) ≈ 2.54A

取开关频率65kHz，Lp = Vin_min×D_max/(Ipk×f) = 127×0.447/(2.54×65000) ≈ 344µH，工程上取330µH。

第五步算匝数。选磁芯Ae=100mm²（如RM8或EFD30量级），最大磁密取0.3T：

Np = Lp×Ipk/(Bmax×Ae) = 330e-6×2.54/(0.3×100e-6) ≈ 27.9，取28匝

Ns = 28/5 ≈ 5.6，取6匝。此时实际匝比是28/6=4.67，VOR=4.67×20.5≈95.7V，回到第一步复核MOS应力，仍是可接受范围。辅助绕组按12–15V供电反推：Na = Ns×15/20.5 ≈ 4.4，取5匝，实际辅助电压约17V，整流后经稳压给控制电路，够用。

这套算法不复杂，但每一步都互相牵制，改动一个数字要往前回代验证。我见过不少新手直接把参考设计的匝数照抄，结果换了磁芯材质或者气隙，电感量对不上，满载直接饱和炸管。

2.3 漏感、钳位与吸收电路：调试中最花时间的部分

漏感是反激的固有缺陷，它不参与能量传递，却储存了能量，在MOS关断瞬间通过钳位电路释放。漏感的大小主要取决于绕组结构和层间耦合，初级绕组分成两段夹住次级（三明治绕法）可以把漏感压到初级电感的2%以内，而层层平铺的简单绕法很容易做到5%以上。

钳位方式上，RCD钳位是最常见的，成本低但损耗大，钳位电压设定得越低，MOS越安全但效率越差；TVS钳位把能量回馈得少但钳位更硬，适合追求高可靠性的场合。我一般先把RCD的电阻和电容按经验值起步（比如电容1–2.2nF、电阻100kΩ量级），实测钳位电压波形再调，目标是让钳位电压在满载最低输入时比VOR高出60–90V，不超过MOS耐压的85%。

这里有一个反直觉的点：一味加大钳位电容并不能降低尖峰，反而会让钳位电压"塌"得更慢，在一次侧电流较大的时候钳位管承受更长的导通时间。真正有效的是减小漏感本身，也就是优化绕法、增加挡墙宽度、必要时用铜箔做屏蔽层。我踩过的最典型的一次坑，是某版方案怎么调都压不住尖峰，最后发现是次级绕组出线位置离初级太远，改成三明治绕法后漏感从6%降到1.8%，钳位损耗直接少了1W多。

3. 协议识别与输出调压：充电器"变聪明"的那部分电路

3.1 从D+/D-电平到CC线上的编码，握手到底在谈什么

早期的充电协议非常简单，D+和D-短接，手机检测到这个特征就认为接的是专用充电器，可以拉大电流，这就是常说的DCP模式。后来各家为了做快充，开始在D+/D-上做电压文章：把D+拉到0.6V、D-保持0V表示某种请求，把两个引脚同时加到3.3V表示另一种请求，手机端用比较器判决，充电器端用电阻分压配合开关切换来应答。这类方案的本质是"用模拟电平传信"，实现简单，但组合有限、抗干扰差。

USB PD走的是完全不同的路子。它用Type-C的CC线做BMC编码通信，速率300kbps，双方通过数据包协商电压电流档位，还要交换供电能力、温度状态等信息。这套机制的好处是可扩展、可精细调节，PPS模式甚至支持20mV步进的电压调整和50mA步进的电流限制。代价是对硬件提出了新要求：CC线的上下拉电阻精度、通信时的电平判决门限、以及协议芯片与功率级之间的响应速度都得跟上。

实际做方案时，协议部分最容易出的问题不是"协议不识别"，而是"识别了但响应不过来"。手机请求从5V跳到9V，功率级如果只是简单地改反馈分压，输出电压上升时间可能几百毫秒，手机会判定超时并回退到5V。所以协议芯片发出的调压指令，必须有一路足够快的通路去改变反馈参考，通常做法是用协议芯片输出的PWM或DAC信号直接注入反馈节点，配合合适的环路补偿，把上升时间控制在几十毫秒量级。

3.2 反馈环路的两种做法：光耦方案与二次侧直控

传统反激用光耦加一次侧控制器构成反馈环，输出电压经分压后与基准比较，误差信号通过光耦的电流传递到一次侧，改变占空比。这个方案成熟、便宜、隔离天然，但有两个短板：光耦的电流传输比随温度和寿命衰减，长期使用后环路增益漂移；另外调压速度受光耦带宽限制，做PPS这种精细调节时响应偏慢。

二次侧直控的方案把控制器放到二次侧，直接采样输出电压，通过变压器或者隔离器件把驱动信号传回一次侧。这种架构下反馈环不再经过光耦，调压精度和速度都更好，缺点是隔离驱动增加成本，而且一旦隔离器件失效，故障模式比较难处理。

我在选型时的判断标准很朴素：如果产品只需要5V/9V/12V几个固定档位，光耦方案完全够用，成本也友好；如果要做PPS、要做多口功率动态分配、要做线损补偿，那基本必须上二次侧直控，否则环路响应跟不上协议要求。中间还有一个折中方案，就是光耦负责主环路、协议芯片通过注入电流做微调，这个做法在小功率PPS方案里用得不少，调试时要注意注入点的阻抗匹配，否则容易引起环路振荡。

3.3 输出调压的余量设计与线损补偿

输出电压并不是设定多少就到多少。线缆有电阻，3A电流过一条0.1Ω的线就掉0.3V，到了手机端可能已经低于欠压门限，充电电流就被限下来了。所以稍讲究一点的方案都会做线损补偿：根据输出电流的大小，把充电器输出端的电压抬高一点，让手机端正好拿到额定值。

补偿量的算法很直接：假设线缆加连接器的总电阻Rc，输出电流Io，需要补偿的电压就是Io×Rc。实际实现时不用精确知道Rc，而是按最差情况取一个固定斜率，比如每安培补偿100mV，再设一个上限（避免空载时电压被抬得太高）。这个上限很关键，我做第一版的时候就吃了亏：补偿斜率给得太大又没有限幅，轻载时输出电压被抬到标称值的108%，触发了过压保护，手机刚插上就断电。

还有一点是关于PPS的余量。PPS要求电压可以20mV步进，如果反馈分压网络的精度不够，或者PWM分辨率太低，实际输出会在目标值附近抖动。经验做法是把调压的最小步进做到目标值的1/4以下，也就是5mV量级，给环路留足调整空间；同时输出电容不能太小，否则负载跳变时电压跌落过大，手机端会主动降流。

4. 安全与合规：安规距离、EMI摸底和必测项

4.1 爬电距离与电气间隙的量化规则

这两项是硬件评审的硬门槛，也是最容易被"看起来差不多"糊弄过去的地方。电气间隙是空气中最短直线距离，主要防高压击穿；爬电距离是沿绝缘表面的最短路径，主要防表面污秽导致的漏电起痕。二者不能混为一谈，在开槽、加挡墙的时候要分别核算。

以常见的220V工作电压、污染等级2、材料组IIIa、加强绝缘为例，爬电距离要求大约6.4mm，电气间隙在海拔2000m条件下大约5.5mm。这个数字看起来不大，但落到PCB上非常占地方：变压器骨架的挡墙宽度、光耦下方的开槽、Y电容引脚之间的间距，全都要在这个预算里安排。

我总结出几个实操上的省空间技巧：一是把隔离槽开在爬电距离最紧张的位置，槽宽1mm就能等效增加约1mm的爬电距离；二是在变压器引脚根部套铁氟龙套管，把沿表面的路径拉长；三是光耦尽量选宽体封装，虽然贵一点，但省下的板面面积往往更值钱。至于电气间隙，千万别靠"打胶"来解决，胶体在高压下的绝缘性能并不稳定，评审时也不被认可。

需要强调的是，这里的数字是常见经验值，不同标准版本、不同工作电压、不同海拔条件下要求会变，正式设计必须以当前适用的标准条文和实测工作电压为准，不能照搬别人板子上的间距。

4.2 传导辐射超标的三种典型波形与定位方法

EMI调试大概是充电器项目里最耗心力的环节。传导测试通常覆盖150kHz到30MHz，常见的超标形态有三类，识别出形态基本就锁定了一半原因。

第一类是开关频率的低次谐波超标，波形上表现为一根根间隔等于开关频率的尖峰，低频段尤其明显。这类问题的根源通常在差模路径，也就是输入端的X电容和共模电感的漏感组成的滤波网络衰减不够。处理办法是加大X电容、调整共模电感的差模分量，或者优化输入走线缩短环路面积。我遇到过一次怎么加X电容都压不下去，最后发现是整流桥到输入电容的走线太长，形成了一个天线，把走线改短后低频段直接降了6dB。

第二类是中高频段的包络隆起，通常出现在几MHz到十几MHz，表现为一片连续的鼓包。这类多半是共模噪声，来源是变压器初次级之间的寄生电容和MOS漏极的dv/dt。处理手段是增加Y电容、在变压器初次级之间加屏蔽层并正确接地、给MOS加缓冲。屏蔽层的接地方式很关键，必须接到一次侧的地（也就是母线负端），接错了反而会恶化。

第三类是单根尖刺，频率位置固定，且往往和某个特定负载点相关。这类问题最难查，可能是某个器件的寄生振荡，也可能是PCB上某段走线构成了谐振。定位方法是逐个改变负载和工作点，看尖刺是否随频率移动；如果不动，就用近场探头逐段扫描，找到辐射最强的区域。我碰到过一次12MHz附近的固定尖刺，最后查到是同步整流管的体二极管在死区时间产生的高频振铃，通过调整死区时间和加RC吸收解决。

4.3 保护链的优先级：哪些必须先动作

保护功能不是越多越好，而是要有明确的优先级，否则多个保护同时触发时会出现"互锁"或者"反复重启"的怪现象。我的排序原则是：可能造成器件永久损坏的保护优先，其次是不可恢复的故障，最后才是可自恢复的异常。

按这个原则，一次侧过流保护（逐周期限流）必须最快，它在每个开关周期内生效，直接限制峰值电流；其次是输出短路保护，通过检测反馈电压异常或者辅助绕组电压跌落来判断；然后是输出过压保护，防止反馈环路开路导致输出失控；再往后是过温保护，这个响应可以慢一些，但要保证在器件结温达到极限前动作；最后才是输入欠压和过压保护。

这里有一个实际的经验：短路保护的动作时间要留够余量。输出电容在短路瞬间会通过同步整流管反向放电，电流可能达到几十安培，如果保护动作太快，反而会因为电流尖峰误触发；动作太慢又会烧管。我一般的做法是让短路保护在检测到异常后延迟几十微秒再动作，同时确保同步整流管本身有足够的浪涌电流能力。另外，短路保护恢复后不要立刻重试全功率，最好先软启动降压再逐步提升，否则反复短路会把变压器和整流管往死里整。

5. 热设计与结构：小体积高功率的真正瓶颈

5.1 一份65W方案的损耗分布估算

热设计的前提是知道自己要散多少热。还是拿65W、效率90%举例，总损耗约7.2W，这7.2W分布在哪些地方，决定了散热结构怎么设计。

一次侧MOS：满载最低输入时初级有效电流约1A，导通电阻取0.4Ω，导通损耗0.4W；开关损耗在QR模式下已经比较低，估算0.4W；驱动和输出电容损耗0.2W，合计约1W。

变压器：初级绕组直流电阻按0.15Ω算，铜损约0.15W；次级绕组电流大，铜损约0.5W；磁芯损耗按材质和频率估算0.4W，合计约1.05W。

同步整流管：输出电流3.25A，导通电阻20mΩ，占空比约0.78，导通损耗约3.25²×0.02×0.78≈0.16W，加上死区时间体二极管导通损耗和开关损耗，实际约0.4W。

钳位与吸收电路：这部分损耗容易被低估，实测经常在0.6–1W之间，取决于漏感大小和钳位电压设定。

输出滤波、采样网络、协议芯片、辅助供电：合计约0.5W。

把这些加起来大约3.5–4W，比理论总损耗7.2W还差一截，差的那部分主要来自整流桥（约0.8W）、输入滤波电感、PCB走线电阻、以及同步整流管的开关损耗估算偏低。这个差值本身就说明一件事：小功率电源的损耗是"分散"的，每一项都不大，加起来才要命，所以散热设计不能只盯着MOS和变压器，输入整流桥和PCB铜箔同样是热点。

5.2 灌封、导热垫与外壳材料的取舍

充电器的散热路径基本是：器件→导热介质→外壳→空气。密闭的小体积产品没有风，全靠外壳自然对流，所以外壳材料的导热系数直接决定温升。

常见的做法有三种。一是完全灌封，用导热灌封胶把整个PCBA包起来，好处是导热路径最短、防水防潮、还能抑制振动和啸叫；坏处是重量增加、返修困难、成本上升。二是局部点胶，只在高热器件（变压器、同步整流管、整流桥）上点导热胶贴合外壳，兼顾成本和效果。三是用导热垫片把发热器件压到外壳内壁，这种方式适合有金属外壳或者内部有屏蔽罩的方案。

我在做封闭式小体积方案时更倾向于局部点胶配合导热垫片，因为灌封虽然效果最好，但一旦调试阶段要改电路，整块板子就废了。等到设计定型再考虑全灌封，是更稳妥的节奏。另外，外壳材料选阻燃等级达标的PC或者PC/ABS合金，壁厚不要太薄，薄壁的横向导热能力差，容易形成局部热点。

还有一个经常被忽略的点：变压器的散热。它体积最大、损耗集中，但表面往往被绝缘胶带包住，热量散不出去。我通常会在变压器外侧加一层导热胶带或者让磁芯外露一部分贴到导热垫上，实测能降5–8度。

5.3 老化测试怎么做出有效结论

老化测试不是"通电烤几个小时看看坏不坏"，而要能回答三个问题：最热点在哪、温升余量有多少、长时间工作后参数漂不漂。

我的做法是在额定负载、最高环境温度（通常按40或45度）、最低输入电压的条件下连续跑两小时以上，用热电偶贴在一侧MOS、变压器磁芯、同步整流管、整流桥、输出电容这几个点上，每隔十分钟记录一次，直到温度稳定（连续三次读数变化小于1度）。同时用红外热像仪拍一张整板图，找找有没有热电偶没覆盖到的热点，比如PCB铜箔的某一段、或者协议芯片。

判据上不只看绝对温度，更要看余量。电解电容的寿命和温度强相关，经验法则是温度每升高10度寿命减半，所以电容位置的温度最好比额定值低15度以上。MOS的结温需要根据壳温和热阻反推，如果壳温已经接近100度，结温基本就没有余量了。另外，老化后要重新测一遍效率和待机功耗，如果效率掉了1个点以上，说明某个器件参数发生了漂移，得查清楚。

6. 调试实录：几个反直觉的现象与处置

6.1 空载打嗝、轻载啸叫与消隐时间的纠缠

空载时充电器进入打嗝模式是正常设计，但打嗝频率如果落在人耳可听范围内，变压器就会发出"哒哒"声。更麻烦的是轻载啸叫，通常在几十毫安到几百毫安负载区间出现，频率在2–8kHz。

这两个现象的根源都在控制器的轻载管理策略上。打嗝周期太长，输出电容电压波动大，辅助绕组供电跟着波动，控制电路反复复位；打嗝周期太短，频率进入音频段，就有声音。啸叫则往往和谷底检测的消隐时间有关：负载轻的时候，开关周期变长，谷底检测窗口如果没跟着调整，MOS可能在非谷底位置开通，产生不规则的电流波形，激励变压器机械振动。

处理思路是先把问题定位到具体机制。我的步骤是：用示波器同时抓驱动波形和输出纹波，看打嗝频率；如果打嗝频率在音频段，优先调整打嗝的阈值和周期；如果是啸叫，先确认谷底检测是否稳定，再考虑给变压器浸漆或者点胶抑制振动。很多时候两个问题会同时出现，改了一个另一个冒出来，这时候要有耐心，一次只改一个参数，记录波形。

需要提醒的是，变压器浸漆能压住声音，但解决不了根本问题。如果驱动波形本身不干净，浸漆只是把症状藏起来，长期可靠性仍然存疑。

6.2 插拔瞬间的电压过冲

手机插上的瞬间，输出从空载跳到满载，输出电压会先跌一下再恢复，这是正常的负载瞬态响应。但如果出现的是"过冲"，也就是电压先往上冲一下，那就是环路或者保护逻辑的问题。

常见原因有三个。一是线损补偿的响应太快，负载电流刚建立，补偿电压就叠加上去，而此时环路还没反应过来，两个作用叠加导致过冲。二是同步整流管的关断时序在突加负载时乱了，反向电流倒灌进输出电容。三是过压保护的门限设得太紧，正常瞬态就能触发。

我处理这类问题的顺序是：先抓插拔瞬间的Vout和Iout波形，看是过冲还是先跌后冲；如果是先跌后冲，多半是环路带宽不够，需要加相位裕度；如果直接冲，就查线损补偿的滤波时间常数，通常给补偿信号加一个几十毫秒的RC延迟就能压住。同步整流的时序问题则要靠调整死区时间和关断阈值，这部分必须结合具体控制器的手册来调，不能凭感觉改电阻。

6.3 换一根线就握手失败

这个问题在工厂测试阶段特别折磨人：同一批充电器，配A线全部正常，配B线有10%握手失败。查协议芯片没问题、查输出电压没问题，最后发现是CC线的阻抗和线缆的寄生电容导致BMC信号边沿变缓，判决门限被跨越的时间点偏移了。

BMC编码对边沿的要求其实不算苛刻，但如果线缆的寄生电容偏大，加上充电器端CC引脚的上下拉电阻精度不够（比如用了5%的电阻而不是1%），两者叠加就会让某些批次的手机识别不到。解决方法是把CC引脚的电阻换成1%精度、把CC走线尽量短且远离高频开关节点，必要时在CC上串一个小电阻做阻尼。

还有一类握手失败是"能识别但不升压"，这多半是协议芯片收到了请求但没有正确驱动调压电路。用逻辑分析仪抓一下CC线上的数据包，看请求的电压值和实际输出的电压值差多少，如果差得远，就是调压通路的问题；如果只差几十毫伏，那可能是反馈分压的精度不够，手机判定电压不在容差窗口内，主动退回5V。

7. 一份可以照着走的方案自检清单

7.1 原理图阶段必须闭环的十项确认

做到最后我发现，大多数批量问题都能在原理图阶段提前发现，只是当时没人认真看。我自己整理了一份十项确认，每版方案出图前逐条过一遍。

第一，隔离带是否只有变压器、Y电容、反馈器件三处跨越，其余走线是否全部绕开。第二，Y电容容值对应的漏电流是否在限值内，计算过程有没有留档。第三，一次侧MOS的电压应力在最恶劣工况下是否有20%以上余量。第四，同步整流管的耐压是否考虑了最高输入电压加反射电压再加尖峰。第五，辅助绕组供电在空载和满载两个极端下是否都在控制器工作范围内。第六，协议芯片的供电是否会在打嗝期间掉电。第七，所有保护的门限和延时是否有明确数值，而不是"大概"。第八，输出电容的纹波电流额定值是否大于实际纹波有效值。第九，线损补偿是否有上限钳位。第十，所有跨隔离带的元件引脚间距是否满足爬电距离要求。

这十条里，第五条和第六条最容易被漏掉，因为它们不影响通电点亮，只影响极端工况下的稳定性，而极端工况恰恰是客户最先投诉的地方。

7.2 打样回来先做什么，后做什么

板子回来之后的测试顺序，我的习惯是：先不接负载，用可调电源从低压开始慢慢升，观察空载功耗和辅助供电是否正常；正常后加小负载（比如0.5A）看输出电压精度和纹波；再逐步加到满载，同时监测一次侧电流波形和MOS温度；最后才做动态负载和协议测试。

这个顺序的道理是先排除"能不能活"，再验证"活得好不好"。我见过有人板子一回来直接接手机测试快充，结果变压器极性搞反，一上电就炸，连排查的机会都没有。所以第一次上电一定要用限流电源，把电流限制在预期值的1.5倍以内，就算有问题也只是保护动作，不会伤器件。

满载稳定之后再做的事包括：效率曲线扫描（从10%到100%负载，记录每个点的效率）、待机功耗测量、温升测试、EMI预扫、协议兼容性测试（至少覆盖三到五个不同品牌的手机和几根不同线缆）。这几项里，协议兼容性最花时间，也最容易被压缩，但它直接决定用户拿到手能不能用，不能省。

7.3 从样品到量产之间还差的那几步

样品能跑通和能量产之间，隔着元器件容差、工艺一致性和测试覆盖率三道坎。容差方面，反馈分压电阻、电流检测电阻、变压器电感量这三项的精度直接影响输出精度和保护点，量产前要把最坏组合算一遍，确认在最不利的容差叠加下仍然满足规格。

工艺一致性主要看变压器。同一批磁芯的Ae可能有±5%的差异，气隙研磨的精度决定了电感量的分散度，如果电感量分散超过±10%，峰值电流和保护点就会漂。我的做法是在变压器规格书里明确电感量的中心值和允许偏差，并要求供应商逐只测试，必要时在产线增加电感量抽检。

测试覆盖率则是把调试阶段发现的每一个问题都转化成一条产线测试项。比如协议握手，不能只测一个电压档，要把所有支持的档位都过一遍；比如保护功能，要人为触发一次确认动作正常；比如待机功耗，要作为全检项而不是抽检项。这几条看起来是产线的事，但方案设计阶段就要把测试点留出来，否则到了量产再想加测试，连测点都找不到。

我个人在实际操作中的体会是，充电器这个品类看起来成熟得不能再成熟，但真正决定一版方案能不能顺利落地的，往往不是拓扑选得多先进、器件用得多高端，而是那些最不起眼的细节：一个消隐时间、一段隔离带上的走线、一颗电阻的精度、一次钳位电压的复核。把这些小事一件件钉死，方案自然就稳了。