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1. 端侧 AI 到底在跑什么：从一次模型部署翻车说起

去年帮一个做智能门锁的团队看他们的端侧人脸识别方案，模型在 PC 上跑得好好的，量化成 INT8 塞进设备之后，识别率直接从 99.2% 掉到 87%，误识率飙升。他们第一反应是"量化精度损失"，折腾了两周换量化算法、调校准集，效果始终上不去。后来我让他们把中间每一层的张量 dump 出来对比，才发现问题根本不在量化——是 NPU 的算子支持列表里没有他们用的那个自定义激活函数，编译器悄悄把它 fallback 到 CPU 上执行，而 CPU 和 NPU 之间的数据搬运引入了额外的 layout 转换，把特征图的通道顺序搞乱了。

这个案例我后来在好几个团队都遇到过类似的版本。大家谈端侧 AI，张口就是"模型压缩""量化""剪枝"，但真正决定一个端侧方案能不能落地的，往往是更底层的东西：张量在内存里到底长什么样、NPU 怎么理解这些张量、编译器怎么把算子映射到硬件上。这三件事没搞明白，上层做再多优化都是隔靴搔痒。

这篇内容我想把"从张量到 NPU"这条链路完整拆一遍。核心关键词就四个：张量、NPU、端侧 AI、底层执行逻辑。我会讲清楚张量在端侧到底以什么形式存在、NPU 的硬件结构为什么决定了它能跑什么不能跑什么、编译器在中间做了哪些你可能不知道的"翻译"工作，以及在实际部署中怎么定位那些"模型没错但结果不对"的玄学问题。适合正在做端侧部署的工程师、准备选型 NPU 方案的架构师，以及想搞懂"为什么我的模型在 NPU 上跑不快"的开发者。不需要你有芯片背景，但最好跑过一次完整的端侧部署流程，这样看下面的内容会更有体感。

2. 张量不是数学概念，是内存里的一块布局

2.1 从数学张量到内存张量：中间隔着一个 layout

教科书里讲张量，说的是多维数组，是标量、向量、矩阵的推广。这个定义没错，但对端侧部署来说几乎没用。因为在硬件眼里，张量首先是一段连续或非连续的内存，其次才是一个多维数组。这两者的区别，就是"逻辑形状"和"物理布局"的区别。

举个具体的例子。一个形状为[1, 3, 224, 224]的输入张量，逻辑上是 NCHW 四维。但在内存里，它可能以 NCHW 排布，也可能以 NHWC 排布，甚至可能是分块（tiled）排布。同样是这 150528 个浮点数，排布方式不同，硬件读取的效率能差好几倍。

为什么会有这么多排布？因为不同硬件对内存访问的偏好不一样。CPU 上做卷积，NCHW 对 SIMD 向量化友好，因为通道维连续，可以一次加载多个通道做并行乘加。但很多 NPU 的卷积单元是按行扫描的，NHWC 让最后一个维度（通道）连续，反而更利于它做流水线。这就是为什么你在 PC 上训练用 NCHW，部署到某些 NPU 上编译器会强制转成 NHWC——不是它想折腾你，是硬件就这么设计的。

我见过太多人忽略这一点。他们在 PyTorch 里permute一下觉得无所谓，但在端侧，一次 layout 转换可能意味着一次完整的内存拷贝，在 224x224x3 的输入上就是 600KB 的搬运，如果这个转换发生在每一层之间，累积起来就是灾难。

2.2 端侧张量的三种真实形态

在实际的端侧执行链路里，张量会经历三种形态，理解这三态是理解整个执行逻辑的基础。

第一种是框架张量，比如 PyTorch 的torch.Tensor或 TensorFlow 的tf.Tensor。这是你在写模型时接触的形态，它带着完整的元信息：形状、数据类型、设备位置、是否需要梯度、以及一个指向底层存储的引用。这个形态的特点是"重"——元信息比数据本身还占地方，而且带着大量训练时才需要的字段。

第二种是中间表示张量，出现在模型转换阶段，比如 ONNX 的TensorProto、TFLite 的Tensor、或者各家 NPU 工具链自己的 IR。这个形态去掉了训练相关的字段，保留了形状、类型、量化参数（scale 和 zero_point），并且明确了 layout。它是"可序列化"的，能存成文件，也是编译器做图优化的操作对象。

第三种是运行时张量，也就是真正躺在 NPU 或 CPU 内存里的那块 buffer。这个形态最"裸"——它可能只有一个地址加一个大小，形状信息被编译器"编译进"了指令里，运行时根本不需要再查。量化后的张量在这里就是纯粹的 INT8 数组，scale 和 zero_point 被折叠进了算子实现。

提示：调试端侧问题时，一定要明确你现在看的是哪一态的张量。很多人拿框架张量的数值去对比运行时张量的数值，中间隔了 layout 转换和量化反量化，对不上是正常的，对上了才奇怪。

2.3 量化张量的内存账：为什么 INT8 不一定比 FP16 快

这里要破除一个常见误解：INT8 一定比 FP16 快。在端侧，这个结论经常不成立。

原因在于，量化张量虽然数据量小了一半，但它多出了两个东西：scale 和 zero_point。这两个参数在反量化时要做乘加，如果硬件没有专门的定点乘加单元，这个反量化开销可能吃掉数据量减半带来的收益。更麻烦的是，很多 NPU 的 INT8 卷积要求输入和权重都量化，而激活值的动态范围每一层都不一样，需要在线统计或者用校准集预先确定。如果校准做得不好，为了不溢出就得用更保守的 scale，等效精度反而下降。

我实测过一组数据，在某个主流 NPU 上跑 MobileNetV2，FP16 版本单帧 8.3ms，INT8 版本单帧 7.1ms，只快了 14%，远没有理论上的 2 倍。但功耗确实降了接近 40%，因为 INT8 的乘加单元面积小、漏电低。所以选 INT8 还是 FP16，要看你的瓶颈是延迟还是功耗。如果是电池供电的设备，INT8 的功耗优势值得那点精度损失；如果是插电的盒子，FP16 可能更省心。

3. NPU 的硬件脾气：它到底擅长什么、讨厌什么

3.1 从 MAC 阵列说起：NPU 的本质是空间换时间

要理解 NPU 为什么对某些算子快、对某些算子慢，得从它的核心结构说起。NPU 的计算核心通常是一个MAC 阵列（Multiply-Accumulate Array），比如 16x16 或者 32x32 个乘加单元排成矩阵。每个时钟周期，这个阵列能完成几百到几千次乘加运算。

这个结构和 CPU 有本质区别。CPU 是"时间换空间"——几个 ALU 轮流干活，靠高主频和指令流水线提升吞吐。NPU 是"空间换时间"——把大量计算单元铺开，靠并行度提升吞吐，主频反而不高（通常几百 MHz）。这就解释了为什么 NPU 跑卷积飞快，但跑控制流、分支判断就很拉胯：MAC 阵列是为规则的数据并行计算设计的，遇到 if-else 这种不规则逻辑，大量计算单元只能闲置。

所以当你看到一个算子在 NPU 上特别慢，第一反应应该是：这个算子能不能被表达成规则的矩阵运算。如果能，那可能是编译器没优化好；如果不能，那它本来就不该在 NPU 上跑。

3.2 算子支持列表：NPU 的"菜单"和"忌口"

每个 NPU 都有一份算子支持列表，这份列表决定了哪些算子能硬件加速，哪些要 fallback 到 CPU。这份列表通常不会完整公开，或者公开了也和实际编译器行为有出入，这是端侧部署最大的坑之一。

以卷积为例，NPU 通常支持标准卷积、深度可分离卷积、逐点卷积，但对空洞卷积（dilated convolution）、可变形卷积（deformable convolution）的支持就参差不齐。激活函数方面，ReLU、ReLU6、Sigmoid、Tanh 一般都有硬件实现，但 GELU、Swish、Mish 这些"新潮"激活函数，很多 NPU 就不支持，得拆成多个基础算子组合，或者直接 fallback。

我整理过一份常见算子在主流 NPU 上的支持情况，虽然具体型号有差异，但规律是通用的：

注意：算子支持列表一定要以你实际使用的工具链版本为准。同一个 NPU，去年不支持 GELU，今年可能就支持了；反过来，某些算子在新版本里因为性能问题被"降级"处理也是有的。别拿网上的旧资料当圣旨。

3.3 内存带宽：NPU 真正的瓶颈往往不在算力

很多人选 NPU 只看 TOPS（每秒万亿次运算），这是个巨大的误区。在端侧，内存带宽往往比算力更早成为瓶颈。

道理很简单：卷积层的计算强度（算术运算次数 / 内存访问字节数）是有限的。以 3x3 卷积为例，每个输出像素需要 9 次乘加，读取 9 个输入值和 9 个权重。如果输入是 FP16，那就是 18 字节的读取换 9 次乘加，计算强度只有 0.5 FLOP/Byte。而 NPU 的算力如果是 1 TOPS，内存带宽只有 10 GB/s，那理论峰值算力根本发挥不出来，实际性能被带宽卡死在 5 GOPS 左右。

这就是为什么很多 NPU 要配大容量的片上 SRAM 或者用权重压缩技术。片上 SRAM 的作用是把权重和中间激活值"关"在芯片里，避免反复访问外部 DRAM。权重压缩则是利用权重的稀疏性和低秩特性，减少搬运量。你在选型时，除了看 TOPS，一定要看片上内存大小和外部内存带宽这两个参数，它们对实际性能的影响经常比 TOPS 更大。

4. 编译器：把张量"翻译"成 NPU 指令的幕后黑手

4.1 图优化：编译器在你不知道的时候改了多少东西

模型转换工具链（比如各家 NPU 的编译器）在把模型编译成可执行文件时，会做大量的图优化。这些优化大部分是好事，但有些会改变数值行为，导致"模型没错但结果不对"。

常见的图优化包括：算子融合（把 Conv+BN+ReLU 合成一个算子）、常量折叠（把编译期能算出来的常量表达式提前算好）、死代码消除（删掉不影响输出的分支）、layout 转换消除（把连续的转置操作合并或抵消）。这些优化在数学上应该是等价的，但实现上可能有细微差异。

我遇到过一个典型案例：某模型里有一个Conv -> BatchNorm -> ReLU的结构，编译器把它们融合成了一个算子。融合本身没问题，但融合后的算子在做 BN 时，用的是编译期从权重里算出来的均值和方差，而不是运行时统计的。如果这个 BN 在训练时用的是移动平均，而移动平均和真实分布有偏差，融合后就会放大这个偏差。解决办法是在导出模型前把 BN 的统计量"固化"进卷积权重，也就是常说的 BN folding，让编译器的融合变成无损操作。

4.2 算子调度：为什么同样的模型在不同 NPU 上性能差 10 倍

算子调度是编译器最核心也最不透明的工作。它决定了每个算子在哪执行（NPU 还是 CPU）、以什么顺序执行、中间结果放哪里、什么时候做 layout 转换。同样的模型，调度策略不同，性能能差一个数量级。

调度要解决的核心矛盾是：NPU 算得快但内存小，CPU 算得慢但内存大。一个典型的策略是把连续的 NPU 算子尽量排在一起，减少 NPU 和 CPU 之间的数据往返；同时把中间激活值控制在片上内存能容纳的范围内，超出的部分"溢出"到外部内存。这个平衡点很难找，编译器通常用启发式算法，不一定最优。

作为开发者，你能做的是给编译器提供更多信息。比如在模型里显式标注哪些层可以量化、哪些层必须保持高精度、哪些张量的生命周期很短可以复用内存。这些信息通过工具链的配置文件或者模型里的 annotation 传递，能显著改善调度质量。我试过在一个检测模型上，仅仅通过标注"前 10 层保持 FP16、后面全 INT8"，就让整体延迟降了 22%，因为编译器不用再为前 10 层纠结量化策略了。

4.3 一个真实的编译日志解读

下面这段是我从某 NPU 工具链的编译日志里截取的（做了脱敏），它展示了编译器如何决定一个算子的命运：

[INFO] Op 'conv_12' (Conv2D): - Input layout: NHWC, dtype: int8 - Weight layout: HWIO, dtype: int8 - Candidate targets: NPU_CONV, CPU_CONV - NPU_CONV constraints check: * kernel size 3x3: PASS * stride 1x1: PASS * dilation 1x1: PASS * input channels 64 (multiple of 8): PASS * output channels 128 (multiple of 8): PASS - Selected target: NPU_CONV - Estimated cycles: 1240 [INFO] Op 'gelu_13' (GELU): - Candidate targets: NPU_ACT, CPU_ACT - NPU_ACT constraints check: * activation type 'gelu': FAIL (not in supported list) - Selected target: CPU_ACT - WARNING: layout conversion required (NHWC -> NCHW) - Estimated cycles: 8900 (including data transfer)

这段日志信息量很大。conv_12因为所有约束都满足，被调度到 NPU，估计 1240 个周期。gelu_13因为不在 NPU 激活函数支持列表里，被 fallback 到 CPU，而且因为 CPU 算子要求 NCHW 布局，还要做一次 layout 转换，估计 8900 个周期——比卷积本身还慢 7 倍。

看到这个日志，优化方向就很明确了：要么把 GELU 换成 NPU 支持的激活函数（比如 ReLU 或 Sigmoid 的近似），要么把 GELU 合并到前一个卷积里（如果编译器支持），要么接受这个开销但把它挪到不影响关键路径的位置。这就是读编译日志的价值——它把"玄学"变成了"可定位的问题"。

5. 实操：从零跑通一个端侧模型的完整链路

5.1 环境准备与工具链选型

假设我们要把一个图像分类模型部署到一块带 NPU 的开发板上。工具链的选择取决于你的 NPU 型号，但流程是通用的：训练框架导出 -> 中间格式转换 -> NPU 编译器编译 -> 板端推理。

中间格式我强烈建议用 ONNX，因为它的算子定义最规范，各家工具链对它的支持也最全。导出时注意几个参数：opset_version选工具链支持的版本（通常 11 到 13 比较稳），do_constant_folding设为 True 让 PyTorch 先做一轮常量折叠，input_names和output_names显式指定，避免工具链自动生成奇怪的名称。

import torch import torch.onnx model.eval() dummy_input = torch.randn(1, 3, 224, 224) torch.onnx.export( model, dummy_input, "model.onnx", opset_version=12, do_constant_folding=True, input_names=["input"], output_names=["output"], dynamic_axes=None # 端侧通常固定形状，不要开动态轴 )

导出后一定要用onnxruntime跑一遍，确认 ONNX 模型的输出和原模型一致。这一步能过滤掉大部分导出问题，别跳过。

5.2 量化校准：决定成败的一步

量化校准是端侧部署里最需要经验的一步。核心是选一个有代表性的校准集，让每一层的激活值范围统计得准确。校准集不用大，几百张图就够，但一定要覆盖你的实际使用场景。我见过用 ImageNet 校准集去校准一个工业质检模型的，结果因为工业图像的整体亮度分布和 ImageNet 差很远，量化后精度崩了。

校准算法上，KL 散度校准（也叫 entropy calibration）通常比 min-max 校准更稳，因为它会截断一些极端值，避免个别离群点把 scale 拉得过大。但 KL 校准对校准集的分布更敏感，如果校准集本身有偏，KL 反而更差。我的经验是：先用 KL 跑一遍，看每层的 scale 分布，如果某些层的 scale 明显异常（比如比相邻层大一个数量级），就检查那层的输入是不是有异常值，必要时手动 clamp。

# 以某工具链的量化 API 为例（伪代码，具体接口看文档） from npu_toolkit import Quantizer quantizer = Quantizer( model="model.onnx", calibration_dataset="calib_images/", calibration_method="kl_divergence", num_calibration_samples=500, per_channel=True # 权重按通道量化，精度更好 ) quantizer.run() quantizer.save("model_quantized.onnx")

提示：per_channel=True对卷积权重几乎总是更好的选择，因为不同输出通道的权重分布差异很大，按通道量化能显著降低精度损失。代价是 scale 的数量变多，但对现代 NPU 来说这点存储开销可以忽略。

5.3 编译与板端部署

把量化后的模型喂给 NPU 编译器，得到可执行文件。这一步的关键是读懂编译报告，特别是算子调度和内存占用部分。如果发现大量算子 fallback 到 CPU，或者内存占用超过片上 SRAM 导致频繁溢出，就要回头调整模型结构或量化策略。

板端部署时，注意输入数据的预处理要和训练时完全一致。我见过太多因为预处理不一致导致的精度问题：训练时用的是 BGR、归一化到 [0,1]、减均值除方差，部署时忘了减均值，或者用了 RGB，结果精度掉一大截。建议把预处理也做成一个可测试的模块，在 PC 上用同样的输入对比预处理后的张量，确保 bit-level 一致。

推理代码的核心就是喂数据、取结果：

import numpy as np from npu_runtime import Runtime rt = Runtime("model_compiled.npu") input_tensor = preprocess(image) # 确保和训练预处理一致 output = rt.infer(input_tensor) pred = np.argmax(output)

5.4 性能剖析：找到真正的瓶颈

部署跑通只是第一步，接下来要剖析性能。端侧的性能剖析比 PC 难，因为工具链通常不提供细粒度的 profiling。但有几个土办法很管用：

分段计时。把模型按层切成几段，分别测每段的耗时，找出最慢的段。如果某段特别慢，大概率是有算子 fallback 了。

对比 CPU-only 和 NPU 的耗时。如果 NPU 版本只比 CPU 快一点点，说明大部分算子在 CPU 上跑，NPU 没发挥作用。

看功耗曲线。NPU 满载时功耗会明显上升，如果功耗一直很低，说明 NPU 大部分时间在闲置。

我用这些土办法定位过一个"NPU 加速无效"的问题：分段计时发现前 5 层特别慢，查编译日志发现这 5 层因为输入是动态形状被 fallback 了。把输入固定成静态形状后，这 5 层回到 NPU，整体延迟从 45ms 降到 12ms。

6. 踩坑实录：那些文档里不会写的经验

6.1 常见问题速查表

6.2 三个我踩过的坑

第一个坑：以为量化是"无损"的。早期我总觉得量化只是精度换速度，损失可控。直到有一次做一个医疗影像的模型，量化后 AUC 从 0.96 掉到 0.89，怎么调校准集都上不去。后来发现是某一层的激活值分布是双峰的，KL 校准只保留了主峰，把次峰截断了，而次峰恰好对应病灶区域。解决办法是这层不量化，保持 FP16。结论：不是所有层都适合量化，关键层要保留高精度。

第二个坑：忽略了 NPU 的"冷启动"。有些 NPU 在第一次推理时要加载权重、初始化硬件，耗时可能是后续推理的几十倍。如果你的应用是间歇性推理（比如门锁一天开几十次），每次都是冷启动，那平均延迟会很难看。解决办法是保持 NPU 常驻，或者用低功耗模式维持权重在片上。

第三个坑：盲目追求最新工具链。新版本工具链通常支持更多算子、优化更好，但也可能引入新的 bug。我有一次升级工具链后，一个稳定运行了半年的模型突然精度下降，查了一周才发现是新版本的某个图优化把两个不该融合的算子融合了。结论：生产环境用的工具链版本要锁定，升级前必须做完整的回归测试。

6.3 一个反直觉的优化技巧

最后分享一个反直觉的技巧：有时候让模型"慢一点"反而整体更快。

具体来说，如果某个算子在 NPU 上跑很快，但它的输出要传给 CPU 上的下一个算子，中间要做 layout 转换和数据搬运，那这个"快"就被搬运开销抵消了。这时候如果把这个算子也放到 CPU 上，虽然单算子变慢了，但省掉了搬运，整体反而更快。

我实测过一个案例：一个模型里有 3 个连续的 NPU 算子，后面跟一个 CPU 算子。原本的调度是 3 个 NPU + 1 个 CPU，中间一次搬运。改成 4 个全 CPU 后，单算子耗时增加了 40%，但因为省掉了搬运和同步开销，端到端延迟降了 15%。这个技巧在算子边界处特别有用，值得在性能剖析时专门测一下。

端侧 AI 的底层执行逻辑，说到底就是张量在内存里的布局、NPU 的硬件约束、编译器的调度决策这三者的博弈。把这三者搞明白，那些"玄学"问题就都变成了可定位、可解决的工程问题。我在实际项目里的体会是，与其花时间调量化算法，不如先花半天把编译日志读透——后者带来的收益往往更大。