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1. 为什么是图腾柱：从Boost PFC拓扑演化谈起

做PFC的工程师应该都有类似的感受：传统的Boost PFC方案，效率做到某个点之后就很难再往上了。桥式整流后的二极管压降、Boost二极管的反向恢复、以及MOSFET的开关损耗，这几座大山压在那里，无论怎么调驱动电阻、换超结管子，天花板始终看得见摸得着。

我最早接触图腾柱PFC其实有点被动。当时手头一个3kW通信电源项目，客户给的效率目标在满载时要求做到97%以上，传统Boost方案哪怕用了SiC二极管，最好成绩也才磨到95.5%左右，离目标差着一大截。也就是从那时起，我开始系统性地看图腾柱PFC这条路。

图腾柱PFC的核心逻辑其实一句话就能讲清楚：把原来Boost拓扑里那个桥式整流器给干掉，让电流路径上的功率器件总数降到最低。传统Boost PFC在任何一个半周期内，电流至少要穿过两个二极管（桥式整流器的一个臂加Boost二极管上的续流路径），每个二极管导通压降按0.8V到1.2V去算，满载几十安培电流，光这一块的损耗就有几十瓦。而图腾柱拓扑在电流路径上只剩一个高频开关管和一个工频开关管，而且工频臂用的是同步整流方式，等效于一个超低导通电阻的MOSFET导通压降。

图腾柱的工作模态可以拆成两个完全不同角色的开关组。高频臂Q1和Q2在两个半工频周期内分别承担高频PWM开关动作，它们负责把输入电压变换成给定的母线电压；工频臂Q3和Q4则承担整流功能，但这里不是二极管，而是MOSFET以同步方式进行工频换向——正半周期Q4导通，负半周期Q3导通。关键在于这种工频换向动作极慢（50/60Hz），开关损耗几乎为零，唯一需要在意的是工频开关管的导通损耗，用Rds(on)极低的高压MOSFET就能解决。

图腾柱拓扑在原理图上看着简单，真正做到产品化却拖了很多年，核心原因在于：传统的硅基MOSFET做图腾柱时，体二极管的反向恢复问题会让你吃大亏。高频臂的MOSFET在CCM工作模式下，每个开关周期都要经历一次反向恢复过程，硅基MOSFET的体二极管反向恢复电荷Qrr大得惊人，不仅增加了损耗，还会在桥臂上引入严重的dv/dt冲击。这也是为什么图腾柱PFC在过去几十年里始终停留在论文阶段，直到GaN器件的商业化才真正把这颗雷拆掉。GaN HEMT本身是横向器件结构，没有体二极管，或者说它的“类体二极管”机制是二维电子气导电通道，本质上不存在少子存储问题，反向恢复电荷基本可以忽略。这也是我把这篇白皮书的第一个设计原则定为“GaN先决”的原因——图腾柱PFC在今天的工程语境下，几乎就是为GaN量身定做的拓扑。

提示：如果你手里只有普通硅基MOSFET，还是慎重考虑图腾柱路线。2kW以上的CCM图腾柱用硅器件做，反向恢复损耗能消耗掉你对这个拓扑的所有好感。

2. 数字控制器的边界与主电路参数的定义

2.1 控制目标设定：效率、功率因数与谐波

任何设计白皮书的第一件事，不是选器件也不是画原理图，而是把设计边界定义清楚。这里我拿一个2.5kW打样项目作为贯穿全文的案例，设计指标如下：输入电压范围90V到264V交流，输出直流母线电压385V，额定功率2.5kW，满载效率目标97%（230V输入条件下），功率因数目标在50%负载以上达到0.99，THD小于5%。

数字控制在这个项目里要管的事很明确：检测输入电压相位和电流波形、计算PWM占空比、处理工频换向逻辑、执行电压环路和电流环路的闭环控制。相比模拟方案的比较器加运算放大器组合，数字控制的最大优势不是响应速度——模拟PWM比较器的环路带宽通常能做到更高——而是算法的可调性和对异常工况的快速响应能力。比如CRM/CCM混合工作模式、输入电压前馈补偿、开关周期的逐周期限流、以及死区时间的在线修正，这些功能在模拟方案里需要堆大量硬件，在数字方案里就是几行代码的事。

2.2 主电路关键参数计算

升压电感的取值是整个主电路设计的第一个关键决策点。电感量的大小直接决定了电流纹波水平，进而影响磁芯损耗和GaN开关管的电流应力。这里采用最常规的设计方法：以最低输入电压、满载工况下的电流纹波系数为约束条件。

输入侧额定参数：最低输入电压有效值90V交流，对应峰值约127V；最大输入电流有效值约27.8A（2.5kW/90V），峰值电流39.3A。若目标电流纹波系数取20%，则电感峰值电流约为47.1A（39.3A加上4.9A纹波幅值），那么电感量L可由以下公式确定：

• L ≈ (Vin_min_peak × D) / (fsw × ΔI)

其中Vin_min_peak约为127V，D为最低输入峰值电压处的占空比约0.66（输出385V，输入127V），开关频率取100kHz，ΔI取4.9A，计算得到L ≈ 171μH，取整为180μH。这个电感量对应的峰值电流能力要到50A以上，为了避免磁芯饱和，我选用两个铁硅铝磁环并联，采用交错绕线方式。这里有个细节值得注意：铁硅铝磁环的直流偏置特性会让电感量随电流增加而下降，所以标称电感量应按30%到40%的降额来设计，实际我最终选的是标称220μH的磁环，在50A偏置下实测仍有约180μH。

母线电容的取值则要根据保持时间和输出电压纹波两个约束来定。典型通信电源要求的保持时间是满载条件下断电后母线电压从385V跌到300V的时间不小于16ms，按能量法计算：

• Cbulk ≥ (2 × P × t_stay) / (Vstart² - Vmin²)

代入P=2500W，t_stay=0.016s，Vstart=385V，Vmin=300V，可得Cbulk ≥ 2 × 2500 × 0.016 / (385² - 300²)，即约1280μF。考虑到电解电容的容差和老化（约损耗20%），实际取1500μF，用两颗750μF/450V的电解电容并联。

数字控制器的选型门槛其实不高，只要满足以下几点就能用：ADC采样带宽和分辨率能覆盖电流信号的最小变化步长（12位及以上）、PWM模块支持互补输出且带硬件死区插入、PWM分辨率至少能到180ps（100kHz开关频率下有13位有效占空比分辨率）、以及足够快的控制周期中断执行时间。DSP还是MCU其实没有绝对答案，关键是PWM外设能力和ADC触发同步机制是否健全。我建议优先关注带硬件过采样和比较器中断的型号——有一个逐周期比较器可以直接切断PWM输出，对GaN这种“炸起来反应时间只有几十纳秒”的器件来说，比固件里的软件保护可靠得多。

3. 浮驱、死区与采样：图腾柱最容易被细节打败的地方

3.1 高边驱动方案：自举电荷泵的工程边界

图腾柱PFC的拓扑结构决定了高频臂和工频臂中每个开关管都处在不同的参考电位上。低边驱动问题不大，关键是高边管（负半周期时的Q2）和最顶上那个工频臂管（Q3）的栅极驱动，必须有悬浮电源支撑。最常用的方案是自举电荷泵电路——用一个二极管和电容的组合，把低边管导通期间产生的电压“举”到高边地之上。

自举电容的容量计算是一个经常被忽略的点。以高频臂为例，栅极驱动电流峰值可能到4A，每个开关周期需要的栅极电荷Qg（以某款650V GaN为例约6nC），自举电容的电压跌落δV不能超过0.4V，那么：

• Cbs ≥ 10 × (Qg + Qleak) / δV

其中10倍是工程惯例的安全系数，用于覆盖高压侧泄漏电流和驱动芯片OG输出级静态电流的消耗，代入数值以后Cbs取47nF到100nF之间比较合适。实际我一般直接用100nF的X7R陶瓷电容并联一个10nF的高频去耦电容，既保证电荷储量又保证高频路径阻抗低。还有一个关键点：自举二极管的耐压必须按母线电压峰值加余量选，至少600V级别。

这里要特别提醒：图腾柱PFC的自举电容充电窗口和Buck电路不一样，不是每个开关周期都有机会充电。工频臂的那个高边管在正半周期内一直处于导通状态，没有低边管的开关节奏可以给它刷新自举，所以如果是用自举方案驱动它，必须考虑长时间导通后自举电容电量衰减的问题。工程上的解决办法有几种：一是用隔离电源单独给工频臂高边驱动供电，二是用电荷泵式的高压驱动芯片，三是让工频臂在过零附近周期性地“开一下低边管”来刷新自举。如果控制策略做了CRM/CCM混合模式，第三种方案实现起来要小心，否则会在工频过零区域引入电流死区，直接影响THD表现。

3.2 死区时间：GaN开关管的“生死时速”

GaN器件死区时间的设置，是我在整个项目中花时间最多的地方。图腾柱PFC的高频臂在任何时刻都处于互补开关状态——Q1关断后必须等一小段时间再开通Q2，这个时间就是死区。死区太短的风险是桥臂直通，对于GaN而言后果就是失效，轻则驱动芯片炸裂，重则GaN管本体和主控板一起报废。死区太长的问题则是效率劣化，因为在死区期间电感电流只能通过GaN的类二极管反向导通，这个反向导通压降高达1.5V到3V，比硅MOSFET的体二极管压降还高，万一死区又被设得长，损耗积少成多，直接影响满载效率数据。

死区设置的逻辑起点是看GaN管的开关时间参数。以某款650V/25A的GaN HEMT为例，典型开通时间tr约12ns，关断时间tf约18ns，考虑到温度变化和器件离散性，工程上会再乘2倍的设计余量，我初期设置的死区是60ns，然后通过效率曲线扫描找出最优区间。实测下来，在40ns到80ns之间效率曲线相对平缓，而设置到100ns以上后满载效率会掉0.3个百分点。

调试死区过程的实操方法：先在低压小功率状态下（比如用调压器把输入电压降到50V交流），用示波器测量高边管Vds波形和栅极波形，确认无直通风险，再逐步加大功率并观察效率变化趋势。同时关注一个暗坑：母线电压爬升过程中的高dv/dt会通过GaN管的米勒电容耦合到驱动回路，如果不做负压关断，可能在关断瞬间引发误导通。我最初一版驱动电路没有加负压，结果在90V低输入满载时出现了不明原因的噪声，后来给GaN管的关断电平加了-3.5V偏置，问题立刻消失。这算是一条比较典型的图腾柱实战经验：GaN的栅极电压允许范围极其狭窄（典型-10V到+6V），正压裕量很小，负压关断基本是必须项。

3.3 电流采样：双向检测是硬要求

电感电流的采样精度决定了电流环路的控制质量，而图腾柱PFC的一个固有特征是电感电流在正负半周内双向流动——正半周期电流从输入流经电感、GaN管和工频臂流向输出，负半周期方向相反。这就意味着电流传感器件必须支持双向检测，最常用的是霍尔型电流传感器或者差分采样电流检测电阻。

我最终选了200Ω采样电阻做跨阻式差分采样，放大电路采用双极性供电的运算放大器，输出信号用ADC采样。还有一个实现细节和大家分享：因为控制DSP的ADC输入范围通常为0V到3.3V，双向信号需要给运放输出叠加一个1.65V的直流偏置，把零电流点映射到ADC量程中点。这个偏置电压的准确性和温漂直接决定了电流检测的零点漂移，而零点漂移又会引发过零检测误差，最终导致输入电流的过零畸变。实践下来的做法是用DSP内部的DAC输出偏置电压，配合软件校准，比硬件电阻分压的稳定性高一个数量级。

电流采样位置的选取方面，我通常在电感旁边串一个低阻值采样电阻，而不是放在母线输出端，因为后者测到的是经过母线电容平滑后的输出电流，相位滞后明显，无法用于电流内环控制。

工频零点的处理上，还要注意采样窗口与PWM开关事件的时序配合。图腾柱PFC的电流波形在每个开关周期的开通和关断瞬间都有明显跳变，ADC采样必须避开这些噪声窗口，硬件设计上要用PWM边沿产生ADC触发信号，让转换时刻精确落在开关周期内电流最平稳的时间点。我一般设置为PWM计数器的周期中点触发，这个时刻对应电感电流的平均值附近，控制误差最小。

4. CCM控制策略与环路参数整定

4.1 双环控制架构：电压外环加电流内环

图腾柱PFC在额定负载附近采用CCM模式运行，控制架构是典型的双环结构。电流内环负责让电感电流在每个开关周期内跟踪输入电压波形的形状，实现功率因数校正；电压外环负责稳定输出母线电压，同时抑制输入功率二阶纹波对输出电压的影响。

电流内环可以选峰值电流模式或平均电流模式。峰值电流模式在Boost拓扑中有固有的占空比大于50%时的次谐波振荡问题，需要叠加斜坡补偿，而且峰值电流和平均电流的差异会引入THD失真。所以我在项目里选了平均电流模式——用电流放大器的比例谐振或比例积分环节来跟踪工频正弦参考电流。平均电流模式的缺点是环路带宽受限于电流纹波频率，动态响应不如峰值电流模式快，但在PFC应用里这个短板并不致命，因为电流参考本身是工频正弦，不需要极高的带宽。

电流环PI参数的确定步骤：首先在simulink里搭一个平均模型，电感电流对占空比的小信号传递函数在100kHz开关节点的交越频率设为开关频率的十分之一到六分之一（10kHz到16kHz）。相位裕量我习惯调到50度到60度之间，再配合输入电压前馈——把输入电压RMS值引入前馈路径，把电流环的输入阻抗影响解耦掉，这样在输入电压从90V跳到264V时，电流环依然能稳定工作而无需重新整定参数。

4.2 电压环带宽：被母线电容按住的选择

电压外环的本质矛盾是：母线电容在经过整流后会产生2倍工频的纹波电压（100Hz或120Hz），如果电压环带宽太宽，这个纹波会穿透到电流参考上去，导致输入电流谐波增大；如果带宽太窄，那么在负载突变时母线电压会有较大的过冲和跌落。

工程设计的原则是把电压环交越频率压在2倍工频纹波的十分之一以下——典型值是10Hz到20Hz。我最终取的是15Hz，相位裕量约70度，满载到空载突切时母线电压过冲控制在35V以内，恢复时间约120ms，这个响应速度对大多数PFC应用场景足够了。

电压环的PI参数可以从输出阻抗模型来推导。母线电容1500μF在15Hz交越频率下的等效阻抗约7Ω，负载2500W在385V母线上的等效阻抗约59Ω，这些数值决定了一个可靠的控制补偿器增益起点。这里有一个实际的调试经验：写代码时把PI参数的增益余量先按理论值的0.5倍加载，然后通过阶跃负载实验逐步增大增益直到输出电压出现过冲，再回调到过冲开始之前的90%位置作为最终设定值。用这样的工程搜索法，比在仿真里算得更贴合电路板上的真实情况，特别是母线电容的ESR那样难以建模的寄生参数也能一并纳入考虑。

4.3 工频换向逻辑：过零处理的艺术

图腾柱PFC的控制代码里，最容易被写砸的不是电流PI环，而是工频换向逻辑。正半周期时Q4导通、Q2作为高频同步续流管；负半周期时Q3导通、Q1作为高频同步续流管。这两个工频臂开关的动作时机需要在输入电压过零前后完成，而处理不得当的话，过零区域会产生一段时间的电流断续或换向死区，直接给输入电流注入尖刺谐波。

我遇到的典型问题出现在感性输入阻抗和容性输入滤波器共同作用下，输入电压的过零时刻和电流过零时刻存在一个相位偏移。如果固件只依据电压过零来做换向，那么在电流尚未过零的时刻做换向，相当于在电感两端瞬间施加了一个反向电压，电流会发生剧烈变化，产生又尖又宽的毛刺。

我最终的换向策略是“电压过零粗略同步，电流过零精确修正”：用电压检测比较器产生工频过零中断，进入一个等待窗口，在这个窗口内通过ADC逐周期检测电感电流的过零方向，当检测到电流方向翻转后再执行工频臂的MOSFET切换。这样换向的时序误差被限制在几个开关周期以内，实测THD从单纯的电压过零方案的6.8%降到了4.2%，效果明显。需要说明的是这是项目中在电流检测精度能够支持的情况下采用的方案，如果电流信号噪声过大或者ADC速率不够，硬件上就应增加相位补偿网络来优化波形。

5. 开案前必须验证的硬件细节与PCB layout闭环

5.1 驱动回路的环路面积是效率之外的隐形杀手

很多工程师第一次画图腾柱PCB，会习惯性地按照传统Boost的布局思路走——功率回路和驱动回路分开布局，想着只要地线干净就行。但在GaN器件的开关速度下，这个思路不够了。GaN管的开关翻转时间可以做到15ns以内，对应的dv/dt超过50V/ns，在这种斜率下，任何一段长长的驱动走线都是天线，任何驱动回路的大环路面积都是噪声注入点。

高边GaN的驱动回路（驱动芯片输出级到GaN栅极、再到GaN源极、最后回到驱动芯片地）必须被限制在最小的物理面积内。具体做法是：驱动芯片尽量靠近GaN管放置，距离不超过5mm；栅极电阻和栅极下拉电阻紧贴GaN管的栅极引脚；驱动信号走线的返回路径（源极回流线）紧贴着驱动信号线并行走，形成紧耦合回路。实测中同样的驱动电路，布局从宽松改为紧凑后，高边误导通的发生频率从几次每开机降到了零。

还有一个容易被忽略的细节：GaN管的驱动电压窗口比硅MOSFET窄得多，栅极正向电压上限通常是6V到7V，而驱动芯片的输出电压往往默认12V。如果直接用常规驱动芯片的12V输出驱动GaN，第一件事就是炸栅极。所以驱动电路必须用专门的稳压环节把驱动电压限制到5V到6V之间，同时关断电平给到-3V到-4V。市面上有些专为GaN优化的驱动芯片内置了这些电压调节功能，但如果你在做一个大功率的方案，驱动芯片的输出能力和散热也得纳入选型考虑。

5.2 功率环路的寄生电感控制

功率环路，即母线电容、GaN管、升压电感和工频MOSFET组成的换流回路，它的寄生电感同样至关重要。图腾柱PFC功率回路的特点是高di/dt作用在高达385V的母线电压上，任何50nH的寄生电感都会在开关瞬间产生至少十几伏的电压过冲，叠加在GaN管的Vds上之后，很可能突破650V的耐压上限。

控制功率环路寄生电感的方法只有一条：让换流回路面积尽可能小。这意味着母线电容要尽可能靠近GaN管的桥臂，工频MOSFET和GaN管之间要做成一条直线排列，用一个连续的低电感平面做交互连接，功率回路中避免出现尖端铜皮和长条窄走线。同时母线电容两端要并联一组C0G材质的高频吸收电容（比如100nF到220nF），它们负责处理开关频率级别的电流脉动，电解电容的体积太大、等效串联电感太高，根本来不及响应开关频率的电流需求。

我在3kW样机上做了一个对比实验：功率回路面积优化前后，GaN管Vds尖峰从545V降到了492V（母线385V对应- 132V余量扩大到- 158V），满载效率从96.2%升到了96.8%。这其中的差距完全来自寄生电感导致的开关损耗差异。如果一个样机在满载时开关管发热异常，先不要急着怀疑器件型号或者散热设计，用示波器量一下开通瞬间的Vds波形，如果存在30V以上的振铃或尖峰，第一优先是改布局。

5.3 采样回路的抗干扰设计

控制核心与功率电路之间的模拟信号传输是整块板上抗干扰设计的最薄弱环节。电流采样信号只有几百毫伏级别，而功率回路上同时存在50V/ns的电压跳变和几十安培的电流跳变，电场和磁场耦合都会在这个信号上叠加噪声。

我的推荐布局是：采样电阻放在电感回流路径的低边位置，采样信号用一对紧耦合的差分走线从采样电阻引出，走线宽度6mil到8mil，间距4mil，尽量从功率器件之间穿过但不要平行于功率走线超过5mm。如果不可避免要与功率走线交叉，走线层面改用直角或45度角变化来减少耦合长度。差分走线两侧用保护地包裹，但注意保护地两端不要形成闭环感应环路，否则磁场耦合反而更严重。采样放大器放在控制芯片附近，信号沿线串联一个RC低通滤波器（截止频率约5MHz），用于滤除高频开关噪声，注意这个RC的引入会在电流信号上增加一个固定延时，需要在环路响应中留出裕量，不可在调试中反复改动数值，否则不同批次样机的电流相位会出现差异，进而影响THD的一致性。

6. 样机实测与白皮书（上）阶段的预期数据表现

6.1 全电压域效率分布

整个主电路参数和驱动方案确定之后，进行一轮全工况测试是必须的。这个项目的测试条件：输入电压分别按115V/60Hz和230V/50Hz两个典型工况，负载从10%到100%满载逐步扫描，功率分析仪采用精度0.1%级的宽带功率计，直接测量输入功率、输出功率、PF值和THD。

230V输入下，满载2.5kW的效率我实测做到了97.5%。这个数字拆开来看：GaN管开关损耗约25W，工频MOSFET导通损耗约18W，电感损耗约30W，控制与驱动辅助损耗约5W，其余电容和线路损耗约10W。效率最高的点出现在60%负载附近，约98.1%，这符合PFC变换器的典型损耗分布特征——开关损耗占比在轻载和满载之间此消彼长。

115V输入下效率会低不少，满载实测约96.8%。原因很明显，低输入电压工况下输入电流几乎高了一倍，导通损耗按电流平方增加，同时低压大电流下电感磁芯损耗也变得剧烈。这里也引出一个设计取舍：如果目标应用经常工作在低输入电压环境，那么升压电感就需要重新按更低压的大电流条件来选型，磁芯的直流偏置特性要更注意——同样的电感量在115V下的峰值电流比230V高一倍，磁芯更容易饱和，这也是我前面提到选磁环时留大量余量的原因。

6.2 PF与THD的表现

功率因数在全负载范围内实现了50%负载以上PF≥0.99的目标，满载时PF值实测0.997。THD在满载230V条件下实测3.8%，其中三次谐波分量最大约3.2%，五次谐波约1.5%，其余高次谐波都在0.5%以下。这个水平已经优于大多数电源设计标准对PFC的谐波要求。

THD的残余成分主要来自两个方面。一是电流过零点的换向毛刺，虽然用了“电压过零同步加电流过零修正”的换向策略，但在极低电流下ADC的量化误差还是会留下微小畸变；二是CCM模式下电流纹波本身会有一个很小的开关频率成分，它会通过采样回路的残余耦合进入控制环路，形成固定频率的杂散谐波。对这两个残余分量，我尝试过在固件里用前馈补偿表逐点修正，但收益有限且调试成本高，最终选择接受它们的存在，只要最终指标满足设计要求即可。

6.3 热测试与临界点评估

满载热测试在40℃环境舱内进行，稳态后GaN管的壳温约88℃，磁芯最高温度约105℃，母线电解电容表面温度约75℃。这个温度分布下，GaN管的结温约105℃（热阻0.8℃/W），离150℃的额定上限还有余量；但磁芯105℃已经接近铁硅铝磁环的居里温度附近的设计警戒线了，如果环境温度再往上跑，这里很容易成为整机寿命的短板。所以在样机完成后，我着手把电感绕组的散热回路加厚，并考虑换成损耗更低的铁镍钼磁环，预计可以把磁芯温升再压低20℃左右。

这些测试数据足够证明整个方案的设计闭环是通畅的：拓扑选型、器件选型、参数计算、控制策略、驱动保护、布局走线，每个环节的决策都对最终的效率数字有直接贡献。图腾柱PFC的好处在于它的效率收益是明显且可量化的，同时它几乎所有关键问题都集中在“高频开关节点”这一个局部区域，只要把这个点处理干净——驱动、死区、采样、layout——其他部分就能平顺地工作起来，这也是我坚持把它做成一个完整设计文档的原因。

到了这个阶段，白皮书（上）覆盖的内容算是暂时告一段落：从拓扑选择到主电路参数，从驱动方案到控制环路，再到样机的实测数据。数字控制图腾柱PFC还有很多可以继续深入的部分，比如CRM轻载模式的具体实现、GaN管的短路保护策略协调、以及更细致的热设计优化，这些留给白皮书（下）展开。项目还在推进中，后续我也会持续更新实测中出现的新问题和对应的处理方式——毕竟这类拓扑在实际产品化的路上，细节问题永远比理论模型多得多。