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1. 项目概述与核心思路

1.1 一个电源设计问题，往往在画第一根线之前就已经注定了

做PCB电源设计这行久了，你会发现一个规律：很多板子出问题，不是死在原理图上，而是死在电源树没想清楚就开始布局布线。电源树这个词听起来玄乎，其实它就是一张“谁给谁供电、供多少、怎么供”的关系图。你把这张图画明白了，后面DCDC和LDO的选型、PCB布局、甚至EMC整改都会顺很多；反之，电源树稀里糊涂，画到一半发现电流不够、电压拓扑绕了远路，再回来改板子，那成本就不是几张样板的事了。

我见过不少工程师，一上来就急着在AD或Allegro里放器件，觉得电源设计嘛，不就是“输入接DCDC，输出接LDO，滤波电容一摆，完事”。但真到了调试阶段，纹波超标、发热严重、DCDC啸叫、RE辐射过不了，问题一个接一个。这篇文章我想从自己实际做过的项目出发，把PCB电源设计从电源树构建到DCDC-LDO实战布局的完整链路捋一遍，重点讲清楚每一步背后的“为什么”，以及我在实操中踩过的坑和总结出来的细节。内容适合正在做硬件设计、PCB layout，或者刚接触电源设计的工程师参考，尤其是那些“原理图能画、布局总翻车”的朋友。

1.2 这套设计思路适用哪些场景

这套方法并不局限于某一种特定产品。我最早是在消费电子主控板上把它跑通的，那块板子上有5V适配器输入、3.8V锂电池、多路DCDC降压、还有给模拟前端供电的低噪声LDO，电源轨加起来有七八路。后来做工业控制板，24V输入、反激出多路隔离电源、再通过DCDC和LDO逐级降压，思路也完全通用。甚至你在做电机驱动板、传感器采集板、通信模组底板时，核心逻辑都一样：先算账，再选型，最后才是画板。

这篇文章不会拘泥于某一个EDA工具的操作细节——AD和Allegro的快捷键那类内容网上很多，我只在必要的地方点一下。我更想讲清楚的是那些“工具告诉不了你”的东西：环路面积为什么重要、电感下面为什么不能乱铺铜、反馈采样线为什么必须远离开关节点、DCDC的分地为什么经常是伪命题。这些东西想明白了，换哪个工具都能画好板。

2. 电源树的构建：从需求到拓扑的关键一跳

2.1 电源树到底在画什么

电源树表面上是一张从输入源到各个负载的供电路径图，但它真正表达的是两件事：能量怎么分配，噪声怎么隔离。很多工程师只盯着第一件事，把各路电压算清楚就完事，第二件事往往要到EMC测试才想起来，那就被动了。

以我之前做过的一个便携设备为例。系统输入有两种：USB 5V适配器和单节锂电池，锂电池电压范围是3.0V到4.2V。板子上有MCU（3.3V）、DDR（1.8V）、模拟采集电路（3.3V AVDD）、传感器接口（5V或3.3V可选）、以及射频前端（需要低纹波的3.3V或2.8V）。如果只是简单地把电池电压直接分成两路LDO，一路给数字3.3V，一路给模拟3.3V，你会发现在电池电压掉到3.3V以下时，LDO根本没法工作了。所以在画电源树之前，必须先明确输入电压的波动范围，再决定哪些轨用DCDC升压或降压，哪些轨用LDO直接落。

正确做法是先画一张表：每一路负载的电压、最大电流、纹波要求、上电时序要求、是否需要隔离。有了这张表，电源树就自动浮现出来了。电池电压3.0到4.2V，MCU需要稳定的3.3V，那就得做一个升降压DCDC或者先用升压到5V再降压；如果系统能接受在低电压时MCU跑在稍低频率，也可以直接用一颗低压差LDO，但要确认电池在截止电压下LDO的压差是否满足。这种“先列需求、再定架构”的顺序，能帮你避免很多选型阶段的返工。

2.2 从负载倒推电流：怎么才算“算明白账”

电源设计里有一个极其常见的错误：把芯片数据手册上写的最大电流当成常态电流来设计。比如某颗MCU手册写最大工作电流120mA，但实际正常运行时平均才30mA，峰值偶尔到80mA。如果你按120mA去选DCDC，也不是不行，但效率、体积、成本都会有冗余；如果反过来，只按平均电流选型，峰值一到就触发过流保护，板子就莫名其妙复位。

我的做法是，对每路负载区分三种电流：平均电流、峰值电流、瞬态电流。平均电流决定电源的稳态散热和电池续航估算；峰值电流决定DCDC/LDO的选型上限和电感饱和电流；瞬态电流决定输出电容的容量和反馈环路的响应速度。举个例子，一颗4G模组的峰值电流可以到2A，但平均只有0.3A，如果你用一颗最大输出1A的小DCDC去带它，平时看着没问题，一注册网络就掉电压。反过来，按2A稳态去选，板子又大又贵。正确的做法是选一颗最大输出2.5A左右的DCDC，但把电感饱和电流选到3A以上，同时输出电容用两颗22uF陶瓷电容并联，保证瞬态响应。

在实际算电流的时候，我会再额外留20%到30%的裕量，这既是给未来功能升级留空间，也是给DCDC在高温降额下的性能衰减留余地。很多电源芯片的数据手册里都有“电流降额曲线”，温度一高，最大输出电流是要打折的。不留裕量的设计，在常温测试时都正常，一到高温老化就现原形。

2.3 电源轨的上电时序：被很多人忽视的“隐形需求”

电源树构建时，还有一个容易被忽略的维度：上电时序。多路电源轨的板子上，时序错了轻则功能异常，重则烧毁器件。最经典的场景是MCU的IO口在核心电压没起来时就已被外设灌入高电平，导致IO口闩锁或芯片损坏。另外，DDR、FPGA这类器件对时序要求格外严格，核电压、IO电压、辅助电压之间往往有明确的先后的关系。

我在项目中通常用两种方式解决时序问题：一是选带使能脚的DCDC和LDO，通过RC延时或电源监控芯片控制EN脚的开启顺序；二是利用DCDC的软启动时间差异，让后级电源轨自然晚于前级开启。前者更可靠，后者省成本但只适用于时序要求不严格的场景。如果板子上有CPLD或逻辑门，也可以用来做简单的时序逻辑，但注意别把过于复杂的功能交给纯硬件逻辑，调试起来会非常痛苦。

电源树画完，时序关系标清楚，这还只是开始。接下来就要面对一个经典选择题：这一路的电源到底用DCDC还是LDO？这个选择做错了，后面布局布线再漂亮也白搭。

3. DCDC与LDO的核心对比与选型方法

3.1 原理级对比：效率、纹波与响应速度

DCDC和LDO虽然在电路形式上都有输入、输出、地，但工作原理完全不同。LDO本质上是一个可调电阻，通过调整调整管的导通程度来维持输出电压稳定，输入输出压差越大，调整管上的损耗就越大，效率越低。它的优势是纹波极低、噪声小、响应快、外围元件极少，通常只需要输入输出电容就能稳定工作。

DCDC（以BUCK为例）则是通过开关管的高速通断配合电感和电容进行能量转换，输入输出压差大时效率依然能保持很高，但开关动作带来了开关纹波和EMI问题。它的外围元件多，布局要求高，反馈环路设计也要考虑稳定性。所以我在选型时有一条不成文的规则：压差大、电流大的场合优先考虑DCDC；压差小、电流小且对噪声敏感的模拟供电，优先考虑LDO；同一路电源如果既要求效率又要求低噪声，那就采用DCDC+LDO级联的结构。

有一款经典的组合方式我经常用：5V输入，先用一颗同步BUCK DCDC把电压降到3.6V或3.3V，再通过一颗低噪声LDO降到3.0V给模拟电路供电。DCDC负责把大部分压差扛掉，LDO负责把纹波和噪声压到微伏级。这个方案的效率远高于直接用LDO从5V降到3.0V，噪声又远低于DCDC直接输出。代价是多占一点面积、多花一点成本，但在精密采集电路里非常值得。

3.2 DCDC拓扑选型：不只BUCK，还有反激、COT架构和ACDC

DCDC这个词其实是一个大家族，包含BUCK（降压）、BOOST（升压）、BUCK-BOOST（升降压）、反激、正激等多种拓扑。做PCB电源设计时，不能一听到DCDC就默认是同步降压芯片，拓扑选错了，整个电源方案都得推翻重来。

以我常用的几种场景为例：输入电压高于输出电压且压差大，用同步BUCK，效率高、外围简单；输入电压可能高于也可能低于输出电压，例如锂电池供电要稳定输出3.3V，就得用BUCK-BOOST或升降压芯片；需要做多路隔离输出，或者输入是高压市电，那就用反激拓扑加变压器，这也是很多ACDC电源模块内部的核心架构。

在参数选型阶段，我会特别关注DCDC的架构类型。传统的电流模式PWM架构对环路补偿要求较高，而COT架构（恒定导通时间）不需要复杂的环路补偿，瞬态响应快，适合高降压比场景。COT架构DCDC在中高端电源芯片里越来越常见，原因是它内部结构简单，外围设计容易，且负载瞬态响应表现好。但COT架构对输出电容的ESR有要求，有时需要选特定规格的电容才能维持稳定，这一点在选择芯片时就要在数据手册里确认清楚。

从工具和方案角度看，现在很多电源芯片厂商会提供完整的参考设计，包括原理图、PCB layout建议、BOM和寄存器配置列表。比如我之前调试过一个基于SW6206的电源方案，厂商提供的资料就很全，原理图、PCB、寄存器配置都有。拿到这类原厂方案时，我的建议是“先照抄，再优化”：第一版严格按照参考设计画，先让板子跑起来；然后再根据自己产品的结构限制和散热需求做局部调整。千万不要一开始就魔改参考设计，那样出了问题你根本不知道该查哪里。

3.3 关键参数的工程估算：电感、电容、BOOT电阻

DCDC外围参数的选择，是很多入门工程师最头疼的部分。虽然芯片数据手册里一般都有参考值，但搞清楚这些值怎么来的，才能在布局遇到空间限制时灵活调整。我以一颗常见的同步BUCK为例，说几个关键参数的估算思路。

电感值的选择影响纹波电流的大小。常用公式是L = (Vin - Vout) × Vout / (Vin × ΔIL × fsw)。其中ΔIL一般取输出电流的20%到40%。如果电感选得太大，纹波电流小，但瞬态响应变慢，电感体积也大；选得太小，纹波电流大，输出纹波和电感损耗都会上升。我通常先按30%的纹波系数算出初始值，再根据实际测试微调。

输出电容主要看输出纹波和瞬态响应的要求。陶瓷电容ESR很小，对纹波抑制效果好，但容值在直流偏压下会衰减，所以选型时要注意耐压留够余量，并且多用几颗并联降低ESL。在DCDC输出端，我一般会放一颗4.7uF到22uF的陶瓷电容加一颗100uF到470uF的电解电容组合，兼顾高频纹波和低频瞬态。

BOOT引脚的电容和电阻也是常见的设计盲区。BOOT电容负责给高边驱动电路供电，容值太小，高边MOS导通不足；容值太大，充放电时间变长，影响占空比。如果数据手册允许在BOOT引脚串联一个小电阻，这个电阻可以调节开关管的导通速度，对改善EMI有一定作用。实测中，串一个2.2Ω到10Ω的电阻能减缓开关沿的陡峭程度，RE测试时辐射噪声会有几dB的改善。但电阻也不能太大，否则高边管驱动不够，效率下降甚至发热严重。

3.4 DCDC与LDO的选型决策表和反例分析

为了让大家选型时少走弯路，我把常用的决策逻辑整理成一张表。但这张表不是万能的，实际项目里还要根据价格、供货、封装、温度范围等因素综合判断。

反例也不少。我之前见过一个工程师把5V转3.3V的LDO直接换成DCDC，因为“效率更高”，但他没注意到那颗DCDC的开关频率正好落在后级ADC采样频段附近，导致ADC的采样结果出现明显噪声。后来加了LC滤波才勉强压下去，但板子面积和成本都比原来的LDO方案更高。如果负载电流不大，LDO本可以零噪声解决，强行上DCDC就是在给自己制造麻烦。电源选型不是越高级越好，而是越合适越好。

4. DCDC-LDO实战布局：从PCB设计到布线细节

4.1 布局前的准备：层叠、线宽、过孔载流能力

PCB布局的第一步不是放器件，而是确认板子的层叠结构和关键载流参数。很多layout工程师习惯直接按照原理图网表摆放器件，放到一半才发现电流路径绕了远路，回头调整非常浪费时间。

层叠方面，4层板常见的叠层方案是“信号-地-电源-信号”，6层板则可以是“信号-地-信号-电源-地-信号”。对于DCDC电源设计，我强烈建议在DCDC所在层相邻铺一个完整的地平面，因为开关电流的回流路径需要低阻抗的地平面作参考。如果DCDC下面没有完整地平面，回流面积会变大，EMI辐射和地弹噪声都会加剧。如果是双层板，也要尽量在DCDC区域铺大块地铜，并用多个过孔连接到底层地。

线宽和过孔载流能力是一个经常被人忽略的基础问题。铜箔的载流能力和温升、线宽、铜厚直接相关。一个快速估算的方法是：1oz铜厚、1mm线宽，在温升不超过10°C的情况下，大约能过1A电流。这只是一个粗略值，精确值还要查IPC-2221标准里的曲线。DCDC输入输出主回路走线，我一般按这个经验值再放宽30%以上，并且尽量采用铺铜方式而非普通走线。过孔的载流能力取决于孔径和孔壁铜厚，一个0.3mm孔径的过孔大约能承受0.5A到1A电流。如果电流超过2A，建议多个过孔并联，或者采用更大孔径的过孔。

4.2 DCDC布局的第一原则：主回路面积最小化

DCDC的布局好坏，直接影响它的EMI、效率和稳定性。在所有布局原则里，我认为最重要的只有一条：让高频开关电流回路包围的面积尽可能小。

什么是DCDC的主回路？以BUCK为例，高边MOS导通时，电流从输入电容流过电感再到输出电容，这时输入电容、高边MOS、低边MOS、电感、输出电容之间形成了一个多条电流路径组合。低边MOS导通时，电感电流通过低边MOS续流，形成另一个环路。这两个环路是高频开关电流流动的关键路径，它们的面积越大，辐射噪声越大，同时走线上的寄生电感也会引发电压尖峰。

因此布局时要把输入电容尽量靠近芯片的VIN和GND引脚，并且让输入电容-高边MOS-低边MOS-输入电容形成的最小环路面积达到最小值。一个常用的验证方法是看DCDC芯片数据手册里的“典型布局”推荐图，很多大厂的原理图库里都有一张参考布局图，照着它摆，一般不会出大问题。我自己的习惯是：先把输入输出电容放在距离芯片引脚最近的位置，再放电感，再放其他外围电阻电容。主回路的地，也尽量用独立的铜皮连接，然后通过过孔接到整板地平面，而不是到处迂回。

4.3 LDO布局与散热：别把热焊盘当摆设

LDO的布局相对简单，但也有两个关键点：输入输出电容尽量靠近引脚，以及散热设计。LDO的热量来源是压差乘以电流，因此在设计LDO布局时，要保证芯片的散热路径通畅。很多LDO芯片底部有大面积散热焊盘（Exposed Pad），这个焊盘必须通过多个过孔连接到PCB另一层或内部的地平面，否则热阻会急剧增大，芯片温度会显著上升。

我在画LDO散热过孔时，一般用0.3mm孔径、1mm间距的过孔阵列，放在散热焊盘范围内，过孔扇出的位置尽量别打断地平面的完整性。焊接时，这些过孔如果直接开窗，焊锡会被毛细作用吸走，导致虚焊。所以量产设计中我倾向于在过孔上做“盘中孔+树脂塞孔”处理，或者把过孔开窗设计成“半塞”形式，方便手工焊接和小批量生产。

还有一点容易被忽视：LDO输出端的电容选择。虽然LDO通常不像DCDC那样对ESR有那么严格的要求，但有些LDO对输出电容的容值和ESR还是有范围的，特别是那些内部补偿型LDO。选得太小可能引起振荡，选得太大也可能导致相位裕度下降。稳妥的办法是参考数据手册推荐的电容范围和ESR范围，不要凭感觉选。

4.4 采样线、反馈线和地平面的分割问题

DCDC布局中，反馈采样线和地平面的处理是决定电源输出准确性的关键细节。反馈走线连接的是输出电压采样点和芯片的FB引脚，这条线必须远离电感和开关节点，否则开关噪声耦合进FB，输出电压就会不稳定，甚至出现异常振荡。

实践中，我通常把FB采样线从输出电容的末端引出，走线尽量短、尽量直，并且在采样点附近放置一个小的RC滤波网络（如果手册允许），滤掉高频噪声。反馈电阻的分压点也要靠近FB引脚放置，而不是放在远端。如果反馈走线较长，可以在走线两侧加地保护铜，但要注意地保护铜不能破坏芯片下方的地平面结构。

地平面的分割是一个颇具争议的话题。我个人的观点是：DCDC的功率地（PGND）和信号地（AGND）是否需要分割，要看具体芯片设计和参考设计，不要一刀切。很多同步降压芯片会在芯片内部把功率地和信号地分开引出引脚，PCB上通常建议在芯片下方把PGND和AGND单点连接，再通过过孔汇入整板地平面。这样可以让开关大电流不流经敏感的模拟地走线，又不至于因为地平面被完全割裂而产生严重的回流问题。实际上我见过很多板子，地平面被粗暴地割成两块，结果就是参考地不完整，模数转换器性能反而下降。如果芯片参考设计里有分地要求，按参考设计来；如果没有，就保持完整地平面，让大电流回路通过过孔紧密耦合。

5. 高频干扰、涡流损耗与EMI问题排查

5.1 DCDC电源的RE问题：源头与路径

DCDC的辐射发射（RE）问题，在EMC测试中是一个非常常见的整改点。尤其是那些开关频率在几百kHz到几MHz的BUCK电路，开关节点上的电压跳变（dv/dt）和电流跳变（di/dt）都是宽频噪声源。噪声主要通过两条途径传播：一是辐射，开关环路像一个小天线向外辐射电磁波；二是传导，噪声通过输入输出线缆传到外部。

在画板阶段，能做的抑制手段主要有三个：减小开关环路面积、控制开关节点铜皮面积、增加适当的缓冲电路。减小环路面积前面已经说了，这里不再重复。控制开关节点铜皮面积的意思是，开关节点（SW节点）的铜皮要足够宽以承载电流，但面积又不能过大，否则它就像一个大天线，对外辐射显著增强。这是一个需要权衡的地方：铜皮太窄，寄生电感大，电压尖峰高；铜皮太宽，辐射面积大。我通常把SW节点的铜皮控制在比芯片封装略大一点点的水平，铺铜时不要故意扩展成一大片。

RC吸收电路（Snubber）也是常见的抑制手段。在SW节点对地并联一个串联的电阻电容，可以吸收开关振铃的尖峰电压，同时对辐射和传导噪声都有一定抑制作用。RC值的选取通常需要通过实验确定，初始值可以参考数据手册建议，再根据实际波形微调。电阻功率要留足余量，因为吸收电路上消耗的是真实功率。

5.2 涡流损耗：高频电流在铜箔里的“隐藏损耗”

涡流损耗是高频电流在导体中产生的趋肤效应和邻近效应导致的损耗，很多人会忽略它在PCB电源设计中的影响。开关频率越高，电流越趋向于集中在导体表面，电流流过的有效截面积变小，等效电阻增大，发热也增大。DCDC的开关电流，尤其是电感电流的高频纹波成分，会在地平面和铜箔中诱发出涡流，造成额外的温升。

降低涡流损耗的办法有几个：一是让主电流路径尽量短而粗，减少寄生电阻；二是避免在DCDC正下方大范围铺铜形成不必要的涡流路径；三是在高频变压器和反激电源设计时特别注意铜箔的方向和布局。对于反激电源的PCB，变压器周围的铜箔经常会出现局部过热现象，这往往就是涡流损耗导致的。在布局时，我会尽量避免在变压器下方或紧邻区域形成大面积闭合铜环，并且把变压器周围的接地过孔适当错开，不要形成单一方向的“铜栅栏”。

5.3 从实测波形反推布局问题

布局是否合理，其实不用等到EMC测试，在实验室用示波器就能初步判断。测量DCDC的SW节点电压波形，如果发现开关沿非常陡峭或者振铃电压很高，说明回路寄生电感偏大，需要检查输入电容是否足够靠近芯片、回路面积是否过大。测量输出纹波时，示波器探头要使用短的接地弹簧而不是长地线夹，否则测量到的纹波中会混入大量环境噪声，无法反映真实情况。

有一次，我调试一块板子时，输出纹波在高频段出现了一个几十MHz的尖峰，怎么换电容都压不下去。后来把热风枪拆下DCDC模块重新布局，才发现输入电容经过了一段窄走线连接到芯片VIN引脚，这段走线的寄生电感与输入电容产生了谐振，导致高频噪声放大。把那颗输入电容挪到距离VIN引脚0.5mm以内的位置后，尖峰就消失了。这个案例说明，布局的微小差异，往往会在高频段被放大到非常明显的程度。

5.4 布局布线后的检查清单

画完板子，发送制造之前，我会再快速过一遍检查清单。这些检查项可以帮你提前暴露大量问题，省去改板子来回的周期。

• 输入输出电容是否紧靠芯片引脚，主回路面积是否最优？
• 反馈采样点是否从输出电容末端引出？反馈走线是否远离SW节点和电感？
• BOOT电容是否靠近芯片BOOT引脚？
• 散热焊盘的过孔阵列是否足够？是否可能引起焊接虚焊问题？
• 高电流路径的线宽和过孔数量是否满足载流需求？
• DCDC下方的地平面是否完整？是否需要分割或单点连接？
• 电感下方的铜箔是否造成了不必要的涡流路径或耦合？
• 输入和输出端的储能电容耐压和容值是否满足直流偏压条件？
• 如果板子上同时有DCDC和敏感模拟电路，间隔和屏蔽措施是否合理？

6. 实操经验与常见问题排查实录

6.1 Allegro、AD等工具在电源板设计中的几个关键操作

不同工程师习惯不同，有人用Allegro，有人用AD，也有人用嘉立创EDA。工具是次要的，但有几个操作对电源板设计特别重要，值得单独提一下。

在Allegro里画PCB，快捷键的设置对提升效率非常关键。比如“移动”命令常用“M”+“空格”组合，走线用“add connect”，固定器件用“fix”命令，这些键位每个人都可以自定义，但核心原则是：高频操作要尽量安排在主键盘区域，减少鼠标在菜单间来回跳跃。在设置里把“drag”模式改成“move”模式，也能减少调整器件时的误操作。对于电源板来说，还有一个实用操作是快速测量走线的宽度和长度，Allegro自带“show measure”功能（快捷键通常绑定在“I”或自定义键位），能够快速核对关键走线的长度匹配情况，对电源地和高速信号都有帮助。

在AD（Altium Designer）里，一个常见需求是在PCB上显示元器件型号和名称。默认状态下封装丝印可能只显示位号，不利于人工核对，可以在PCB面板里通过“View Configuration”打开丝印层的“Component Type”选项，让位号和型号同时显示出来。另外，制作螺丝孔或定位孔时，很多新手容易在“Keep-Out Layer”画一个圆圈就完事，实际上应该用“Multi-Layer”或“Mechanical Layer”放置过孔焊盘，并设置合适的孔径和外径，否则制造时可能无法识别。AD导出PCB文件给板厂时，记得用“File → Fabrication Outputs → Gerber Files”生成完整的Gerber，同时勾选钻孔文件，别只发一个PCB源文件。

在嘉立创EDA里画PCB，现在流行用AI自动布局的功能，但我的建议是：AI布局可以用作快速摆出一个初始方案，电源部分还是要手工微调。因为电源布局的“最小环路面积”原则很难被通用算法自动优化。

6.2 大电源模块的拆卸与返修：热风枪确实不管用

做电源板调试，经常要把焊上去的电源模块拆下来，尤其是那些底部有散热焊盘的大功率DCDC模块。很多人第一反应是用热风枪吹，但实测效果往往不好，因为大模块吸取热量快，风枪加热一边另一边还是凉的，硬撬还容易把焊盘和走线扯坏。

我自己的经验是：先在模块四周和底部过孔处堆上足量的低温焊锡，让热量通过焊锡更均匀地传导，然后再用热风枪对着底部散热焊盘的位置吹，温度设置在350°C左右，风速不要太高，等焊锡完全熔化后再用镊子轻轻挑起模块。如果模块底下有散热过孔但没做树脂塞孔，焊锡会被不断吸入过孔，这个时候就要多补焊锡，确保过孔内有充足的焊料导热。或者采用拆焊台配合加热板，从PCB背面整体加热，效果更好，但设备门槛高一些。

拆下来之后，焊盘上残留的焊锡要用编织带清理干净，同时检查有没有被拉起的焊盘或断裂的过孔。返修后的模块重新焊接时，底部散热焊盘要均匀涂上锡膏，不要过量，否则模块会垫高，四周引脚无法贴合焊盘。

6.3 那些“按文档画了还是出问题”的常见原因

有时候，工程师严格照着芯片数据手册的参考设计画板，还是会出现问题。根据我的经验，原因往往集中在几个地方。

第一个是数据手册里的参考电路图没有显示PCB布局的细节，比如反馈走线的位置、输入电容的实际物理位置。手册里示意图只是逻辑连接，不等于物理布局建议。第二个是物料替代问题，因为交期或价格，实际贴片的电容电感品牌、系列和手册推荐的不一致，特别是陶瓷电容的直流偏压特性差异很大，用不同系列容值在额定电压下可能衰减到标称值的一半。第三个是地平面的处理，虽然电路原理一致，但PCB层叠不同，回流路径就完全不同，双层板和四层板即使原理图一样，布局也要重新优化。

遇到这种“按文档画了还出问题”的情况，我一般会从三个方向排查：先看开关节点的波形正不正常，再测输出电压的纹波和瞬态响应，最后检查输入输出电流路径上有没有不合理的窄走线和过孔。这三个方向排查完，大部分问题都能定位到具体的布局缺陷。

6.4 常见问题快查表

7. 工具链与参考资源的使用建议

7.1 原厂方案资料怎么“榨干”它的价值

现在很多电源芯片厂家会提供完整的“demo board”资料包，包括原理图、PCB源文件、BOM、寄存器配置列表等。比如SW6206这类电源方案，网上流传的原厂资料包就非常完整。我的建议是，拿到资料后不要急着照抄，先做三件事：第一，把原理图的每个模块都看明白，特别是反馈环路、使能电路、保护电路，看懂了再画自己的版本；第二，把PCB源文件的布局尺寸、覆铜边界、过孔阵列扒出来，逐项对比自己的结构限制和安装需求；第三，BOM里的每一个电容、电感都要查一下型号和厂商，特别是电感的工作电流、饱和电流、DCR参数，这些往往是性能差异的关键。

但也要注意，原厂方案通常是在标准四层板、标准铜厚、标准散热条件下调出来的，你的实际产品如果层叠不同、结构紧凑、工作环境温度更高，就必须做适当的调整。完全照搬原厂方案在一些定制场景下反而会出问题。

7.2 关于PCB线宽、层叠与电流估算的几个实用参考

对于入门工程师，我建议把“线宽电流对照表”打印出来贴在工位上，虽然它是一个快速估算工具，不比热仿真精确，但能快速排除明显不合理的走线设计。1oz铜厚、1mm线宽过1A电流只是一个经验值，走线长了还要考虑压降和温升，所以更好的做法是：关键大电流路径用铺铜，并且用多个过孔连接各层。在某些高功率场景，还会在PCB上焊接铜条或采用厚铜板，但成本更高，不是所有产品都能接受。

层叠方面，如果板子对EMI要求高，我优先选四层板且保证DCDC下面有完整地平面。如果在双层板上做DCDC，除了尽量缩短主回路，还可以考虑在电感下方、开关节点附近的地铜上开一个小窗口，减少寄生耦合，但注意不要破坏电流回路的连续性。电源和地平面的间距也会影响电源完整性，对于多层板，电源平面和地平面尽量紧耦合，间距越小，平面谐振频率越高，越不容易在低频段出现噪声问题。

7.3 从原理图到PCB布局的“翻译”方法

原理图上器件的摆放顺序，其实就是电源信号流的顺序。在画PCB时，很多人习惯按照原理图的视觉顺序来摆放PCB器件，但PCB布局的物理顺序应该按照“电流走向”来安排，而不是原理图的图纸顺序。举个例子，原理图里，输入接口可能画在最左边，DCDC在中间，LDO在右边，模拟电路在右下角。PCB布局时就应该从输入接口开始，沿电流路径依次放置输入滤波、DCDC、输出滤波、LDO、模拟负载，形成一个清晰的物理流水线。

在摆放时，还可以利用“飞线密度”来辅助判断。EDA工具里的飞线显示了网络连接的拓扑，飞线密集的区域说明连接关系复杂，器件之间应该尽量靠近。电源流向的主干网络（大电流网络）的飞线会很粗，在工具里可以单独高亮这些网络，让布局时视觉焦点始终放在主回路上。这个方法对复杂板子特别有用，能让布局阶段就避免大量绕线。

8. 总结与个人经验

8.1 我在实际项目中沉淀下来的几条核心心得

做PCB电源设计这些年，我最大的体会是：电源设计是一个“纸上谈兵半步，实际调试一步”的领域。图纸上看似完美的方案，一到实板测试，各种寄生参数就会给你上眼药。所以我越来越倾向于“保守设计”：能靠近就靠近，能多过孔就多过孔，能留裕量就留裕量。那些看起来“刚刚好”的设计，往往在量产阶段会因为物料批次差异、温度漂移、焊接工艺波动而暴露问题。

另一个心得是，DCDC布局中“主回路面积最小化”这个原则，应该刻在每个硬件工程师的骨子里。不管是哪家芯片、哪种拓扑，这个原则都适用。当你在EMC实验室里焦头烂额时，回头检查一下开关回路的物理面积，往往能找到问题的根源。很多RE问题在layout阶段避免，比事后加屏蔽、加磁珠要省钱省力得多。

关于LDO和DCDC的选择，我也有一个更细致的判断标准：不只是看压差和电流，还要看负载对电源噪声的敏感度。数字电路用DCDC，模拟前端用LDO，在DSP、ADC、传感器混合的板子上几乎是铁律。如果一个板子上同时有射频电路，那射频电源的去耦和隔离甚至要比计算效率更重要。

8.2 最后分享一个检查技巧：把电源树“画”到PCB上

在布局布线基本完成之后，我习惯做一件事：把自己的电源树图打印出来，然后拿着实物PCB，用不同颜色的笔把各个电源轨的电流路径描一遍。描到DCDC主回路时，看看实际走线形成的环路面积是不是最小；描到LDO时，看看散热路径是不是通畅；描到反馈线时，看看它是否贴着噪声源走了很远。这个过程非常有效，能让你在发出Gerber之前发现不少“逻辑上没问题但物理上不合理”的地方。

这个习惯帮我避免过很多次改板。有一次描线时发现一路3.3V电源轨的反馈采样线从整个板子绕了一大圈才到FB引脚，中途还穿过了电机驱动区域，虽然原理图完全正确，但实际板子上这路电源的噪声一定会很大。后来调整了反馈电阻的位置，把采样线缩短到原来的三分之一，实板测试纹波果然降了一半。

电源设计这条路，踩坑是常态，但每踩一个坑，把原理和布局对应起来，能力就会有实实在在的成长。希望这篇文章里的经验能帮你在设计阶段就避开一些我当年反复折腾过的问题。