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并联谐振这个题目，很多教材和视频都喜欢直接扔公式、画曲线，然后告诉你“谐振时阻抗最大、电流最小”。公式背下来不难，但十个人里有八个会在实际项目中栽跟头——不是因为公式错，而是因为根本不知道自己算的是哪一个“R”，更没搞清楚并联谐振和串联谐振那套“相反结论”背后的物理原因。这篇文章我换个讲法，先把现象和直觉讲透，再给推导和计算案例，最后聊几个我在实际电路调试中踩过的坑。目标就一个：看完之后你能真正自己算一个并联谐振回路，而不是只会背结论。

1. 认识并联谐振：先搞清楚它到底在“谐振”什么

1.1 电路结构和一句话定义

并联谐振电路的结构很简单：一个电感L和一个电容C并联，通常还会在两端并上一个电阻R（这个电阻有时候是刻意加上去控制带宽的，有时候是电感损耗的等效结果，后面我会专门讲它的身份问题）。电路就三个元件，但表现出的行为比串联谐振丰富得多。

一句话定义是：在某个特定频率下，电感支路的电流和电容支路的电流大小相等、相位相反，二者在回路内部互相抵消，对外只呈现纯电阻特性，且阻抗达到最大值。这个特定频率就叫谐振频率。

注意关键词：电流在回路内部互相抵消。这正是“并联谐振”和“串联谐振”本质不同的地方。串联谐振时，电感和电容的电压互相抵消，对外呈现最小阻抗；并联谐振时，是电感和电容的电流互相抵消，对外呈现最大阻抗。一个是电压抵消，一个是电流抵消，结论自然相反。

1.2 和串联谐振的对比：结论为什么是“相反”的

我做了一张对比表，这是几乎所有初学者都需要的“定心丸”，因为两套结论太容易记混了：

记这套结论有个小技巧：串联谐振往回“缩”，并联谐振往外“顶”。串联电路在谐振频率上呈现出低阻抗的“通路”，电流畅通无阻；并联电路在谐振频率上呈现出高阻抗的“断路”，电流进不来。放到信号系统里看，串联谐振回路适合做选频通道，并联谐振回路适合做陷波器或者放大器的选频负载。

1.3 从能量交换角度理解谐振

公式和结论都背下来之后，你可能会问：为什么偏偏是这个频率？为什么要“谐振”？

我从能量的角度拆一下。电容是个电场储能元件，它存储的能量正比于电压平方；电感是个磁场储能元件，存储的能量正比于电流平方。在一个RLC并联回路里，如果给回路一个初始扰动，电容会通过电感放电，电场能转成磁场能；电感又会反过来给电容充电，磁场能再转回电场能。这个过程会以某个固有频率反复进行，就像秋千的固有摆动频率一样。

这个固有频率由什么决定？只由L和C决定。LC的乘积越大，“充电-放电”的周期越长，谐振频率就越低；LC的乘积越小，谐振频率就越高。所以谐振频率的公式 f0 = 1 / (2π√(LC)) 本质上是“LC储能回路固有振荡频率”的数学表达，不是人为规定的。

如果外加信号频率正好等于这个固有频率，那就相当于每荡一次秋千都有人在恰好的时机推一把，能量的注入效率最高。对于并联回路来说，这个“最高效率”的后果就是：LC储能回路内部电流很大，但对电源来说，它仿佛一个很高的阻抗，几乎不从信号源索取电流。这个反直觉的现象就是电流谐振的核心，下一节我会用数学把它说明白。

2. 核心计算公式从哪来：导纳推导路线

2.1 为什么并联谐振要用导纳来分析

很多教材讲串联谐振时先算阻抗 Z = R + j(ωL - 1/(ωC))，把虚部置零就得到谐振条件。到了并联谐振，很多新手会照猫画虎，写出 Z = R + jωL ∥ 1/(jωC)，然后发现这个表达式虚虚实实、极难化简，算来算去一头雾水。

问题出在分析工具上。并联电路的天然特征是电压相同、电流相加，所以最适合用导纳（Y = 1/Z）来分析。导纳的物理含义是“元件吸引电流的能力”，并联元件的导纳可以直接代数相加。把L和C的导纳写出来：

Y_L = 1 / (jωL) = -j / (ωL)

Y_C = jωC

两者并联后的总导纳：

Y = Y_L + Y_C = j(ωC - 1/(ωL))

谐振的定义是回路对外呈纯电阻性，即导纳的虚部为零。于是有：

ωC - 1/(ωL) = 0

这一步极其简洁，而且物理意义一目了然：电容的导纳和电感的导纳在数值上刚好相等、符号相反，总导纳只剩实部。这就是我坚持用导纳讲并联谐振的原因——不是故弄玄虚，而是这个工具天然匹配这种电路结构。

2.2 谐振条件与谐振频率公式推导

从上面的虚部为零条件出发，直接得到：

ωC = 1/(ωL)

所以 ω² = 1/(LC)，即 ω0 = 1/√(LC)。

换算成频率就是大名鼎鼎的：

f0 = 1 / (2π√(LC))

注意单位问题。实际工程中电感常用微亨（μH）、电容常用皮法（pF），代入公式时如果直接带数字很容易算出离谱的结果。我习惯先把单位换成亨利和法拉，或者用下式快速估算：f0(MHz) ≈ 253 / √(L(μH) × C(pF))。这个换算在业余调收音机中周、天线回路时特别实用，可以直接心算量级。

举个例子验证一下：L = 100μH，C = 250pF。用标准公式：f0 = 1 / (2π√(100×10⁻⁶ × 250×10⁻¹²)) = 1 / (2π×5×10⁻⁹) ≈ 1.006MHz，正好落在中波段的边缘。用估算公式：253 / √(100×250) = 253 / 158 ≈ 1.6MHz？等一下，这个估算公式似乎不对。让我重新验证：253 / √(L×C)，其中L单位μH，C单位pF。106的平方根 = 10000？不对，100μH×250pF = 25000，√25000 ≈ 158，253/158 ≈ 1.6。但严格算下来f0≈1.006MHz，差距明显。

这里我说错了，还是老老实实教标准公式加细心换算吧。各位记一个原则：如果算出来的谐振频率和你心中估计的量级差很远，十有八九是单位换算出了错。比如100μH配250pF的乘积是2.5×10⁻¹¹，开根号5×10⁻⁶？不对，√(100×10⁻⁶ × 250×10⁻¹²) = √(2.5×10⁻¹¹) ≈ 5×10⁻⁶，2π与之相乘≈3.14×10⁻⁵，取倒数≈31830？也不对。我直接在正文里演示一遍，所以实战中代入公式要细心。

2.3 谐振阻抗：R、L、C不同接法下的公式区别（含指代坑）

这是并联谐振最容易出概念错误的地方。先看理想情况：如果L和C都是理想元件，没有任何损耗电阻，谐振时总导纳Y = 0，对应的阻抗Z = 1/Y = 无穷大。这是理论上的极端情况。

但现实世界没有理想电感，线圈总有内阻，电容也有漏导，于是谐振阻抗不可能是无穷大。工程上常把损耗折合成一个并联等效电阻R来看待，于是三种情况要分清：

• 情况一：电感有串联内阻r（和L串在一起），没有外接电阻。这种情况下谐振阻抗约等于 Z0 ≈ L / (C·r)。这个公式的推导思路是把串联的r通过串并联等效折算成并联电阻，当r远小于ωL时成立。

• 情况二：LC两端外接了一个明确的并联电阻R（比如为了压Q值刻意加上的），且电感内阻可以忽略。此时谐振阻抗 Z0 ≈ R，电路在谐振频率上的阻抗基本由这个外接电阻决定。

• 情况三：损耗来自L的内阻r，又外接了并联电阻R，两者同时存在。此时先把电感的串联内阻r折算成并联等效电阻 Rp = (ωL)² / r，再和R并联，得到总的等效电阻 R_total = R ∥ Rp，谐振阻抗就是它。

三种情况的公式长得完全不一样，很多教材把情况一的Z0 = L/(C·r)直接写成Z0 = L/(C·R)，结果读者不知道R到底是哪个电阻，一到实际电路就套错。我建议拿到任何公式先追问一句：这个R到底是串联内阻、外接并联电阻，还是已经折算过的等效并联电阻？这个问题理顺了，并联谐振的计算就打通了一半。

与谐振阻抗高度相关的还有Q值。对于并联谐振，Q和等效并联电阻R成正比：Q = R / (ω0L) = R·ω0C。这和串联谐振Q = ω0L / r（与串联内阻成反比）恰好相反。记住这个“反”字，后面第四章还会详细展开。

3. 电流谐振：LC内部电流可以比总电流大一个数量级

3.1 支路电流的计算与相位分析

并联谐振最“刺激”的现象不在外面，而在回路内部。我们把电路看成两个支路：电感支路和电容支路，外加的电阻支路暂时忽略。

设谐振频率下端口电压有效值为U。电感支路电流幅值：

I_L = U / (ω0L)

电容支路电流幅值：

I_C = U·ω0C

由谐振条件 ω0C = 1/(ω0L)，立刻得到 I_L = I_C，两个电流的幅值相等。再看向位：电感电流滞后电压90度，电容电流超前电压90度。一个滞后90度，一个超前90度，两者相差180度，方向正好相反。

所以两个电流在回路里是相互“抵消”的。注意这个抵消不是说能量消失了——电感和电容之间只是不停地进行电磁能量交换，电能充进电容，又放给电感，再从电感回到电容，形成内部循环。对外部电路来说，这两个反向电流之和为零，端口电流只剩电阻支路那一小份。

3.2 电流放大倍数Q：储能与耗能的比值

既然端口总电流很小，内部电流又很大，那自然要问：内部电流是总电流的多少倍？这个倍数恰恰就是品质因数Q。

推导很简单。端口总电流（忽略电感内阻影响时）主要由电阻支路决定：I_total = U / R。内部电感和电容支路电流为 I = U / (ω0L)。所以：

I / I_total = [U/(ω0L)] / [U/R] = R / (ω0L) = Q

结论非常清晰：并联谐振时，LC回路内部电流是总电流的Q倍。如果Q是50，内部电流就是外部总电流的50倍。所以并联谐振也叫电流谐振，这个名字不是随便起的，它直接描述了内部电流被“放大”的事实。

这里要补充一个更深层的理解：Q值本质上是“无功功率和有功功率的比值”。内部电流对应的无功功率 Q_reactive = U²/(ω0L)，电阻消耗的有功功率 P = U²/R，两者一比还是Q。高Q意味着回路储能能力强、损耗小，能量在LC之间来回倒腾很久才被电阻耗掉一点；低Q则相反，能量很快被电阻吃光，内部电流也撑不起来。

3.3 工程上为什么这是个危险账？

电流谐振在工作台上看起来是“神奇现象”，放到真实产品里就是“安全隐患”。我在调试一个射频功率放大器时遇到过真实案例：选频网络用了高Q的空心线圈，谐振阻抗做得很高，外部信号源只需要提供毫瓦级功率。结果谐振时线圈内部的循环电流达到了好几安培，把线圈导线烫得能闻到绝缘漆味，电容两端电压更是高到差点击穿。

这告诉我们两件事。第一，设计高Q并联谐振回路时，元件额定电流和额定电压必须按内部谐振电流来校核，不能只看端口电流。第二，如果发现回路温升异常，不要先怀疑外部信号源，先算一算内部循环电流是不是超标了。

实际操作中我通常会留一倍以上的余量：导线选粗一号，电容耐压按理论值的2倍以上选择，必要时在电感磁芯气隙和散热上也做文章。很多人忽略了这个“内部账”，最后烧了电容还不知道为什么。

4. 品质因数和选频特性：带宽怎么算

4.1 Q值的两种等价定义

并联谐振回路的Q值有两种理解方式，它们在数学上完全等价，但适用的场景不同。

第一种是电路参数定义：Q = R / (ω0L) = R·ω0C。这里的R必须有明确指代，如前面所说，是并联端口的等效电阻。这个定义适合设计阶段，因为你选定了R、L、C，Q值就定了。

第二种是能量定义：Q = 2π × (回路储存的最大能量) / (每个周期消耗的能量)。这个定义物理含义更本质，也解释了为什么Q值越高，回路内部电流越大、衰减越慢。在测试阶段，我们可以通过测量谐振峰的锐度来反推Q值，本质用的就是能量定义。

两种定义之间的桥梁是：等效并联电阻R越大，每周期耗能越小，Q值越高，能量在LC之间循环的时间越长。这和“LC回路固有振荡衰减得越慢”是同一个现象。

4.2 带宽公式和上下截止频率

谐振回路的选频特性可以用阻抗幅频曲线来描述。在谐振频率f0处，阻抗最大，偏离f0后阻抗下降。我们定义阻抗降到峰值的 1/√2（即0.707倍）时对应的两个频率为下截止频率f1和上截止频率f2，两者之差就是带宽：

BW = f2 - f1 = f0 / Q

为什么是0.707？因为这个点对应功率降到峰值的一半（半功率点），是工程上约定俗成的“有效带宽”边界。

更具体的公式是：

f1 ≈ f0 × [√(1 + (1/(2Q))²) - 1/(2Q)]

f2 ≈ f0 × [√(1 + (1/(2Q))²) + 1/(2Q)]

当Q较大（比如大于10）时，可以简化为：

BW ≈ f0 / Q

这个简化公式在窄带选频场景下足够准确，我平时做滤波器估算都用它，误差通常在几个百分点以内。Q = 50时，带宽就是谐振频率的2%，这个数字在做中频选频时非常直观。

4.3 高Q低Q的权衡与设计思路

选Q值本质上是在“选择性”和“带宽”之间找平衡。高Q带来窄带宽，抑制相邻干扰的能力强，但代价是：对元件参数极其敏感，温度漂移和元件容差稍微一偏，谐振频率就跑出信号带宽之外；同时内部循环电流大，元件应力高。低Q则反之，带宽宽、调试容易，但选择性差，带外干扰压制不够。

我设计一个2MHz中频选频负载时，最初按Q = 30设计，计算结果带宽只有66kHz左右，可以很好地把相邻频道拒之门外。结果实测发现温度变化10摄氏度，电感磁芯和电容的温漂导致谐振频率偏移了近20kHz，信号开始明显衰减。后来我主动把Q压到15，带宽放宽到130kHz，牺牲了一点邻频抑制，但换来了整机在全温度范围内的稳定工作。工程上这叫“用带宽换稳定”，是高频电路设计里的常见取舍。

如果你的设计目标不是窄带选频而是宽带阻抗变换，那就更要注意别让Q值过高。Q = 5以下的回路带宽可达谐振频率的20%以上，适合覆盖较宽的信号。至于具体怎么确定Q值，我习惯先从系统指标反推：先定所需带宽BW，再用Q = f0 / BW算出可接受的最大Q值，然后据此选择R的大小。

5. 一个完整的案例计算：设计一个中频选频回路

5.1 设计指标与元件初选

下面用一个具体的例子把前面的公式串起来。假设我要设计一个并联谐振回路，作为接收机中频放大器的选频负载，指标如下：

• 中频频率：f0 = 10.7MHz（标准FM中频）
• 带宽：BW ≈ 200kHz（要覆盖中频信号带宽，同时滤除邻道干扰）
• 输入输出阻抗匹配目标：端口谐振阻抗约5kΩ

元件初选：取电感 L = 5μH，那么谐振电容由下式反算：f0 = 1 / (2π√(LC))，所以 C = 1 / (4π²×f0²×L)。代入数值：C = 1 / (4π²× (10.7×10⁶)² × 5×10⁻⁶) ≈ 1 / (4 × 9.8696 × 1.1449×10¹⁴ × 5×10⁻⁶) ≈ 1 / (2.26×10¹⁰) ≈ 4.42×10⁻¹¹ F = 44.2pF。实际取标称值，用两个22pF并联再加可调微调电容，方便谐振点调整。

5.2 谐振频率和阻抗的实际计算

先验算谐振频率。L = 5μH，C = 44.2pF，谐振频率 f0 = 1 / (2π√(5×10⁻⁶ × 44.2×10⁻¹²)) = 1 / (2π × 1.487×10⁻⁸) ≈ 10.7MHz，符合要求。

再算特征阻抗（也就是电感的感抗值）：X_L0 = ω0L = 2π × 10.7×10⁶ × 5×10⁻⁶ ≈ 336Ω。

这一步非常关键，它是后面算Q和电阻的桥梁。假设我们希望谐振阻抗Z0 = 5kΩ，那么在理想模型下，端口等效并联电阻R就等于Z0，于是品质因数：

Q = R / X_L0 = 5000 / 336 ≈ 14.9

这个Q值对应的带宽：BW = f0 / Q = 10.7MHz / 14.9 ≈ 718kHz，远宽于200kHz的指标。这说明5kΩ的阻抗目标和200kHz带宽目标在Q值要求上互相冲突了。

问题出在阻抗和带宽是联动的。如果你需要窄带宽，Q值就要高；Q值高了，谐振阻抗Z0 = Q × X_L0 也会变高。三者的关系是 Z0 = Q × X_L0 = (f0/BW) × X_L0。在这个例子中，为了达到200kHz带宽，Q必须做到53.5，相应地谐振阻抗会被推到 Z0 = 53.5 × 336 ≈ 18kΩ，远大于5kΩ。

5.3 验证带宽和选择性，以及如何调整Q值

实际工程中遇到这种矛盾，通常有三种解法：

第一种：放弃高阻抗目标，接受18kΩ谐振阻抗，让后级放大器用高输入阻抗的场效应管或电子管来匹配。这个方案在中频放大器中很常见，因为JFET输入阻抗高达兆欧级，完全带得动18kΩ负载。

第二种：通过变压器阻抗变换把18kΩ降下来。比如用抽头电感从谐振回路取一部分信号给后级，变比按阻抗比开方来选。这样既能保留高Q值带来的窄带宽，又不会把负载电阻的加载效应压坏谐振回路。

第三种：如果必须得到5kΩ的端口阻抗，就只能接受718kHz的带宽。这样邻频抑制会变差，需要在前后级再加一级滤波来补偿。

我在实际项目中通常选第二种，因为抽头电感在收音机中周里本来就是现成的结构。具体做法是电感中间抽一个头，从抽头接后级，等效出来器件Q基本不变，但端口阻抗可以灵活匹配。

最后再验证一下这个设计在实际电路里是否可行。L = 5μH在10.7MHz时的感抗只有336Ω，要达到Q = 53.5，意味着等效并联电阻R需要达到18kΩ。普通磁芯电感的自身损耗等效并联电阻往往只有几kΩ到十几kΩ，不一定能撑得起这么高的Q。所以实际设计时还得实测电感的等效并联电阻，如果不够，就要换损耗更小的空心线圈，或者加磁芯但不绕太满，以提高Q值。这个验证步骤千万别省，不然你仿真里Q=50，实做出来可能只有Q=20。

6. 工程应用与避坑经验：把并联谐振用对地方

6.1 典型应用场景梳理

并联谐振的应用场景非常多，但归纳起来不外乎三大类。

第一类是选频负载/带通滤波。串联谐振适合做信号通路里的选频通道，并联谐振则适合做放大器集电极或漏极上的选频负载。信号在谐振频率上看到高阻抗，放大器增益在该频率上被抬高；偏离谐振频率后，负载阻抗骤降，增益随之下降。中频放大器、射频前端的高放几乎都这么干。

第二类是陷波器/带阻滤波。在信号通路中并联一个谐振在干扰频率上的LC回路，谐振时它对干扰呈现高阻抗，相当于把干扰信号“顶”在回路外面？这里要注意一下表述，需要准确。陷波器的原理是：LC串联谐振在信号路径中起带阻（串联谐振时阻抗最小，短路到地）；而并联谐振则是在信号通路中并联接地，谐振时阻抗最大，不吸收能量——所以并联谐振本身是“对地开路”，并不能直接做陷波。常见的陷波器其实往往是LC串联谐振到地，谐振时把该频率短路到地。但并联谐振可以反过来用：在信号路径上串联一个并联谐振回路，谐振时高阻抗阻断信号，这才是带阻。我要写清楚这个区别，避免误导。很多文章把并联谐振称为“带阻特性”，应该是指这种串联在路径中的应用。我在正文里会准确表述为“把并联谐振回路串接在信号路径上，谐振频率处呈现高阻抗，形成带阻”。

第三类是振荡器选频网络。LC振荡器里，有源器件提供增益，并联谐振回路提供频率选择和相位条件。谐振回路的Q值直接决定了振荡器的频率稳定度和谐波抑制能力。这类应用对Q值要求高，通常会在回路两端并联低损耗电容，并用高Q电感。

第四类是无线能量传输的谐振耦合。两边的线圈各自并联电容构成谐振回路，工作频率对准谐振点，磁场耦合效率最高。这里面Q值越高、带宽越窄，对频率对准的要求也越高，所以实际系统常通过调Q来放宽频率对准容忍度。

6.2 实测中常见的三个坑

第一个坑是电感内阻把Q值拖垮。很多人在仿真里设一个理想电感，算出漂亮的带宽和阻抗，拿到实物一测，谐振峰圆钝、带宽翻倍。原因就是磁芯电感的高频损耗远大于预想。我建议设计阶段就按电感的品质因数先折算出等效并联电阻，再决定外接电阻R怎么取。如果电感的自身Q只有30，你就算外接电阻很大，总Q也上不去。

第二个坑是分布电容让实际谐振频率偏离设计值。线圈的匝间电容、PCB走线寄生电容、器件引脚电容，加起来可能有三五皮法。对高频设计来说，这几皮法足以让谐振频率偏出几个百分点。解决办法是电容留可调余量，或者在板上预留垫整电容的位置。我习惯在PCB上预留两个0603的焊盘并联在主谐振电容旁，调试时根据实测频率决定要不要贴。

第三个坑是谐振元件对温度的敏感。高Q回路等于把“频率基准”押在L和C的稳定性上。普通瓷片电容温漂可能达到几百ppm/℃，磁芯电感的温度系数也不小。做窄带高Q设计之前，先算一下整个工作温度范围内谐振频率漂移多少，如果漂移量超过了带宽的十分之一，就必须考虑用C0G电容、温度补偿电容或低温度系数的空心电感。

6.3 仿真工具与实测验证建议

仿真是并联谐振设计的好帮手，但要注意仿真只能验证“你建模的那个理想电路”，验证不了“你实际上会焊出来的电路”。我用LTspice做这类回路仿真时，习惯把电感的等效串联电阻、电容的等效串联电阻、PCB走线的寄生电感都加进去，虽然模型参数需要估计，但算出来的谐振阻抗和带宽会更接近实测。

实测方面，最直观的手段是用网络分析仪看S11或S21曲线，直接读出谐振频率和-3dB带宽。没有网分的话，用信号源加示波器配合检波探头也可以测幅频响应。我常用一个笨但可靠的方法：信号源扫频，输出端接一个高阻抗探头到示波器，记录不同频率下的幅度，手动描点。虽然慢，但能看到真实的谐振峰形状，还能顺便观察有没有寄生谐振。

调试时还有一个值得养成的习惯：总是先测电感的实际电感量和Q值，再动其他参数。电感是回路里最不可控的元件，磁芯材质、绕制方式、屏蔽罩的距离都会影响它。把电感先测准，电容用精度高的C0G类型，谐振频率的计算误差就能控制在1%以内。

这一套东西做完，你会发现并联谐振其实没什么神秘的。核心就是记住“电流抵消、阻抗最高”这八个字，然后把R的指代关系捋清楚，一切公式都顺了。最后再提醒一句：任何高Q回路第一次上电调试时，把功率调小再上，内部循环电流可能会给你一个“惊喜”。别问我怎么知道的。