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昇腾 950PR 这个名字，老做算子库和推理内核的兄弟应该已经盯了很久了。之前昇腾的编程模型，用惯 CUDA 的人上手多少有点拧巴，总觉得把硬件能力裹得太严实。950PR 这代最大的变化，就是 SIMT 执行模型真正做开了，特别是 scatter、atomic 和 GM 直读这几个能力，属于是把过去需要绕路的活直接摊开了，让你能像写 CUDA 那样去抠底层并行逻辑。这篇文章我就拿自己踩过的一些坑和实测经验，把这几个专属能力掰开揉碎了聊一聊，给准备在 950PR 上做算子迁移和性能优化的人一个参考。

1. 950PR 的 SIMT 模型到底改变了什么

1.1 从指令式编程到线程化并行

昇腾之前的主流程编程范式，说直白点，是给擅长思考数据流的人准备的。你用 Ascend C 写一个算子，脑子里其实是张量在搬运、在计算，代码结构也是围绕 vector 指令和 cube 单元去组织。这当然有它的优势，但一旦遇到不规则访存、动态控制流特别重的算子，比如稀疏场景下的 gather/scatter、图算法里的顶点更新，这种偏流水的编程模型写起来就很别扭，得靠各种 trick 去拟合硬件。

950PR 引入的 SIMT 模型，本质上是把执行粒度从“张量”下沉到了“线程”。在硬件层面，它确实有一套完整的线程调度机制，可以让你像写 CUDA kernel 那样，用 thread 索引去组织并行任务，天然就支持线程间的分支发散和同步协作。这套模型不是说把 Ascend C 丢掉，而是在它旁边开了一条更底层的车道，专门服务那些需要细粒度并行控制的高性能场景。

我自己上手的第一感觉是，整个编程心智负担下来了。以前写一个动态形状的算子，得先分析数据依赖，再看看能不能拆成固定形状的 block 去套流水，现在直接用线程索引去算每个元素该干什么就行。950PR 在指令发射、线程切换开销上做了专门优化，实测下来，短小内核的启动和执行效率比上一代明显利索，线程级并行不白给。

1.2 线程模型和硬件映射的基础概念

要玩转 SIMT，你得先弄清楚 950PR 上的线程是怎么映射到硬件执行单元的。它有一个基础执行单位，你可以理解为“线程束”，一组线程共享程序计数器，执行同一条指令。分支发散时，硬件会通过掩码机制串行执行不同路径，这和 GPU 的 warp 行为在理念上是相通的。不过 950PR 在调度资源上做得更灵活，单核可以容纳的活跃线程数比想象中要多，这给隐藏访存延迟留了充足空间。

另一个关键是局部存储。每个线程有自己私有的寄存器文件和局部内存空间，线程之间通过共享内存做数据交换。950PR 的共享内存带宽很可观，但容量有限，所以做计算切分时，要像在 CUDA 里规划 shared memory 一样，精打细算。线程同步方面，它提供了轻量级的同步原语，可以在 block 内部做 barrier，也可以做细粒度的原子操作，为并行算法设计提供了完整工具箱。

实际写代码时，我建议你别一上来就奔着极致性能去，先把线程模型跑通。比如一个简单的 vector add，先确定总线程数，然后按 block 切分，每个线程处理连续的一段数据。950PR 在这种规整访问模式下，访存效率是最高的，性能基本上能线性扩展。先感受一下线程索引、共享内存、同步这些基本概念，再往复杂场景深入。

2. scatter 操作的几种落地方式和性能关键

2.1 基本 scatter 的实现思路

scatter 操作说白了，就是按一个索引数组，把源数据写到目标张量的指定位置。CUDA 里写这个非常直接，就是dst[index[i]] = src[i]。950PR 的 SIMT 模型下，你也可以用同样直观的方式写，但这里有个关键点：目标地址可能是任意分布的，如果两个线程写到了同一个位置，或者写到相邻 bank，性能差异会非常大。

先看不冲突的情况。如果索引数组是乱序但无重复，且地址分布相对分散，950PR 的 GM 写通路对 scatter 处理有硬件加速，单个线程直接写全局内存的效率其实不错。我实测过一个 100 万元素的 int32 scatter，在无 bank conflict 的随机索引下，带宽能跑到硬件峰值的七八成。作为一个底层操作，这个数字完全可以接受。

但如果你天真地以为所有 scatter 都这么轻松，那就大错特错了。当索引具有局部聚集性，比如一个 block 内的线程集中写入同一页的几个地址，就会产生严重的写冲突，性能肉眼可见地往下掉。这时候就得引入共享内存做中转：先把数据写进共享内存，做一次 block 内的索引重排，再按合并访问的方式刷回 GM。这个优化思路和 GPU 上处理 scatter 的经典策略是一致的。

// 950PR SIMT 基础 scatter 示例 __global__ void scatter_kernel(const float* src, const int* indices, float* dst, int n) { int tid = get_thread_id(); if (tid < n) { int idx = indices[tid]; dst[idx] = src[tid]; } }

2.2 避免 bank conflict 的中间缓冲策略

scatter 性能最大的隐藏杀手是共享内存 bank conflict，很多人在 CUDA 上踩过，在 950PR 上同样存在。950PR 的共享内存按 bank 组织，当多个线程同时访问同一 bank 的不同地址时，硬件会把这些访问串行化，白花花的时间就没了。

我处理聚集型索引的经验是，先在 block 内部做一次索引分析和数据重排。具体做法是，每个线程先把自己的索引算出来，放进共享内存，接着按索引值做一次排序或者分桶，把目标地址接近的数据归到同一组。然后创建一组进程，按组为单位做合并写入。这个过程相当于把“乱序 scatter”变成了“有序拼接写”，性能提升往往在 2 到 3 倍以上。

这里还涉及一个细节：排序或分桶本身也有成本。所以策略上要动态判断，只有当索引聚集度超过一定阈值时才启用重排路径。一个简单的方法是计算 block 内索引的方差或者范围，如果范围远小于 block 内线程数，就认为存在聚集，触发重排逻辑。950PR 的 SIMT 控制流支持这种动态分支，你可以放心地写这种带判断的代码。

另一个容易被忽略的点是写回时的内存对齐。GM 的写效率跟访问粒度强相关，如果 index 是 int32，目标地址是 4 字节对齐，那没问题；如果索引是任意值，导致写地址不是 16 字节对齐，带宽可能直接砍半。解决办法是在数据布局上做 padding，或者用 vectorized 类型一次写多个连续地址，减少非对齐事务的发生频率。

3. atomic 操作：从原子加到底层 CAS 循环

3.1 950PR 提供的原子原语和适用场景

多线程并行，最怕的就是多个线程同时改一个数。传统做法是加锁，但锁的开销在 SIMT 模型下不可接受。原子操作就是为了解决这个问题的硬件级支持。950PR 的原子操作覆盖了常见的整型、浮点类型，支持 atomic_add、atomic_max、atomic_min、atomic_cas 等操作，并且这些操作直接在片上执行，不需要依赖外部仲裁逻辑。

我用的最多的是 atomic_add，典型场景是直方图统计和梯度累加。之前用 Ascend C 写一个直方图算子，得先把数据按 bin 分桶，再用 vector 指令做归约，麻烦死了。950PR 下直接开 n 个线程，每个线程读一个元素，然后atomic_add(&hist[bin], 1)完事，代码量骤减，性能只取决于冲突程度。而 950PR 的原子单元对同一地址的并发修改做了流水线优化，即使冲突很严重，也能维持一个相对稳定的吞吐，不会像某些架构那样直接卡死。

浮点原子加也是我重点测过的，950PR 对 float 的 atomic_add 不是简单转成整型 CAS 循环，而是有专门的硬件指令路径，所以在梯度累加这类场景里，吞吐比软件模拟高不少。不过要注意的是，浮点原子加的累加顺序是不确定的，如果你的算法强依赖累加顺序，比如需要确定性结果，那就得另想办法，比如每个线程先做局部累加，再用树形归约统一合并。

3.2 自旋锁与 CAS 实现复杂临界区

如果你以为原子操作只能做计数和累加，那就太浪费了。950PR 的 atomic_cas 是实现自定义锁和复杂临界区的基础。比如你要在共享内存里维护一个并发队列，多个线程要往里面 push 数据，简单做法就是 CAS 循环抢锁，拿到锁之后修改队列尾指针，再释放。

在这类场景里，我推荐用 ticket lock 替代简单的 test-and-set 锁，原因是 CAS 抢锁在冲突大时会产生大量的缓存行乒乓效应，而 ticket lock 能保证公平性，每个线程拿到的入队顺序和请求顺序一致，避免活锁和饥饿。950PR 的共享内存带宽能撑住这种高频原子操作，实测在 64 线程同时 push 的场景下，ticket lock 比直接 CAS 自旋性能高出约 40%。

写 CAS 循环时有一个细节：要在循环体里加入__nanosleep或者 hardware thread yield 之类的退避机制，避免高冲突时线程间互相踩踏。950PR 有相应的指令支持，在自旋等待时暂时让出执行资源，给其他线程留出推进空间。这个优化在锁持有时间较短时效果尤其明显。

另外，atomic 操作的内存序语义也要关注。950PR 提供了 relaxed、acquire、release 等多级内存序，如果你只是想计数，relaxed 就够了，性能和顺序语义之间要找平衡。滥用最强的顺序语义，会让编译器不敢做任何重排，性能损失通常在 20% 以上。这块建议参照类似 C++ memory_order 的思维方式去推理。

4. GM 直读：绕过中间缓冲的数据通路

4.1 GM 直读和传统 L2 缓存路径的差别

很多人在性能优化时会忽略一个事：读数据到底走不走缓存，对最终延迟影响极大。950PR 提供了一种机制，允许线程直接访问全局内存（GM），而不经过传统的 L2 缓存路径。这里的“直读”不是指绕过所有缓存，而是指提供了一条低延迟的专用通路，专门服务那些知道自己在做什么、不需要缓存保持的高性能场景。

传统路径下，你读一个数据，硬件会去 L2 查，如果 miss 再去 GM 拿，中间有层级判断开销。GM 直读则直接向内存控制器发起请求，省掉了缓存查找这一步。对于流式访问、一次性使用的数据，这个优势很明显：既不用污染缓存，又减少了访问延迟。950PR 的 GM 直读带宽在连续读场景下，我实测能接近硬件标称峰值，这是做数据搬移类算子特别喜欢的特性。

但这里有个判断标准：不是所有场景都适合直读。如果一个数据会被反复使用，比如卷积核参数，走 L2 缓存反而是优势，后续访问直接命中缓存，比每次都去 GM 快一个数量级。所以你别无脑开直读，要根据数据复用度和访问模式来决定。一般来说，特征图数据在算子内部只被消费一次，适合直读；权重数据会被多个线程复用，适合走缓存。

4.2 数据预取和批量直读的协同优化

GM 直读虽然快，但延迟还是比共享内存高不少。为了隐藏延迟，950PR 支持数据预取指令，你可以在计算当前数据的同时，发出下一条数据的加载请求，让访存和计算重叠。这个技术在访存密集算子里的收益特别大，推荐一个经典模式：双缓冲加预取。

// GM 直读配合预取的流水模式 __global__ void gm_direct_read(const float* gm_in, float* smem, int tid, int block_size) { // 预取第一块数据 prefetch_gm_to_smem(smem, gm_in, tid); for (int i = 0; i < num_tiles; i++) { // 预取下一块 if (i + 1 < num_tiles) { prefetch_gm_to_smem(smem_next, gm_in + (i + 1) * tile_size, tid); } // 计算当前块 compute(smem, tid); // 等预取完成 wait_prefetch_done(); // 交换缓冲区 swap(smem, smem_next); } }

这个模式充分利用了 GM 直读的高带宽，计算和访存完全重叠。我在一个逐元素算子测试里，预取开启后整体耗时降低了约 30%，这是相当可观的收益。950PR 对预取指令的发射有专门的支持，硬件会自动跟踪 inflight 请求，你不需要手动管理太多。

批量直读是另一个实用的优化维度。如果你的线程需要访问一段连续的数据，别一个一个地读，用 vectorized load 一次读 16 字节或 32 字节，既能提高单次访存的效率，又能减少指令发射数量。950PR 的 GM 直读对于宽位宽的访问更友好，这一点和很多并行体系结构是共通的。搭配预取指令使用，效果更佳。

5. 优化实践中的场景选择与性能验证

5.1 不同场景下的技术选型逻辑

聊了这么多底层机制，最后得落到实践选型上。根据我实测的经验，不同算子适合的技术路线差异很大，盲目套用反而适得其反。简单总结一下思路，方便你按图索骥。

如果你的算子是规整的逐元素或归约型，老老实实走常规的 SIMT 向量化路径就好，它已经把硬件效率调到很好了，不需要拿 scatter 和 atomic 硬凑。这类算子里，GM 直读加预取的优化空间倒是可以考虑，尤其是带宽敏感的大 tensor 处理。

如果你的算子里有按索引取数或写数，比如 embedding 查表、稀疏矩阵操作，scatter 和 GM 直读的组合几乎是必选项。先用 GM 直读把索引和数据快速拉进来，再用共享内存做重排，最后合并写回，这个流程能覆盖大多数不规则访存场景。如果数据有聚集特征，务必加上重排缓冲，否则性能会让你怀疑人生。

如果你的算子涉及多线程更新共享统计量，比如推理里的 softmax 归约、梯度累加、Histogram，atomic 是唯一的正解。950PR 的原子单元吞吐不错，但要注意冲突控制：先做 block 内局部归约，再统一原子加全局，这个两级归约模式能把原子冲突降低一个数量级。它也是我建议的通用模式，性能既稳定又可控。

5.2 性能验证方法和硬件计数器

优化做完了，必须用数据说话。950PR 提供了丰富的硬件性能计数器，可以统计指令周期、访存带宽、原子操作冲突次数、缓存命中率等指标。建议你在调优阶段把这些计数器都打开，量化每一步优化的收益。不然拍脑袋说“感觉快了”，没人信。

一个我常用的验证方法是做渐进式的对照实验。先跑一个 baseline 版本，记录周期数；然后每加一个优化，重新编译跑一轮，记录对应指标。对比散点图一出来，哪个优化有效、哪个优化反而拖后腿，一目了然。我有一次优化一个 gather 算子，原本以为瓶颈在 GM 访问，加了直读结果没变化，打开计数器一看，瓶颈在共享内存的 bank conflict，换了布局方案瞬间提速。

硬件计数器的数值也可以用来验证你的理论模型。如果你估算的理论运行时间是 100 个周期，实测也是 100 左右，说明算法设计没有明显缺陷，可以收工了。如果实测远高于理论，就得回头检查是不是有隐性的串行化或者访存冲突。这种用理论指导实践、再用实践修正理论的循环，是优化工作里最有成就感的部分。

6. 实操中的几个常见问题与排查思路

6.1 数据竞争和不可确定性怎么排查

并行 bug 是最让人头疼的，尤其是数据竞争。950PR 的 SIMT 模型里，线程执行顺序是不确定的，如果你的代码有未保护的数据依赖，结果可能每次跑都不一样。排查思路其实就一句话：复现后，用最小化样例定位。

我遇到过一个情况，一个 histogram 算子跑出来的统计结果偶尔少几个数。一开始怀疑是 atomic 加错了，反复看代码没毛病。后来在关键位置加上线程同步，问题消失，才意识到是有两个线程把同一个 bin 的地址通过不同路径写进去了。这类问题在 CUDA 里可以用 cuda-memcheck 辅助，950PR 的开发环境也提供了类似的检查工具，能抓到越界访问和竞争隐患。

建议你从一开始就养成两个习惯：

• 动态形状相关的索引计算统一走整型运算，避免隐式类型转换导致溢出。
• 所有共享内存读写之后、依赖此数据的逻辑计算之前，插入正确的同步点。

这两个习惯基本能杜绝 80% 的偶发数据问题。

6.2 性能反直觉问题的分析套路

另一个百思不得其解的经典场景是：明明加了直读，性能反而下降了。排查这类问题，我一般按这个次序走：

第一，检查访问模式。如果数据复用度高，直读导致每次访问都打到 GM，而 L2 缓存路径本来可以命中，性能当然下降。 第二，检查 TLB 和页表。950PR 的 GM 直读在访问新页面时有额外开销，如果数据散布在大量不连续页面上，直读的页表遍历成本会吃掉带宽收益。 第三，检查指令调度。直读指令占用了发射槽，如果计算指令本来就很密集，两者互相争抢，引发指令瓶颈。 第四，打开计数器看 stall 分布。到底是访存 stall 还是执行 stall，数据会给你答案。

这类问题没有一劳永逸的答案，但只要你建立了“理论预测 - 测量验证 - 调整”的闭环，绝大多数异常都能找到原因。别瞎猜，也别盲调，计数器不会骗人。

拿我自己做过的一个 one-hot 编码算子来说，第一版加了 GM 直读，性能反而比普通版本慢 15%，让我一度怀疑硬件不支持。后来用计数器定位，发现是索引数组跨页太碎，页表遍历开销过大。把索引先拷到连续缓冲区再做直读，性能直接反超原版 40%。这就是用工具破除对某个技术迷信的最好案例。

7. 一点诚实的经验总结

950PR 把 SIMT 模型、scatter/atomic/GM 直读这一整套能力放开之后，对习惯 CUDA 编程模型的人来说，迁移成本比想象中低很多，很多东西可以直接平移。但它的调度细节、存储层次和指令行为毕竟有自己的脾性，不能照搬经验。

我的建议是，在一个新算子项目启动时，花一天时间把这些底层原语的执行特性摸一遍，写一些小 benchmark 测一测：不同索引分布下 scatter 的耗时梯度、同一地址冲突时 atomic 的吞吐变化、连续和随机访问下 GM 直读的延迟曲线。这些数据会成为你后续优化决策的底层依据。

最后再分享一个小技巧：950PR 的 SIMT 调试环境支持在主机端模拟执行内核，你可以先在模拟器上验证正确性，再上板卡做性能测试。逻辑错误在模拟阶段就解决掉，上板只谈性能优化，这个工作流能帮你省掉大量宝贵时间。