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做电力电子这些年，我越来越觉得，很多看似复杂的电源问题，拆到根上，就是几个很基础的小器件在“唱主角”。其中出场率最高的，一个是比较器，一个是R-S触发器。你去看那些成熟的电源方案：过压过流保护、滞环控制、无感方波电机的换相检测、软启动时序……背后几乎都有这两个元件的影子。

比较器负责“看”，它时刻盯着电压、电流这些模拟量，一旦越过设定界限就翻脸输出逻辑电平；R-S触发器负责“记”，它把比较器给出的瞬态事件锁存下来，告诉后面的控制器“刚才出过事，别不当回事”。这两个器件一配合，就成了电力电子系统里最朴素的“感知+记忆”闭环。这篇文章我就从实际工程角度，把这套组合的典型应用场景拆开聊一聊，重点讲清楚电路怎么搭、参数怎么算、坑在哪里，希望对正在做电源和电机驱动的朋友有参考价值。

1. 两个小器件，先搞清楚各自的角色定位

1.1 比较器：模拟世界和数字世界的翻译官

比较器本质上是一个1 bit的ADC。它有两个输入端，同相端和反相端，输出只有两种状态：高电平或低电平。当同相端电压高于反相端时，输出翻转，反之则回到另一状态。听着和运放很像，但它和运放的关键区别在于：运放工作在闭环线性区，比较器工作在开环饱和区，追求的是“要么最高、要么最低”的快速翻转。

在电力电子的实际电路里，比较器的输入信号通常是采样电阻上的压降、分压电阻网络得到的分压值、电流互感器二次侧的信号。这些模拟量经过比较器后，就变成干净的0/1信号，可以直接喂给MCU的GPIO、数字逻辑门电路或者R-S触发器。

选型上我偏爱开漏输出的比较器，比如LM393、LM339这一系列。开漏输出的好处是，输出电平可以由外部上拉电阻决定，方便和不同电压域的逻辑电路对接。比如比较器供电用12V，但后级MCU是3.3V逻辑，只要上拉到3.3V就行，不用额外加电平转换。这个特性在混合信号系统里非常实用。

1.2 R-S触发器：一个能记住事件的“比特位”

R-S触发器也叫复位-置位锁存器，是数字电路里最基础的状态存储单元。它有两个输入端，S（置位）和R（复位），两个输出端Q和Q非。用两个与非门交叉耦合就可以搭出来，也可以用现成的CD4044、74HC279这类集成RS锁存器。

R-S触发器在电力电子里的价值，不是拿来跑复杂逻辑，而是用来“记住一件事”。比如过流保护动作了，这个事件可能只持续几十微秒，MCU如果没赶上采样怎么办？有了R-S触发器，故障信号一到S端，Q端就被拉高并保持住，MCU随便什么时候来读都能读到。直到你主动给R端一个复位脉冲，它才恢复原状。

1.3 为什么这两个器件总爱成对出现

因为它们天生互补。比较器是“无记忆”的，输入信号回到正常范围，输出立刻跟着回；但电力电子系统里很多故障是瞬态的，比如负载突变带来的电流尖峰、电机启动瞬间的冲击电流，如果只靠比较器做保护，电路会处于“故障来了就关断、故障走了就恢复”的抖动的状态，轻则反复重启，重则器件过热损坏。

R-S触发器补上的正是“记忆”这一环。比较器检测到越界事件，触发器锁存故障状态，驱动电路保持关断，直到人工复位或系统确认安全后才重新启动。检测和记忆分离，这样的保护逻辑清晰又可靠，也是工业级电源设计里很成熟的做法。

2. 典型场景一：过压/过流保护，RS锁存怎么搭才可靠

2.1 保护电路的基本结构和锁存的意义

开关电源输入过流、输出过压，这些都是最常见的故障。如果不加锁存，保护电路很容易在故障和正常之间来回切换，导致电路间歇工作。举一个我实际调过的例子：某DC-DC模块输出短路时，电流采样电阻上的电压瞬间升高，比较器翻转，驱动芯片被关断。但驱动一关断，电流立刻下降，采样电压回落，比较器又翻回去，驱动重新打开，电流又飙升。这样循环几次，MOS管就热炸了。

加上R-S触发器以后，逻辑就完全不同了。比较器翻转后，触发器的Q端被置位，输出一个持续的保护电平，把PWM驱动死死拉住。哪怕比较器输入端已经恢复正常，Q端依然保持高电平。只有外部复位信号到来，系统才重新使能。这样做保护，才叫“锁得住”。

2.2 实战参数计算：过压保护阈值怎么定

以一个输出12V的电源模块为例，我要设计一个输出过压保护，阈值定在13.2V。用LM393比较器，反相端接采样分压，同相端接参考电压。

分压网络选择：上电阻100k，下电阻10k。正常情况下，12V输出电压在下电阻上的分压为：

12V × 10k / (100k + 10k) = 1.0909V

当输出过压到13.2V时，分压值变成：

13.2V × 10k / (100k + 10k) = 1.2V

所以参考电压就设为1.2V。这里我习惯用TL431产生参考电压，因为TL431内部其实就是一个带2.5V基准的比较放大结构，配合两个电阻可以把参考电压做得很准。分压电阻和参考电阻都选1%精度，误差能控制在1%以内。

需要注意一点：分压电阻阻值不宜太大。LM393的输入偏置电流虽然很小，但分压网络的阻抗如果到兆欧级，偏置电流引起的压降误差就不能忽略了。我一般控制在几十k到一百k级别，稳定性和功耗都能兼顾。

2.3 上电复位、复位逻辑和接线细节

RS触发器在保护电路里的接线，我最常用的方案是用两片LM393中的一个比较器做故障检测，再用CD4044或两个与非门搭锁存。正常的逻辑定义是：比较器输出高电平表示“异常”，这个高电平送到RS触发器的S端，把Q端置为高电平去封锁PWM。复位端R接到MCU的一个IO口，平时给低电平，需要清故障时给一个几十微秒的高脉冲。

这里有几个特别容易踩的坑。第一个坑是上电瞬间的误触发。电源刚上电时，各路电压都在建立过程中，比较器两个输入端的电压谁高谁低是随机的，很容易在启动瞬间误置位RS触发器，导致系统一上电就锁死。我的解决办法是给复位端加一个上电延时电路，用一个RC延时，上电后先把触发器复位一次，等比较器供电和参考电压都稳定了再放开。这个RC延时我一般取10ms左右，用100k电阻和100nF电容就行，大约1倍时间常数就有动作余量。

第二个坑是RS触发器的S端和R端谁是高有效、谁是低有效，不同芯片不一样。用与非门搭的RS锁存器是低电平有效，CD4044也是低电平有效的S/R输入。所以比较器输出要先反相一次再接进去，或者干脆用或非门搭的高有效版本。我吃过这个亏，第一次用CD4044时忘记反相，保护信号进S端完全没反应，逻辑反了。建议大家在图纸阶段就把真值表列出来核对一遍。第三个坑是驱动封锁信号的同步问题。触发器的Q端信号最好和PWM调制信号做一次与门处理，保证是在PWM高电平期间被封锁，不会产生半开半关的异常脉冲。

3. 典型场景二：滞回比较器与滞环控制

3.1 为什么需要滞回：单阈值比较器的“临界抖动”

假设你要监控一个母线电压，超过15V就报警断开。如果只用一个单阈值比较器，阈值就卡在15V上。实际信号不可能是一根直线，总会有纹波和噪声。当电压正好在15V附近慢慢漂移的时候，比较器会在阈值点反复翻转，输出一串毛刺信号。后级如果接了计数器或者RS触发器，可能被这串毛刺误触发，造成误报警甚至误保护。

这时候就需要滞回比较器。它有两个阈值：一个上门限，一个下门限。电压升到上门限才翻转，降到下门限才翻回去。中间这一片“模糊地带”就是滞回窗口，窗口内的噪声再怎么折腾，输出状态也不会变。这就是抗噪的原理，工程上叫做“施密特行为”。

3.2 滞回窗口计算：一个实例带你走通公式

滞回比较器的窗口宽度由正反馈电阻决定。以常见的同相输入滞回比较器为例，信号从同相端输入，反馈电阻R1从输出端引回同相端，同相端对地接R2。反相端接参考电压Vref。

上门限VTH和电压VTL的公式可以这样理解：输出为高电平VOH时，反馈电阻会把同相端的电压往上抬一点；输出为低电平时，又会往下拉。分压系数β = R2/(R1+R2)，那么：

VTH = Vref + β × (VOH - Vref)

VTL = Vref + β × (VOL - Vref)

滞回宽度ΔV = VTH - VTL = β × (VOH - VOL)

举个实例。Vref取2.5V，输出高电平5V，低电平0V，R1取10k，R2取100k，β = 100k/(10k+100k) ≈ 0.909。但这里反馈系数算错了，反馈应该看从输出到同相端的分压，反馈系数是R2/(R1+R2)，算出来是0.909，窗口宽度就是0.909 × (5-0) ≈ 4.55V，窗口太大，不合理。

实际中我通常希望反馈系数在0.05到0.2之间，也就是R1远大于R2。重新取R1 = 100k，R2 = 10k，β = 10k/(100k+10k) ≈ 0.0909。这样：

VTH = 2.5 + 0.0909 × (5 - 2.5) ≈ 2.727V

VTL = 2.5 + 0.0909 × (0 - 2.5) ≈ 2.273V

滞回宽度约454mV。信号超过2.727V翻转一次，低于2.273V才翻回来，窗口中心的2.5V附近有近半伏的噪声免疫能力，实际够用了。如果你的信号噪声幅度更大，适当减小R2或增大R1就行。计算滞回窗口时要把比较器的输出摆幅VOH和VOL当成已知条件，而不是默认5V轨到轨，这一点很多新手容易忽略。

3.3 滞环控制在Buck变换器中的实际应用

滞回比较器在电力电子里最经典的应用，就是Buck变换器的滞环电流控制。思路很简单：把电感电流采样值送进滞回比较器，参考值是电流给定Iref。当电感电流低于Iref减去半个窗口时，比较器输出高电平，开通上管；电流上升到Iref加上半个窗口时，比较器翻转，关断上管、开通下管。电流就在窗口内来回“爬坡-下降-爬坡”，像蛇形一样贴着参考值走。

这种控制的优点非常突出：不需要环路补偿网络，响应速度极快，负载突变时电流能在极短时间内被拉回窗口。而且参数设计直观，窗口宽度直接决定了电流纹波。假设采样电阻Rs为10mΩ，希望纹波电流是1A，那窗口电压就设成10mV，用前面滞回宽度公式反推反馈电阻就行。

这里有个要注意的事：滞环控制下开关频率是不固定的。输入电压越高、电感越小，电流上升越快，开关频率就越高。在某些条件下频率可能高到超出MOS管的承受能力，所以实际设计还要加频率限制逻辑，比如在比较器输出和驱动之间加定时最小开通/关断时间，或者用锁相频率方案。这是滞环控制最大的工程难点。

3.4 利弊分析：响应快但不固定频率

滞环控制的“快”和“不固定频率”是相伴而生的。有的场合，比如对EMC和电感损耗要求高的通信电源，就不太适合用纯滞环控制，因为频率不固定导致滤波设计困难。但放到电机驱动、LED恒流驱动、电池充电这类对动态响应要求高、对EMI容忍度高的场景，它就是一个体验非常好的方案。

另外，滞环控制很容易被误解成“不需要建模”，其实如果你要给这类系统做稳定性分析，还是要建立小信号模型，用描述函数法把继电器非线性特性线性化，求出等效增益和相位，才能预测窗口宽度变化对环路稳定性的影响。这个内容比较深，等以后专门写一篇展开。

4. 典型场景三：BLDC无感方波控制里的比较器与状态机

4.1 反电动势过零检测的基本原理

无感BLDC电机驱动，难点在于没有霍尔传感器，不知道转子位置。工程上最常用的方法就是检测反电动势的过零点。反电动势和转子磁场有关，当转子磁极扫过某相绕组时，该相的反电动势会从正到负或从负到正穿越零点，这个过零时刻和换相点之间有固定的30度电角度关系。

检测过零，最硬核的做法就是用比较器。把三相端电压分别和虚拟中性点电压比较，悬浮相的反电动势过零点，就是比较器翻转的时刻。相比用ADC去采样三相电压再做软件计算，硬件比较器法实时性更强，不占MCU资源，转速做高也不怕采样跟不上。

4.2 外部比较器法的硬件实现

外部比较器法的硬件结构一般是这样的：三相端电压经过大阻值分压电阻衰减到比较器共模输入范围内，同时各分压点并联一个小电容做低通滤波，滤掉PWM斩波纹波。虚拟中点由三个等值电阻星型连接得到。三个比较器的同相端接各自分压后的端电压，反相端接虚拟中点电压，输出就是三路过零检测信号。

这里有个细节要提醒：分压电阻的阻值不能取得太小，否则会额外给电机绕组加载，影响反电动势波形。但也不能太大，太大会和滤波电容形成低通滤波器，带来相位延迟。我一般取几十k的分压电阻，滤波电容按PWM频率的10到20倍设计截止频率。相位延迟没法完全消除，就得在软件里按当前转速补偿固定角度。示波器上你会看到，比较器输出的过零沿比理论点滞后一点点，转速越高滞后越多，这是个需要认真处理的误差源。

4.3 RS触发器在换相时序中的作用

过零检测比较器的输出，本质上就是一个个脉冲事件。MCU读到这些脉冲后，软件里做延迟30度换相。但在一些高速场合，软件中断处理可能来不及，或者你想把换相逻辑完全下放到硬件，RS触发器就派上用场了。

比较经典的做法是用RS触发器构成一个环形换相状态机。三路过零信号作为状态切换的触发条件，用触发器锁存当前换相状态，输出直接控制六个MOS管的开关组合。这种方式完全是组合逻辑+时序逻辑，不依赖MCU运行，延迟极低，适合对实时性要求高的电机控制器。还有一种更简单的用法：比较器过零信号送到RS触发器的S端，触发后由MCU在一个确定时间读走状态，然后发复位脉冲清掉，避免过零脉冲太短、MCU轮询时漏掉事件。这种“事件锁存”的用法，是RS触发器在电机控制里最值得复用的技巧。

5. 现场调试中的常见问题与排障技巧

5.1 问题速查表

这几个器件看起来简单，真正上到电路板调试，问题花样不少。我把这几年积累的典型问题整理成一张速查表，大家遇到类似现象可以直接对着排查。

5.2 我的几条避坑心得

比较器电源去耦这件事，再怎么强调都不为过。比较器翻转瞬间，输出级会有比较大的电流变化，如果电源引脚旁的去耦电容离得太远，电源线上毛刺就会耦合到输入端，造成比较器自激。我的习惯是100nF陶瓷电容紧贴电源引脚，有条件再并一个1uF到10uF的电容。

第二，分压电阻网络阻值别盲目加大。为了省功耗，有人把采样分压电阻做到兆欧级，结果输入偏置电流和PCB漏电流造成的误差比1%电阻误差还大，阈值漂移得不像话。对LM393这种输入偏置电流在几十nA级别的比较器，分压网络总阻抗控制在100k以内比较安全。

第三，RS触发器空余输入端不能悬空。用CD4044或者与非门搭锁存时，悬空输入会拾取噪声，导致莫名其妙的置位或复位。所有不用的输入引脚都要按逻辑要求接高或接低，哪怕你觉得“这个引脚反正用不到，留着悬空没事”，实际上了电它就会给你颜色看。

6. 仿真验证：上板之前先用工具把逻辑跑通

6.1 用PLECS做系统级逻辑验证

我平时做电力电子系统仿真用PLECS比较多。它的优点是把电路拓扑、控制算法、热模型放在一起，而且仿真速度比传统SPICE快很多，特别适合先验证控制逻辑和故障保护逻辑是否合理。

比如上面说的滞环Buck控制，在PLECS里搭一个Buck主电路，电感电流采样后用比较器模块加上滞回逻辑生成PWM，几分钟就能跑出完整的电流波形。故障保护逻辑也可以验证：注入一个短路故障，看RS触发器是否按预期锁存、驱动是否被正确封锁。PLECS的好处是不用关心比较器内部晶体管级的细节，逻辑对了就行，这正是“算法验证”阶段需要的效率。

6.2 用SPICE做器件级细节验证

系统级逻辑验证完，还得回到SPICE类工具里把器件细节确认一遍。用LTspice搭比较器电路，扫描输入电压，直接读出实际翻转阈值，和理论计算对比。这里尤其要验证滞回宽度，因为实际比较器的输出摆幅不是理想的0到5V，VOH受上拉电阻和负载影响，会直接影响滞回公式里的ΔV。

噪声仿真也建议这时候做。给输入信号叠加一个幅度接近滞回窗口的噪声，看输出会不会误翻转。如果噪声幅度还没到窗口的一半就翻了，说明电路中还有寄生耦合路径，要回头查PCB布局和地平面。这种问题到了实板上再查，成本就高了。

6.3 仿真和实测要对比的几个波形点

上板后我最关注的波形有这么几个：比较器输出沿是否干净，有没有振铃；RS触发器的Q端在故障注入后是否一次性锁存到位；PWM封锁点和触发器的置位点之间的时序关系。用示波器同时抓这四路信号，和仿真波形叠在一起看，假如误差在10%以内，说明电路设计和建模都比较到位。超出这个范围，优先怀疑比较器的传播延迟和分压网络的寄生电容，而不是怀疑理论公式。

最后再分享一个小技巧。如果你在做的是电机驱动这类有多路比较器的系统，建议把每路比较器的滞回电阻做成可调电阻或者预留贴片电阻位置。调试时先用大滞回保证系统稳定，再逐步减小窗口找到性能最优、又不误动作的最小值。这个参数在理论上算得再精确，到了实板上还是会因为布局、器件差异和温度漂移发生变化，留一手调试余地，能省很多返工时间。