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1. 项目概述与核心挑战

在精密测量领域，我们常常需要处理来自传感器、电桥或热电偶的微弱信号。这些信号往往被淹没在无处不在的噪声中，其中最难缠的“常客”之一，就是来自电网的50Hz或60Hz工频干扰。它就像背景里持续不断的嗡嗡声，如果不加以处理，再精妙的传感器读数也会变得毫无意义。因此，如何从噪声的海洋里，精准地捞出我们想要的信号，是每一位硬件工程师和嵌入式开发者必须面对的挑战。这不仅仅是选一个高分辨率的模数转换器（ADC）那么简单，更是一场关于信号完整性、噪声抑制和系统稳定性的综合战役。

德州仪器的ADS1260和ADS1261系列ADC，正是为赢得这场战役而生的利器。它们不仅仅是24位或32位的高分辨率ADC，更是一个集成了可编程增益放大器（PGA）、灵活数字滤波器和高级校准功能的完整信号链前端。其核心价值在于，它把对抗噪声、提升精度的复杂任务，从外部复杂的模拟电路设计，部分转移到了芯片内部可配置的数字域。这意味着，我们可以在不增加外部元件复杂度和成本的前提下，通过软件配置，实现针对特定应用场景的优化。今天，我们就来深入拆解ADS1260/61的三大核心武器：数字滤波器、工频抑制策略以及校准技术，看看它们是如何协同工作，将理论上的高精度转化为实际项目中稳定可靠的数据。

2. 数字滤波器：不只是滤波，更是系统带宽的守门员

很多人一提到ADC内部的数字滤波器，第一反应就是“滤除高频噪声”。这个理解没错，但太片面了。对于像ADS1260/61这样的Σ-Δ型ADC，其内置的数字滤波器承担着更核心的职责：决定系统的有效带宽和建立时间。它直接影响了你能测量多快的信号变化，以及需要等待多久才能得到一个稳定的读数。

2.1 SINC滤波器与FIR滤波器的本质区别

ADS1260/61提供了两种主要的滤波器类型：SINC（正弦基数）滤波器和FIR（有限脉冲响应）滤波器。选择哪一种，绝非随意，而是由你的应用需求决定的。

SINC滤波器，本质上是Σ-Δ调制器的自然输出经过一个低通抽取滤波器。它的频率响应在数据率（f_DATA）的整数倍处会产生“陷波”（Notch），即衰减极大的点。阶数（SINC1, SINC2, SINC3, SINC4, SINC5）越高，陷波越深、越陡峭，对特定频率噪声（如工频）的抑制能力就越强。但代价是建立时间（Latency）成倍增加。例如，在2.5 SPS数据率下，SINC1滤波器的建立时间约为400.4ms，而SINC4则长达1600ms。这意味着，如果你的输入信号发生阶跃变化，你需要等待超过1.6秒，ADC的输出才会完全稳定到新值。这对于多路复用（MUX）扫描或需要快速响应的控制系统来说，可能是无法接受的。

FIR滤波器则是一种线性相位滤波器，它的特点是零建立延迟（Zero Latency）。在表8中可以看到，FIR滤波器的建立时间与SINC1相当，但它没有SINC滤波器那样尖锐的工频陷波。它的优势在于通带内响应平坦，相位线性，非常适合需要快速、无失真捕捉信号波形的应用，比如振动分析或音频测量。但其对工频噪声的抑制，主要依赖于选择合适的输出数据率，让工频频率落在其固有的衰减带内。

实操心得：滤波器选择的黄金法则

1. 追求极致工频抑制和低噪声：优先选择高阶SINC滤波器（SINC3或SINC4）。牺牲速度，换取纯净度。适用于热电偶、电子秤、应力检测等慢变信号。
2. 需要快速响应或多路切换：选择FIR或SINC1滤波器。在数据采集系统中，如果通道切换频繁，漫长的建立时间会严重拖慢整体采样率。
3. 带宽匹配：务必参考表6的“-3-dB带宽”一栏。例如，选择SINC3滤波器、20 SPS时，系统带宽约为5.25 Hz。这意味着频率高于5.25 Hz的信号成分会被显著衰减。如果你要测量的信号变化频率接近或超过这个值，读数就会严重失真。永远确保你关心的信号频率远低于所选配置的-3dB带宽。

2.2 建立时间与数据吞吐量的权衡

建立时间（Conversion Latency）是评估ADC动态性能的关键参数，尤其在多通道扫描应用中。它指的是从启动转换（START引脚变高或发送START命令）到数据真正准备好（DRDY变低）所经历的时间。

第一个转换的延迟至关重要。从表8可以清晰看出，低数据率、高阶滤波器组合下，首次读数可能需要数秒。在连续转换模式下，首次转换完成后，后续的转换周期就稳定在 1 / f_DATA。但在脉冲转换模式或多路复用场景中，每次启动新转换都可能面临这个“漫长”的首次延迟。

避坑指南：多路复用系统的时序设计假设你用一个ADS1260轮询4个热电偶通道，使用SINC4滤波器、10 SPS。

• 理论通道扫描率：10 SPS / 4通道 = 2.5 次/秒/通道。
• 但实际呢？从表8查得，此配置下首次转换延迟为400.4ms。
• 最坏情况：切换到一个新通道后，需要等待400.4ms才能得到稳定数据。那么扫描完4个通道至少需要 4 * 400.4ms ≈ 1.6秒，平均每通道仅0.625 SPS，远低于预期。
• 解决方案：要么使用建立时间更短的滤波器（如SINC1或FIR），要么在软件上做“预采样丢弃”——切换通道后，丢弃前1-2个读数，只采集稳定后的数据，但这会损失时间。

3. 工频抑制：精准打击50/60Hz噪声

工频干扰主要通过空间辐射（电场、磁场）和传导（电源线、地线环路）两种方式耦合进测量系统。ADS1260/61的工频抑制策略，是数字信号处理智慧的集中体现：既然无法在模拟前端完全消除，就在数字域精准地对它进行“陷波”。

3.1 抑制原理：同步与陷波

其核心思想是让ADC的采样周期与工频噪声周期同步，或者成整数倍关系。这样，在每个转换周期内，工频噪声积分的结果理论上为零（或极小）。数字滤波器（尤其是SINC滤波器）的频率响应特性，天然地在数据率整数倍处形成陷波。通过精心选择输出数据率（f_DATA），我们可以让50Hz或60Hz正好落在这些陷波点上。

表7提供了不同数据率和滤波器类型下的工频抑制能力数据。解读这张表需要抓住几个关键点：

1. FIR滤波器在特定数据率下的优势：在2.5 SPS和5 SPS下，FIR滤波器对50Hz的抑制能力（-113 dB, -111 dB）甚至超过了SINC4滤波器。这是因为在这些低数据率下，FIR滤波器的频率响应零点恰好对齐了工频。
2. SINC滤波器阶数的影响：抑制能力随阶数线性增加。例如在2.5 SPS下，对50Hz ±2%的抑制，SINC1为-36dB，SINC2为-72dB，SINC3为-108dB，SINC4达到-144dB。每增加一阶，抑制能力提升约36dB（相当于噪声电压衰减到1/60）。-144dB意味着将噪声衰减到原值的千万分之六以下，效果极其显著。
3. 频率容差的重要性：表格分别列出了±2%和±6%频率偏差下的抑制能力。电网频率并非绝对稳定，会有轻微波动。可以看到，当工频偏移±6%时（即47Hz或63.6Hz），抑制能力会显著下降。例如，20 SPS下SINC4对60Hz的抑制从-136dB降至-96dB。这意味着，如果你的系统时钟（ADC的f_CLK）精度不够，或者电网频率波动较大，实际抑制效果会大打折扣。

3.2 数据率选择实战

如何根据表7选择最佳数据率？目标是在你需要的滤波器类型下，找到对目标工频（50Hz或60Hz）抑制最深的数据率。

案例：在中国（50Hz电网）环境，使用SINC3滤波器，追求最佳抑制。

• 查看表7中“50 Hz ±2%”列与“SINC3”行。
• 可以发现，在2.5 SPS时抑制为-108 dB，在5 SPS时为-102 dB，在10 SPS时为-102 dB，在20 SPS时仅为-54 dB。
• 显然，2.5 SPS是最优选择，提供了最强的108 dB抑制。
• 但别忘了带宽！再查表6，2.5 SPS下SINC3的-3dB带宽仅为0.65 Hz。这意味着你的信号带宽必须小于0.65 Hz。这对于测量缓慢变化的温度或压力是合适的，但对于任何快速变化的信号都不适用。

因此，工频抑制配置是一个典型的权衡过程：在“抑制深度”、“信号带宽”和“数据输出率”这个不可能三角中，找到属于你应用的最佳平衡点。

注意事项：时钟源是关键ADC的工频抑制效果严重依赖于其主时钟（f_CLK）的准确性和稳定性。ADS1260/61可以使用7.3728 MHz的内部振荡器或外部时钟。内部振荡器典型精度为±2.5%，这在要求严苛的工频抑制应用中可能不够。

• 强烈建议：在需要高精度工频抑制的应用中，使用一个高精度、低抖动的外部晶振或时钟发生器来提供7.3728 MHz时钟。这能确保数据率精确，让工频频率牢牢落在数字滤波器的陷波中心，发挥最大抑制效能。

4. 斩波（Chop）模式：消除器件自身的“暗伤”

即使我们完美地滤除了外部工频噪声，ADC和前端放大器自身产生的失调电压和1/f噪声（闪烁噪声）依然会污染直流或低频测量信号。失调电压会引入固定的偏移误差，而1/f噪声在低频段会显著增加噪声密度。斩波技术是解决这类问题的“神器”。

4.1 斩波的工作原理

斩波的本质是一种调制-解调技术。如图73所示，ADS1260/61的斩波模式在输入多路复用器之后，通过内部开关，交替交换输入信号（VAINP和VAINN）的极性。

1. 第一次转换（C1）：测量 (VAINP - VAINN - V_OS)，其中V_OS是内部失调电压。
2. 第二次转换（C2）：交换输入极性，测量 (VAINN - VAINP - V_OS)。
3. 内部计算：ADC将两次结果相减并除以2：输出 = [(C1) - (C2)] / 2 = [(VAINP-VAINN-V_OS) - (VAINN-VAINP-V_OS)] / 2 = (VAINP - VAINN)。

可以看到，通过这个巧妙的操作，失调电压V_OS被完美抵消了。同时，由于1/f噪声是低频相关的，在两次快速交替的测量中呈现相关性，也能在相减过程中被大幅抑制。

4.2 斩波模式的代价与收益

天下没有免费的午餐，斩波模式需要付出明确的代价：

• 数据率减半：因为需要两次转换才能产生一个有效输出。表8中的建立时间（Latency）在斩波模式下需要乘以2。例如，SINC4滤波器在10 SPS下的建立时间是400.4ms，开启斩波后，首次有效数据的等待时间将变为800.8ms。
• 噪声降低√2倍：由于对两次测量结果进行了平均，白噪声（宽带噪声）会降低√2倍（约3 dB），信噪比有所提升。
• 新的陷波频率：除了原有的数据率整数倍处的陷波，在f_DATA/2的整数倍处也会出现新的陷波点。这在系统频率规划时需要留意。

何时使用斩波模式？

• 追求极限直流精度和长期稳定性：例如高精度电子秤、基准电压测量、传感器桥路的失调校准。斩波能有效抑制温漂和时漂。
• 测量超低频或直流信号：此时1/f噪声是主要噪声源，斩波效果显著。
• 可以接受较低数据率：如果你的应用对速度不敏感，那么用速度换取精度是绝对划算的交易。

实操配置建议： 在寄存器MODE1的CHOP[1:0]位中，00为普通模式，01为斩波模式。开启斩波后，你需要根据翻倍的建立时间来重新评估系统的数据吞吐能力。在读取数据时，软件无需做额外处理，ADC内部已经完成了减法和平均计算，直接输出最终结果。

5. 校准技术：从“良好”到“卓越”的最后一步

即使采用了最好的滤波和斩波技术，ADC本身及其前端电路仍然存在增益误差和残余的失调误差。校准就是利用已知的参考点，对这些系统误差进行数字修正，将ADC的精度提升到其理论极限。

ADS1260/61提供了强大而灵活的校准功能，分为命令校准和用户校准两种方式。其校准模型如图74所示，数学表达为：最终输出 = (滤波器输出 - OFCAL) * (FSCAL / 400000h)其中OFCAL是24位偏移校准寄存器（二进制补码格式），FSCAL是24位满量程校准寄存器（直接二进制格式，400000h代表增益为1）。

5.1 校准命令：自动化校准流程

对于大多数应用，使用内置的校准命令是最方便、可靠的方式。芯片内部会自动完成信号施加、数据采集、计算和寄存器写入。

1. 偏移自校准（SFOCAL命令）：

   • 作用：校准ADC内部PGA和调制器产生的失调电压。
   • 过程：发送命令后，ADC自动内部短路输入（连接到内部共模电压），进行16次转换并取平均，计算结果自动写入OFCAL[2:0]寄存器。
   • 适用场景：上电后或环境温度变化较大时，用于消除芯片自身的零点漂移。这是最常用的校准。

2. 偏移系统校准（SYOCAL命令）：

   • 作用：校准整个信号链的失调，包括外部运放、多路复用器、PCB走线等引入的偏移。
   • 过程：需要用户在外部将ADC输入端短路（或接入已知的零电压源），然后发送命令。ADC同样进行16次平均计算并更新OFCAL寄存器。
   • 适用场景：需要极高绝对精度的系统，例如需要测量绝对电压值的数字电压表。

3. 满量程校准（GANCAL命令）：

   • 作用：校准系统的增益误差。
   • 过程：需要在ADC输入端施加一个精确的、接近正满量程的电压（例如，VREF * 0.9 / Gain）。发送命令后，ADC进行16次平均，计算出一个系数，使得这个已知电压的输入对应正满量程输出代码（7FFFFFh），并更新FSCAL[2:0]寄存器。
   • 关键点：必须先进行偏移校准，再进行满量程校准。因为失调误差会影响增益校准的准确性。

命令校准流程与避坑指南：

1. 稳定是前提：确保电源、参考电压和输入信号在校准前已完全稳定。特别是内部参考电压，上电后需要足够的启动时间（见数据手册）。
2. 配置锁定：确认寄存器锁定模式（REG_LOCK）处于解锁状态，否则校准命令无法写入寄存器。
3. 时序严格：如表14所示，校准时间很长（低数据率下可达数秒）。发送校准命令后，必须保持CS为低，且在此期间不能发送任何其他命令，直到DRDY变低指示校准完成。
4. 理解延迟：校准期间，ADC会暂停正常转换。在连续转换模式下发起校准，会导致数据流中断。

5.2 用户校准：更高灵活性与控制

对于有特殊需求，或者希望将校准参数存储在外部非易失存储器中的高级用户，可以采用用户校准模式。即手动完成测量、计算、并写入校准寄存器。

用户偏移校准步骤：

1. 将ADC输入端短路（系统零点）。
2. 启动连续转换，采集N个（例如64或128个）样本并计算平均值Code_zero_avg。平均是为了降低噪声对校准精度的影响。
3. 将计算出的Code_zero_avg值（24位二进制补码格式）直接写入OFCAL[2:0]寄存器（地址07h, 08h, 09h）。写入后，ADC输出值应为零。

用户满量程校准步骤（更需谨慎）：

1. 先进行偏移校准。
2. 施加一个精确的、接近正满量程的校准电压V_cal。理想值约为0.9 * VREF / Gain，为输出留出余量。
3. 关键预防步骤：为了避免校准计算过程中出现削波（clipping），先将FSCAL[2:0]寄存器设置为一个略小于1的值，例如0x3CCCCC（对应增益0.95）。
4. 采集N个样本并计算平均值Code_cal_avg。
5. 计算理论期望码值：Expected_Code = (V_cal * Gain / VREF) * 2^23。
6. 计算并写入新的FSCAL值：FSCAL_new = (Expected_Code / Code_cal_avg) * 0x400000将计算结果取整后，写入0Ah, 0Bh, 0Ch寄存器。

严重警告：用户校准的陷阱公式FSCAL_new = (Expected_Code / Code_cal_avg) * 0x400000是理想情况。在实际中，Code_cal_avg包含了残余失调和噪声。如果在计算前没有用临时FSCAL值（如0.95）预留足够余量，Code_cal_avg可能已经接近或达到满量程码（7FFFFFh），导致除法计算出的FSCAL_new过小，甚至为0，从而彻底破坏ADC的量程。务必遵循“先降增益，再测量，最后计算并恢复”的流程。

6. 系统集成与编程实战要点

理解了核心原理后，将其集成到实际系统中，还需要注意以下几个硬件和软件上的关键点。

6.1 时钟与电源管理

• 时钟选择：如前所述，对于工频抑制应用，强烈建议使用高精度外部晶振。将7.3728 MHz时钟信号接入CLKIN引脚。如果使用内部振荡器，需将CLKIN引脚接地。
• 启动顺序：上电后，通过读取STATUS寄存器的时钟模式位，确认ADC已切换到正确的时钟源。等待内部参考电压稳定（数据手册有典型时间），再进行校准或转换。
• 电源去耦：AVDD和DVDD必须用高质量、低ESR的陶瓷电容（如10uF钽电容+0.1uF陶瓷电容）在尽可能靠近引脚的位置进行去耦。模拟和数字地之间采用单点连接，避免数字噪声串入模拟信号路径。

6.2 SPI通信与数据就绪（DRDY）处理

ADS1260/61的SPI接口工作在模式1（CPOL=0， CPHA=1）。通信中最容易出错的是对DOUT/DRDY引脚和DRDY信号的处理。

• DOUT/DRDY引脚的双重功能：当CS为低且正在进行读数据操作时，该引脚作为数据输出（DOUT）；在其他时间，当CS为低时，它作为数据就绪（DRDY）信号。一个常见的简化设计是：将DOUT/DRDY引脚连接到MCU的SPI MISO线，同时将专用的DRDY引脚连接到MCU的一个外部中断引脚。这样，可以用中断高效地响应数据就绪事件，并通过SPI正常读取数据。
• 连续转换模式下的数据读取：如图75所示，在连续模式下，如果不在DRDY变低后及时读取数据，DRDY会在下一个转换周期开始前短暂变高。为了确保总是读取到最新数据，最佳实践是：将DRDY配置为触发MCU的外部中断（下降沿触发）。在中断服务程序中，发起SPI读取操作。
• 状态字节（STATUS）的妙用：启用STATENB位，可以让转换数据包中包含一个状态字节。其中的DRDY位可以用于软件轮询，判断当前读出的数据是否是自上次读取以来的新数据。这在无法使用硬件中断引脚时，是可靠的备选方案。

6.3 校准流程的嵌入式软件实现

下面是一个基于典型嵌入式系统的上电初始化及校准流程伪代码，涵盖了关键步骤和错误处理：

// 伪代码示例 void ADS1261_InitAndCalibrate(void) { // 1. 硬件初始化：配置SPI、GPIO（CS, START, RESET, DRDY中断） SPI_Init(); GPIO_Init(); Enable_DRDY_Interrupt(); // 配置DRDY引脚为下降沿中断 // 2. 复位ADC ADS1261_HardwareReset(); // 拉低再拉高RESET引脚 delay_ms(10); // 等待复位完成 // 3. 配置ADC基本参数（数据率、滤波器、增益、PGA启用等） ADS1261_WriteRegister(MODE0_REG, 0x04); // 例如：连续模式， 10 SPS ADS1261_WriteRegister(MODE1_REG, 0x00); // 禁用斩波，正常模式 ADS1261_WriteRegister(MODE2_REG, 0x80); // 启用PGA，增益=1 // ... 其他配置 // 4. 等待内部参考和电路稳定（至关重要！） delay_ms(500); // 等待时间参考数据手册，通常需要几百毫秒 // 5. 执行偏移自校准（SFOCAL） ADS1261_SendCommand(CMD_SFOCAL); // 等待校准完成，最可靠的方式是等待DRDY中断，或超时查询STATUS if (WaitForDRDY(5000) == TIMEOUT) { // 超时5秒 Handle_Calibration_Error(); return; } // 校准完成后，DRDY会变低，此时可以（可选）读取一次数据并丢弃 // 6. （可选）执行系统偏移和满量程校准 // if (需要更高精度) { // Connect_Zero_Voltage_to_Inputs(); // ADS1261_SendCommand(CMD_SYOCAL); // WaitForDRDY(...); // Apply_FullScale_Calibration_Voltage(); // ADS1261_SendCommand(CMD_GANCAL); // WaitForDRDY(...); // } // 7. 启动连续转换 ADS1261_StartContinuousConversion(); // 拉高START引脚或发送START命令 // 8. 主循环：等待DRDY中断，在中断服务程序中读取数据 } // DRDY中断服务程序 void DRDY_IRQ_Handler(void) { uint32_t raw_data; ADS1261_ReadConversionData(&raw_data); // 通过SPI读取24位数据+状态字节 Process_ADC_Data(raw_data); // 进行数据换算、滤波、存储等 }

常见问题排查速查表

通过以上从理论到实践、从配置到排错的全方位解析，我们可以看到，要将ADS1260/61这样的高精度ADC性能发挥到极致，远不是写几行SPI读取代码那么简单。它要求设计者深刻理解模拟信号链的弱点、数字信号处理的原理，并在系统设计之初就做出正确的权衡。从滤波器的带宽与抑制能力选择，到斩波模式对速度与精度的取舍，再到严谨的校准流程，每一步都关乎最终测量结果的可靠性与可信度。希望这篇深入的分析，能帮助你在下一个高精度测量项目中，游刃有余地驾驭这颗强大的ADC，让每一微伏的信号变化都清晰可辨。