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1. 深入解析ePWM时间基准模块：PWM周期计算与同步机制

在嵌入式实时控制领域，无论是驱动一台无刷电机平稳旋转，还是为开关电源生成精准的斩波信号，脉冲宽度调制（PWM）都是最核心的执行手段。我们常说的“调节占空比”来控制输出功率，其底层的一切时序基准，都源于一个看似简单却至关重要的模块——时间基准（Time-Base, TB）。今天，我们就抛开手册上那些冰冷的框图，从一线工程师的视角，深入聊聊TI C2000系列DSP中ePWM模块的时间基准核心。你会发现，精准的PWM波形生成、多模块间的复杂联动，其奥秘都藏在这个模块的计数器模式、周期计算和同步机制里。搞懂了它，你才能真正驾驭ePWM，设计出既稳定又灵活的功率控制系统。

2. 时间基准模块：PWM的“心脏”与“节拍器”

如果把整个ePWM模块比作一个交响乐团，那么时间基准子模块就是乐团的指挥和节拍器。它不直接产生音符（PWM边沿），但它决定了乐曲的速度（频率）、小节长度（周期）以及所有乐手（其他ePWM模块）何时开始演奏（同步）。它的核心是一个可编程的计数器，以及围绕它的一系列控制逻辑。

2.1 核心寄存器与时钟源

时间基准模块的核心是一个16位的计数器TBCTR和一个关键的周期寄存器TBPRD。TBCTR就像秒表的数字，不停地跳动；TBPRD则设定了这块秒表的最大计数范围，决定了它数到多少归零（或反向）。

所有计数的“滴答”声都来自于时间基准时钟TBCLK。这里有一个容易混淆的点：TBCLK并不是直接来自系统时钟SYSCLKOUT或外设时钟EPWMCLK，而是EPWMCLK经过一个可编程分频器后的结果。这个分频器由TBCTL[HSPCLKDIV]和TBCTL[CLKDIV]位域控制，支持广泛的分频比（如 /1, /2, /4, ..., /128）。因此，计算任何时间相关参数的第一步，永远是先确认你的TBCLK频率：

TBCLK = EPWMCLK / (HSPCLKDIV * CLKDIV)

实操心得：在系统初始化时，务必先配置好系统时钟和外设时钟，再计算并设置ePWM的时钟分频。我习惯在程序开头用宏定义或常量明确写出TBCLK的频率，后续所有周期、占空比的计算都基于此值，避免层层传递导致的混淆和错误。

2.2 三种计数器模式详解

时间基准计数器有三种基本工作模式，由TBCTL[CTRMODE]位控制。模式的选择直接决定了PWM波形的对称性，进而影响其在电机控制、逆变器等领域中的应用。

2.2.1 递增计数模式 (Up-Count Mode)

在这种模式下，计数器TBCTR从0开始，每个TBCLK周期加1，直到其值等于周期寄存器TBPRD的值。当TBCTR == TBPRD时，在下一个时钟沿，计数器被复位到0，并重新开始递增。

• 波形特征：生成非对称PWM波形。一个完整的PWM周期只包含一段递增过程。
• 周期计算：T_pwm = (TBPRD + 1) * T_tbclk
  • 为什么是TBPRD + 1？这是新手最容易出错的地方。因为计数器从0计数到TBPRD，总共经历了TBPRD + 1个计数值（0, 1, 2, ..., TBPRD）。例如，TBPRD = 4，计数器序列为 0->1->2->3->4，然后归零。这里包含了5个状态。
• 频率计算：F_pwm = 1 / T_pwm = EPWMCLK / ((TBPRD + 1) * 分频系数)
• 典型应用：常用于需要简单PWM生成的场合，如LED调光、蜂鸣器驱动。在电机控制中，较少用于主功率桥驱动，因为其非对称性可能引入偶次谐波。

2.2.2 递减计数模式 (Down-Count Mode)

与递增模式相反，计数器从TBPRD的值开始，每个TBCLK周期减1，直到其值等于0。当TBCTR == 0时，在下一个时钟沿，计数器被重新装载为TBPRD，并开始新一轮递减。

• 波形特征：同样生成非对称PWM波形。
• 周期计算：与递增模式完全相同，T_pwm = (TBPRD + 1) * T_tbclk。因为从TBPRD减到0，经历的计数值也是TBPRD + 1个。
• 应用提示：递减模式单独使用不常见，但其思想在上下计数模式中至关重要。

2.2.3 递增-递减计数模式 (Up-Down-Count Mode)

这是最强大、最常用的模式，尤其在电机控制和全桥/半桥逆变器中。计数器从0开始递增至TBPRD，到达后立即转为递减，回到0后再次转为递增，如此循环。

• 波形特征：生成对称或中心对齐的PWM波形。每个PWM周期包含一个完整的递增和递减过程，波形关于中心点对称。
• 周期计算：T_pwm = 2 * TBPRD * T_tbclk
  • 为什么是2 * TBPRD？因为一个完整周期包含了从0到TBPRD（TBPRD个步长）和从TBPRD回到0（TBPRD个步长），总共2 * TBPRD个计数值变化。注意，这里计数状态数是2 * TBPRD，而不是2 * TBPRD + 1，因为峰值点TBPRD不重复计算。
• 频率计算：F_pwm = 1 / T_pwm = EPWMCLK / (2 * TBPRD * 分频系数)
• 核心优势：
  1. 对称性：能有效减少谐波分量，特别是在电机驱动中，可以消除偶次谐波，降低转矩脉动和噪声。
  2. 双事件点：在一个PWM周期内，TBCTR会两次经过同一个非零的CMPA/CMPB值（一次递增，一次递减），这为生成复杂的多电平PWM或特定开关序列提供了便利。
  3. 自然生成死区：在中心对称模式下，互补通道的开关时刻自然围绕中心点对称，便于死区插入。

注意：在递增或递减模式下，TBCTR等于TBPRD或 0 的时刻只出现一次。而在递增-递减模式下，TBCTR等于TBPRD和 0 的时刻各出现一次。这对于基于这些事件触发ADC采样或中断至关重要。

3. 影寄存器机制：确保无毛刺的实时更新

在实时控制系统中，我们经常需要在PWM运行过程中动态调整周期（TBPRD）或比较值（CMPx），以实现变频控制或动态响应。如果软件直接写入正在被硬件使用的活动寄存器，可能会发生在计数器匹配的瞬间，导致产生一个极窄的、非预期的脉冲（毛刺），甚至引发桥臂直通等严重故障。影寄存器（Shadow Register）机制就是为了解决这个问题而生的。

3.1 影寄存器工作原理

以周期寄存器TBPRD为例：

• 活动寄存器 (Active Register)：直接与硬件比较器相连，其值直接决定PWM周期。软件不能直接安全地修改它。
• 影寄存器 (Shadow Register)：一个缓冲寄存器。软件平时更新的是它。在硬件认为“安全”的时刻，影寄存器的内容会被自动、同步地装载到活动寄存器中。

TBCTL[PRDLD]位控制此模式：

• PRDLD = 0（默认）：启用影寄存器模式。对TBPRD地址的读写操作均针对影寄存器。装载到活动寄存器的时刻由TBCTL2[PRDLDSYNC]选择，通常是在TBCTR=0或同步事件发生时。
• PRDLD = 1：立即装载模式。对TBPRD地址的读写直接操作活动寄存器。仅在初始化或对实时性要求极苛刻且能确保安全的场合使用。

装载时刻的选择策略：

• CTR=Zero时装载：这是最常用、最安全的方式。在递增或递增-递减模式下，计数器回到0的时刻是一个PWM周期的自然边界，在此刻更新周期不会对当前周期造成任何干扰。
• CTR=PRD时装载：在递增-递减模式下，也可以选择在计数器达到峰值时装载。这对于某些需要严格对称的双更新控制策略可能有用。
• 同步事件时装载：可以与外部或其他ePWM模块的同步信号挂钩，实现多个模块参数的同步更新。

3.2 比较寄存器的影寄存器

CMPA和CMPB寄存器同样拥有影寄存器，其控制位在CMPCTL寄存器中（SHDWAMODE,SHDWBMODE,LOADAMODE,LOADBMODE）。其装载时刻的选择更加灵活，除了CTR=Zero和CTR=PRD，还可以选择在两者都发生时装载，这对于在递增-递减模式下一个周期内更新两次占空比（双更新）至关重要。

双更新模式应用：在电机矢量控制（FOC）中，我们每个PWM周期需要更新一次空间矢量。在递增-递减模式下，若设置LOADAMODE在CTR=Zero和CTR=PRD时都装载，则可以在一个PWM周期的开始和中间各更新一次比较值，从而实现更快的电流环响应。但需注意，更新时刻必须避开功率管开关的瞬间，通常选择在计数器为0或TBPRD时。

实操心得：永远优先使用影寄存器模式。除非你在调试一个极其特殊的、单次触发的脉冲，否则直接写活动寄存器就是在“玩火”。在初始化配置时，就应养成为TBPRD、CMPA、CMPB配置好影寄存器装载模式的习惯。一个常见的错误是只配置了影寄存器使能，却忘了配置装载模式（LOADxMODE），导致影寄存器的值永远无法加载到活动寄存器，PWM参数无法更新。

4. 同步机制：多模块协同的“指挥棒”

在复杂的电力电子设备中，如三相逆变器、交错并联LLC谐振变换器，往往需要多个ePWM模块协同工作，它们之间必须有严格的相位关系。ePWM模块提供了多层次、灵活的同步机制。

4.1 时间基准时钟同步 (TBCLKSYNC)

这是最底层的同步，确保所有ePWM模块的“心跳”TBCLK完全对齐。它通过一个全局控制位TBCLKSYNC（位于PCLKCRx寄存器）实现。

正确的启用流程（必须严格遵守，否则可能导致模块间相位随机）：

1. 使能各ePWM模块时钟：通过PCLKCRx寄存器使能你要用的EPWM1、EPWM2等模块的时钟。
2. 停止所有TBCLK：将TBCLKSYNC位清零 (0)。此操作会暂停所有已使能ePWM模块的内部时间基准计数器。
3. 配置各模块：此时，安全地配置各个ePWM模块的TBCTL（模式、分频）、TBPRD、TBPHS（相位）等寄存器。因为计数器已停止，配置不会产生意外边沿。
4. 同步启动：将TBCLKSYNC位置1 (1)。所有ePWM模块的TBCLK将在下一个时钟上升沿同时开始运行，它们的TBCTR从当前值（通常是0或TBPHS）开始计数。

警告：TBCLKSYNC同步的是TBCLK的边沿，而不是计数器的值。要控制计数器之间的相位差，需要使用下一级的计数器同步功能。另外，所有需要同步的ePWM模块，其TBCTL[HSPCLKDIV]和[CLKDIV]必须设置为相同的分频系数，否则TBCLK频率不同，同步无从谈起。

4.2 时间基准计数器同步 (SYNCI/SYNCO)

时钟同步让大家都按同样的节拍走，但“起跑时间”可能不同。计数器同步则用于精确对齐或设定不同模块计数器之间的相位差。这是通过同步输入EPWMxSYNCI和同步输出EPWMxSYNCO信号链实现的。

同步链：如图15-7所示，同步信号可以像接力棒一样在模块间传递。例如，可以让EPWM1作为主模块，其SYNCO连接到EPWM2的SYNCI，EPWM2的SYNCO再连接到EPWM3的SYNCI，以此类推。

同步事件的行为：当一个ePWM模块检测到其SYNCI输入上有上升沿时，如果该模块的TBCTL[PHSEN]位被使能，则会在下一个有效的TBCLK时钟沿，将其相位寄存器TBPHS的值装载到时间基准计数器TBCTR中。

• TBPHS寄存器：这就是设置相位差的关键。例如，一个三相逆变器需要三路PWM互差120度。假设使用递增-递减模式，TBPRD设为1000对应180度电角度。那么：

  • EPWM1 (U相):TBPHS = 0
  • EPWM2 (V相):TBPHS = 333(对应120度)
  • EPWM3 (W相):TBPHS = 666(对应240度) 当主同步信号触发时，三个模块的计数器会分别被装载为0, 333, 666，从而实现了固定的120度相位差。

• PHSDIR位的作用：在递增-递减模式下，同步事件发生后计数器是继续递增还是递减？TBCTL[PHSDIR]位决定了同步后的计数方向。这在构建特定开关序列时非常有用。

软件强制同步：除了硬件同步输入，还可以通过写TBCTL[SWFSYNC]位产生一个软件强制同步脉冲，其效果与硬件SYNCI脉冲相同。这在主从模式切换或动态调整同步策略时非常方便。

注意事项：

1. 同步链深度：TI建议同步链的传递路径不要超过4个ePWM/eCAP模块，以避免过长的信号延迟导致同步偏差。
2. 边沿检测：SYNCI是上升沿触发。如果信号被持续拉高，不会引起连续同步。
3. 同步与影寄存器装载：同步事件 (SYNCI) 也可以被选为TBPRD或CMPx影寄存器的装载触发源 (PRDLDSYNC,LOADxSYNC)，实现参数更新与计数器相位的硬同步。

4.3 全局装载 (Global Load) 与联动写入 (Register Linking)

在变频应用中，我们可能需要同时更新多个ePWM模块的TBPRD和CMPx寄存器。如果使用普通的影寄存器机制，每个模块在自己的CTR=0时刻独立装载，由于软件写入顺序和计数器运行位置的微小差异，可能导致几个模块的更新发生在不同的PWM周期，造成瞬间的不平衡或次谐波。

• 全局装载 (Global Load)：通过配置全局装载控制寄存器GLDCTL和GLDCFG，可以将多个模块中使能了此功能的影寄存器的装载动作，绑定到同一个全局事件（如某个特定模块的CTR=PRD事件）。这样，所有相关寄存器会在同一个PWM事件边沿同时更新，确保了绝对的一致性。

• 寄存器联动 (Register Linking)：这是一个更紧密的耦合机制。通过EPWMxLINK寄存器，可以将一个ePWM模块的CMPA寄存器“链接”到另一个模块的CMPA。当你写入主模块的CMPA时，从模块的CMPA影寄存器也会在同一个写操作中被更新。这为需要完全镜像或严格比例关系的多相控制提供了硬件级的便利。

应用场景：在多相交错并联Boost PFC电路中，各相的占空比需要严格一致。使用寄存器联动功能，只需更新主相的CMPA，所有从相的CMPA自动同步更新，简化了软件计算和通信开销，并消除了更新时刻的微小抖动。

5. 实战配置：从理论到代码

让我们通过一个具体的例子，将上述概念串联起来。目标：配置EPWM1和EPWM2，产生两路中心对称PWM，频率为10kHz，EPWM2滞后EPWM1 90度相位。系统时钟EPWMCLK = 100MHz。

步骤1：确定TBCLK和TBPRD

1. 选择递增-递减模式，以产生对称PWM。
2. 选择TBCLK分频。为了获得较高的分辨率，我们选择不分频：HSPCLKDIV=1,CLKDIV=1，则TBCLK = 100MHz。
3. 计算TBPRD：
   • 公式：F_pwm = EPWMCLK / (2 * TBPRD * 分频系数)
   • 代入：10kHz = 100MHz / (2 * TBPRD * 1)
   • 解得：TBPRD = 5000
   • 周期T_pwm = 2 * 5000 * (1/100MHz) = 100us，符合10kHz要求。

步骤2：配置EPWM1（主模块）

// 假设已初始化系统时钟和外设时钟 // 停止TBCLK同步（配置期间） SysCtrlRegs.PCLKCR0.bit.TBCLKSYNC = 0; // 配置EPWM1时间基准 EPwm1Regs.TBCTL.bit.CTRMODE = 2; // 递增-递减模式 EPwm1Regs.TBCTL.bit.PHSEN = TB_DISABLE; // 主模块禁用相位装载 EPwm1Regs.TBCTL.bit.PRDLD = TB_SHADOW; // TBPRD使用影寄存器 EPwm1Regs.TBCTL.bit.SYNCOSEL = TB_SYNC_DISABLE; // 主模块SYNCO输出禁用，或设为CTR=0 EPwm1Regs.TBCTL.bit.HSPCLKDIV = TB_DIV1; EPwm1Regs.TBCTL.bit.CLKDIV = TB_DIV1; EPwm1Regs.TBPHS.half.TBPHS = 0; // 相位设为0 EPwm1Regs.TBPRD = 5000; // 设置周期值 // 配置比较器与动作限定器（以50%占空比为例） EPwm1Regs.CMPCTL.bit.SHDWAMODE = CC_SHADOW; // CMPA使用影寄存器 EPwm1Regs.CMPCTL.bit.LOADAMODE = CC_CTR_ZERO; // CTR=0时装载 EPwm1Regs.CMPA.half.CMPA = 2500; // 50%占空比 EPwm1Regs.AQCTLA.bit.ZRO = AQ_SET; // CTR=0时，EPWM1A置高 EPwm1Regs.AQCTLA.bit.CAU = AQ_CLEAR; // CTR=CMPA递增时，EPWM1A置低 EPwm1Regs.AQCTLA.bit.CAD = AQ_SET; // CTR=CMPA递减时，EPWM1A置高（对称波形） // 注意：在递增-递减模式，CAU和CAD通常配对使用以生成对称波形。

步骤3：配置EPWM2（从模块，滞后90度）90度相位差在递增-递减模式下，对应1/4个计数周期。TBPRD=5000，则90度对应5000 / 2 = 2500个计数值（因为一个电周期对应2*TBPRD）。我们希望EPWM2的波形比EPWM1滞后，即其计数器起始值应比EPWM1晚1/4周期。在同步发生时，EPWM1的TBCTR被装载为0，我们希望EPWM2被装载为2500。

// 配置EPWM2时间基准 EPwm2Regs.TBCTL.bit.CTRMODE = 2; // 递增-递减模式 EPwm2Regs.TBCTL.bit.PHSEN = TB_ENABLE; // 使能相位装载 EPwm2Regs.TBCTL.bit.PHSDIR = TB_DOWN; // 同步后向下计数（根据波形需要选择，此处选DOWN） EPwm2Regs.TBCTL.bit.PRDLD = TB_SHADOW; // 关键：设置SYNCI源。假设EPWM1的SYNCO连接到EPWM2的SYNCI EPwm2Regs.TBCTL.bit.SYNCOSEL = TB_SYNC_DISABLE; // EPWM2的SYNCO输出可根据需要配置 EPwm2Regs.TBCTL.bit.HSPCLKDIV = TB_DIV1; EPwm2Regs.TBCTL.bit.CLKDIV = TB_DIV1; EPwm2Regs.TBPHS.half.TBPHS = 2500; // 设置90度相位差 EPwm2Regs.TBPRD = 5000; // 周期必须与主模块相同！ // 配置比较器与动作限定器（与EPWM1相同逻辑） EPwm2Regs.CMPCTL.bit.SHDWAMODE = CC_SHADOW; EPwm2Regs.CMPCTL.bit.LOADAMODE = CC_CTR_ZERO; EPwm2Regs.CMPA.half.CMPA = 2500; EPwm2Regs.AQCTLA.bit.ZRO = AQ_SET; EPwm2Regs.AQCTLA.bit.CAU = AQ_CLEAR; EPwm2Regs.AQCTLA.bit.CAD = AQ_SET;

步骤4：同步启动

// 所有模块配置完成后，同步启动TBCLK SysCtrlRegs.PCLKCR0.bit.TBCLKSYNC = 1; // 如果需要立即同步计数器，可以触发一个软件同步（可选） EPwm1Regs.TBCTL.bit.SWFSYNC = 1; // 产生一个软件同步脉冲 // 这个脉冲会通过EPWM1的SYNCO输出传递给EPWM2的SYNCI // 导致EPWM1的TBCTR载入TBPHS(0)，EPWM2的TBCTR载入TBPHS(2500)

6. 常见问题与调试技巧实录

在实际项目中，配置ePWM时间基准时难免会遇到各种“坑”。以下是我总结的一些典型问题及排查思路。

问题1：PWM频率不对，或者根本没有输出。

• 排查清单：
  1. 时钟树：确认系统时钟SYSCLKOUT是否正确配置？ePWM外设时钟EPWMCLK是否使能（PCLKCR0寄存器）？
  2. TBCLK分频：检查TBCTL[HSPCLKDIV]和[CLKDIV]是否设置正确？这是最容易被忽略的一步。一个错误的分频比会导致频率偏差数倍。
  3. TBPRD值：根据所选模式（递增、递减、递增-递减）使用正确的公式计算TBPRD。TBPRD为0会导致计数器无法正常循环。
  4. 计数器模式：确认TBCTL[CTRMODE]不是00b（冻结模式）。
  5. GPIO复用：确认EPWM输出对应的GPIO引脚是否已正确配置为ePWM功能（通过GPxMUX和GPxGMUX寄存器）？
  6. 动作限定器：即使时间基准和比较器都正确，如果动作限定器AQCTL没有配置任何“置高”或“置低”动作，引脚也会保持默认状态（通常是高阻）。

问题2：动态更新TBPRD或CMPA时，PWM波形出现毛刺或跳动。

• 原因与解决：
  1. 未使用影寄存器：直接写入了活动寄存器。务必设置PRDLD=0和SHDWAMODE=0。
  2. 影寄存器未装载：使能了影寄存器，但装载模式LOADAMODE或PRDLDSYNC配置错误，导致影寄存器的值永远无法传递到活动寄存器。检查这些配置位。
  3. 更新时机不当：在双更新模式下（递增-递减，LOADAMODE在CTR=0和CTR=PRD都装载），如果你在计数器处于0和TBPRD之间写影寄存器，这个新值可能会在本周期下半段（递减段）立即生效，导致波形不对称。安全的做法是在中断服务程序中，在CTR=0或CTR=PRD事件触发中断时更新影寄存器。
  4. 全局装载冲突：如果使用了全局装载，确保所有相关模块的GLDCFG和GLDCTL配置一致，并且全局装载事件是你期望的。

问题3：多个ePWM模块之间无法同步，或者相位差不对。

• 排查步骤：
  1. TBCLKSYNC流程：是否严格按照“停止->配置->启动”的流程？在配置前，必须将TBCLKSYNC清零。
  2. TBCLK分频一致性：所有需要同步的模块，其TBCTL中的分频设置必须完全相同。
  3. 同步信号路径：通过SYNCSEL寄存器确认SYNCI信号源是否正确。例如，EPWM2的SYNCI是否真的来自EPWM1的SYNCO？
  4. 相位寄存器TBPHS：确认从模块的TBCTL[PHSEN]已使能，并且TBPHS的值计算正确。记住，在递增-递减模式下，TBPHS设置的是同步事件发生时计数器被装载的初始值，相位差需要根据计数方向（PHSDIR）和TBPRD来换算。
  5. 同步事件类型：检查主模块的SYNCO信号源（TBCTL[SYNCOSEL]），它应该在你需要的事件（如CTR=0）产生脉冲。

问题4：使用同步后，PWM输出偶尔会丢失一个脉冲或产生一个异常窄脉冲。

• 深度解析：参考手册图15-16的注释明确指出：“An EPWMxSYNCI external synchronization event can cause a discontinuity in the TBCTR count sequence. This can lead to a compare event being skipped.”
• 根本原因：同步事件是异步于计数器时钟的。如果同步事件发生时，计数器刚好跨过比较匹配点（CMPA），由于计数器被瞬间重载为TBPHS，原本该发生的比较匹配事件就可能被“跳过”。
• 解决方案：
  • 规划同步时刻：尽量将同步事件安排在PWM周期的边界（CTR=0），此时没有比较匹配事件发生，最安全。
  • 使用影子比较值：确保CMPA/CMPB使用影寄存器，并且其装载事件（LOADAMODE）设置为在CTR=0时发生。这样，即使计数器跳变，新的比较值也在周期开始时才生效。
  • 应用设计容忍：在一些对单个脉冲丢失不敏感的应用（如电机驱动，电流环惯性大）中，这种偶尔的跳变是可以接受的。但在精密定时或脉冲计数应用中，则需要避免运行时同步。

调试技巧：利用仿真器和GPIO

1. 软件仿真：在CCS的表达式窗口或内存浏览器中，实时监控TBCTR、CMPA、TBPRD等关键寄存器的值，观察其变化是否符合预期。
2. GPIO触发：将某个GPIO配置为普通输出，在关键的代码位置（如CTR=0中断入口、同步事件中断入口）对该引脚进行置位和清零操作。然后用示波器同时观察这个GPIO和PWM输出，可以直观地看到软件执行时刻与硬件波形的关系。
3. SYNCO输出监控：可以将某个ePWM模块的SYNCO信号输出到GPIO（通过配置SYNCSEL和GPIO MUX），用示波器测量同步脉冲的实际发��时刻和宽度，验证同步链是否正常工作。

理解ePWM时间基准模块的每一个细节，是构建稳定、可靠、高性能电力电子控制系统的基石。从周期计算到影寄存器更新，从时钟同步到相位控制，每一个环节都需要仔细斟酌。