Fly-Buck转换器设计:高效多路隔离电源解决方案
2026/7/16 13:16:10 网站建设 项目流程

1. Fly-Buck转换器设计背景与核心优势

在工业电源系统中,工程师常面临一个经典难题:如何从单一输入电源高效生成多个隔离电源轨?传统方案采用独立DC-DC转换器配合隔离变压器,不仅占用宝贵PCB空间,还增加系统复杂性和成本。TI推出的Fly-Buck™拓扑创新性地将同步降压转换器与隔离输出相结合,LMR36520正是这一技术的典型代表。

关键突破点:Fly-Buck利用降压转换器的次级绕组漏感作为隔离变压器,通过调整开关节点波形在副边产生隔离电压。这种设计省去了传统方案中的光耦和额外控制器,使BOM成本降低多达30%。

2. LMR36520关键参数与选型考量

这款4.2V至65V输入的同步降压IC集成了两个170mΩ MOSFET,支持2A连续输出电流。其核心优势在于:

  • 宽输入范围:直接适配24V/48V工业总线电压
  • 集成式设计:省去外部续流二极管,效率峰值达94%
  • 抖频技术:通过±6%的开关频率调制(100kHz-2.2MHz可调)降低EMI
  • 强健保护:包含UVLO/OCP/TSD多重保护机制

在实际选型时需特别注意:

D_{max} = 1 - \frac{V_{in(min)} \times η}{V_{out} + V_{in(min)} \times η}

其中η≈0.9,计算最大占空比时需确保不超过器件规格的70%(典型值)。例如在24V转5V应用中,Dmax≈17%,远低于安全阈值。

3. 变压器设计与布局要点

Fly-Buck的核心是耦合电感设计,必须满足:

  1. 匝比计算

    N = \frac{V_{sec} + V_{D}}{V_{pri}} \times \frac{1 - D}{D}

    其中VD为输出二极管压降(约0.5V)

  2. 电感量选择

    • 原边电感Lp需满足CCM模式工作:
      L_{p(min)} = \frac{V_{in(max)} - V_{out}}{2 \times I_{out} \times f_{sw}} \times D_{min}
    • 推荐值通常在10-47μH之间,过小会导致峰值电流过高
  3. 布局黄金法则

    • 将变压器尽量靠近IC的SW引脚(<5mm)
    • 副边整流回路面积控制在1cm²以内
    • 原/副边间距至少满足8mm爬电距离(针对250VAC隔离)

实测案例:使用Würth Elektronik 750313371(1:1匝比)时,在12V输入转5V/1A输出场景下,测得交叉调整率<±3%。

4. 闭环补偿与稳定性调试

由于副边采用开环结构,需通过原边调节实现稳定:

  1. 补偿网络设计

    • Type II补偿器典型值:
      Rcomp = 100kΩ Ccomp = 1nF Cpole = 100pF
    • 相位裕度建议>45°
  2. 实测调试技巧

    • 用频响分析仪测量开环传递函数时,在Vout端注入10-100mV扰动信号
    • 若出现次谐波振荡,可适当增大斜坡补偿(通过Radj引脚)
  3. 负载瞬态优化

    • 输出电容ESR需满足:
      ESR_{max} = \frac{\Delta V_{out}}{\Delta I_{out}} - \frac{1}{8 \times f_{sw} \times C_{out}}
    • 建议采用2×22μF MLCC并联100μF电解电容组合

5. 典型故障排查指南

现象可能原因解决方案
副边无输出变压器相位反接交换副边绕组引脚
输出电压波动补偿网络失效检查COMP引脚元件焊接
IC过热开关损耗过大降低开关频率或优化散热铺铜
EMI超标变压器耦合不良改用三明治绕法或增加屏蔽层

实测中发现的一个隐蔽问题:当输入电压接近65V上限时,SW节点振铃会加剧。通过增加1nF/100V的Csnubber电容可降低dV/dt约30%。

6. 进阶设计技巧

  1. 多路输出配置

    • 通过增加副边绕组实现,但需注意:
      • 交叉调整率会随负载差异增大而恶化
      • 建议对非主输出增加LDO后级调节
  2. 高压隔离优化

    • 采用三重绝缘线绕制变压器
    • 在原副边间添加2mm挡墙(满足3kVAC隔离)
  3. 效率提升手段

    • 选用低VF的肖特基二极管(如SS3H10)
    • 在轻载时启用PFM模式(通过MODE引脚设置)

在最近一个工业PLC电源模块设计中,采用LMR36520实现的12V/5V/±15V四路输出方案,相较传统方案节省了40%的PCB面积,并通过了CISPR 32 Class B辐射测试。

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